[发明专利]DRAM器件及其形成方法有效
申请号: | 201410513692.X | 申请日: | 2014-09-29 |
公开(公告)号: | CN105529328B | 公开(公告)日: | 2018-11-16 |
发明(设计)人: | 肖德元 | 申请(专利权)人: | 中芯国际集成电路制造(上海)有限公司 |
主分类号: | H01L27/108 | 分类号: | H01L27/108;H01L21/8242 |
代理公司: | 北京集佳知识产权代理有限公司 11227 | 代理人: | 高静;骆苏华 |
地址: | 201203 *** | 国省代码: | 上海;31 |
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摘要: | |||
搜索关键词: | dram 器件 及其 形成 方法 | ||
1.一种DRAM器件的形成方法,其特征在于,包括:
提供衬底,所述衬底包括存储器件区以及至少一个逻辑器件区;
在所述衬底的逻辑器件区以及存储器件区中分别形成第一栅极以及第二栅极;
分别在所述逻辑器件区中的第一栅极两侧的衬底,以及存储器件区中的第二栅极的两侧的衬底中形成凹陷,在所述凹陷中填充材料层,以分别形成所述逻辑晶体管和通道晶体管的源极或者漏极;
在所述通道晶体管的源极或者漏极上依次形成电介质层以及金属层,所述电介质层、金属层与所述通道晶体管的源极或者漏极用于构成电容器;
其中,形成第一栅极以及第二栅极的步骤包括:
所述第一栅极以及第二栅极分别为第一伪栅和第二伪栅;
分别形成所述逻辑晶体管和通道晶体管的源极或者漏极的步骤之后,所述形成方法还包括:
去除所述第一伪栅和第二伪栅,并在所述第一伪栅和第二伪栅的位置形成第一金属栅极和第二金属栅极;
去除第一伪栅以及第二伪栅的步骤包括:
在所述衬底上形成覆盖所述第一栅极以及第二栅极的介质层;
平坦化所述介质层使所述第一栅极以及第二栅极从所述介质层露出;
去除部分所述介质层,以露出所述通道晶体管的源极和漏极的其中之一;
刻蚀以去除所述第一栅极以及第二栅极,以在所述介质层中形成第一开口和第二开口;
形成所述第一金属栅极以及第二金属栅极的步骤包括:
在所述第一开口、第二开口底部以及所述露出的通道晶体管的源极或者漏极表面形成电介质材料,其中,位于第一开口、第二开口底部的电介质材料分别为所述第一栅极和第二栅极的栅介质层,位于所述露出的存储器件区中的源极或者漏极表面的电介质材料为所述电容器的电介质层;
在所述第一开口、第二开口中以及所述电介质层上形成金属材料层,其中位于第一开口、第二开口中的金属材料层形成所述第一金属栅极和第二金属栅极,位于所述电介质层上的金属材料层形成所述电容器的金属层。
2.如权利要求1所述的形成方法,其特征在于,提供衬底的步骤包括:
提供半导体基底;
在所述半导体基底上形成绝缘层;
在所述绝缘层上形成半导体层。
3.如权利要求1所述的形成方法,其特征在于,所述电介质材料为高K介质材料。
4.如权利要求1所述的形成方法,其特征在于,形成金属材料层的步骤包括:在所述第一开口、第二开口中以及露出的通道晶体管的源极或者漏极表面形成金属材料层,平坦化所述金属材料层,使所述电容器的金属层的表面与所述第一栅极和第二栅极的表面齐平。
5.如权利要求1所述的形成方法,其特征在于,提供衬底的步骤之后,形成第一栅极以及第二栅极的步骤之前,所述形成方法还包括:所述形成方法还包括:
对所述衬底位于逻辑器件区以及存储器件区的部分进行掺杂。
6.如权利要求5所述的形成方法,其特征在于,对衬底位于逻辑器件区以及存储器件区的部分进行掺杂的步骤包括:
使所述衬底中掺杂离子的掺杂浓度从衬底表面到衬底中心逐渐减小。
7.如权利要求1所述的形成方法,其特征在于,形成所述逻辑晶体管和通道晶体管的源极或者漏极的步骤中,
在所述凹陷中填充的材料层为金属。
8.如权利要求7所述的形成方法,其特征在于,形成所述逻辑晶体管和通道晶体管的源极或者漏极的步骤还包括:对金属进行退火处理。
9.如权利要求1所述的形成方法,其特征在于,所述电容器的金属层为钨或者铝金属层。
10.如权利要求1所述的形成方法,其特征在于,所述电容器的电介质层的厚度在1.5纳米~3纳米的范围内。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的