[发明专利]一种电力远程抄表系统在审

专利信息
申请号: 201410638741.2 申请日: 2014-11-13
公开(公告)号: CN104361731A 公开(公告)日: 2015-02-18
发明(设计)人: 彭传军;刘奇;李英姿;李峰 申请(专利权)人: 国网河南省电力公司南阳供电公司
主分类号: G08C17/02 分类号: G08C17/02;G08C23/04
代理公司: 郑州红元帅专利代理事务所(普通合伙) 41117 代理人: 季发军
地址: 473000 *** 国省代码: 河南;41
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摘要:
搜索关键词: 一种 电力 远程 系统
【说明书】:

技术领域

发明涉及用电力领域,具体是一种电力远程抄表系统。

背景技术

长期以来,电力抄表人员必须到每家每户抄写用量,效率低、劳动强度大,还可能因人为失误抄错数据,所抄数据由抄表人员带回相关部门汇总处理,再通知用户到指定地点缴费,各用户作息时间不同,使抄表人员常常走空路,多次上门都无法完成抄表工作,影响整体抄表收费工作的正常进度,难以做到实时监控、及时发现异常并快速排查故障,智能电表可以减小抄表收费的压力。

现有技术中,电力远程抄表系统主要有远传式电力远程抄表系统和IC卡预付费式电力远程抄表系统。远传式电力远程抄表系统带有远传通信接口,主要包括用户端和管理端,用户端包括电表、采集器、数据处理器和无线电发射模块,电表数据处理器将电脉冲信号送给采集器,采集器经过无线电发射模块将信号传给数据处理器,电表自动抄表可通过通信接口读取电表读数,但不能在表端充值、实现表端预付费功能。

发明内容

本发明的目的在于提供一种能够进行远程自动抄表和远程充值,进行预付费功能的电力远程抄表系统,以解决上述背景技术中提出的问题。

为实现上述目的,本发明提供如下技术方案:

一种电力远程抄表系统,包括计算机控制管理系统、集中器和智能电表,所述计算机控制管理系统通过集中器连接智能电表,所述智能电表包括电表基表和用于读取电表基表数据的采样单元,所述采样单元的输出端连接有控制芯片U1,控制芯片U1的输出端分别连接有红外通信模块、时钟模块、显示模块和通讯模块,所述通信模块连接集中器。

作为本发明进一步的方案:所述控制芯片U1的1脚分别连接二极管D1、电容C3、电容和C4和控制芯片U1的64脚,控制芯片U1的52脚分别连接振荡器Y2和电容C13,控制芯片U1的53脚分别连接振荡器Y2另一端和电容C12,电容C13另一端连接电容C12另一端,控制芯片U1的7脚分别连接电容C7和电容C8,控制芯片U1的8脚通过振荡器Y1连接控制芯片U1的9脚,控制芯片U1的49脚连接电阻R22,控制芯片U1的48脚分别连接电阻R20和电阻R21,控制芯片U1的58脚分别连接复位芯片U3的OUT端口、复位芯片U3的VDD端口和电阻R6。

作为本发明进一步的方案:所述计算机控制管理系统通过3F网络、GPRS网络或互联网与集中器相连。

作为本发明进一步的方案:所述控制芯片U1的型号为MSP430F247。

作为本发明进一步的方案:所述时钟模块包括型号为8563T的时钟芯片U2,时钟芯片U2的1脚通过振荡器Y3连接时钟芯片U2的2脚,时钟芯片U2的5脚分别连接电阻R17和控制芯片U1的4脚,时钟芯片U2的6脚分别连接电阻R16和控制芯片U1的3脚,时钟芯片U2的8脚分别连接电容C14、电阻R16另一端和电阻R17另一端。

作为本发明再进一步的方案:所述红外通信模块包括红外发送电路和红外接收电路,红外发送电路中红外发射管DS1通过电阻R28连接三极管Q3的发射极,三极管Q3的基极通过电阻R29连接控制芯片U1的34脚,三极管Q3的集电极连接三极管Q2的集电极,三极管Q2的基极通过电阻R30连接控制芯片U1的37脚,三极管Q2的集电极接地,红外接收电路中红外接收头B1的1脚分别连接电阻R3和电阻R31,电阻R31另一端连接控制芯片U1的33脚,红外接收头B1的2脚接地,红外接收头B1的3脚分别连接电容C11和三极管Q4的集电极,三极管Q4的基极通过电阻R5连接控制芯片U1的31脚。

与现有技术相比,本发明的有益效果如下:

(1)本发明通过计算机控制管理系统对电表的通信与控制,实现了电表的远程管理与监控;(2)本发明同时具备远程抄表和远程充值预付费的功能;(3)一个计算机控制管理系统可通过多个集中器连接多个智能电表,实现了一对多的抄表和预付费模式,(4)采用型号为MSP430F247的控制芯片,低电压供电、超低功耗、可靠、性价比高、带A/D转换器、带串口,采用复位芯片避免电路在低压下工作异常;(5)采用时钟芯片为智能电表提供日历和时钟的功能;(6)采用红外通讯模块设置智能电表的初始参数,不工作时电路基本无功耗;(7)本发明结构简单、元器件少,成本低,可广泛应用于远程抄表、远程预付费控制。

附图说明

图1为本发明的结构示意图。

图2为本发明中控制芯片U1的引脚图。

图3-7为本发明中控制芯片U1的外围电路图。

图8为本发明中的时钟模块电路连接图。

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