[发明专利]一种用于时钟恢复的网络数据计数器在审
申请号: | 201410761225.9 | 申请日: | 2014-12-12 |
公开(公告)号: | CN104486021A | 公开(公告)日: | 2015-04-01 |
发明(设计)人: | 胡强;吴援明 | 申请(专利权)人: | 成都朗锐芯科技发展有限公司 |
主分类号: | H04J3/06 | 分类号: | H04J3/06;H04L12/823;H04L12/885 |
代理公司: | 四川力久律师事务所 51221 | 代理人: | 林辉轮;王芸 |
地址: | 610041 四川省成都*** | 国省代码: | 四川;51 |
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摘要: | |||
搜索关键词: | 一种 用于 时钟 恢复 网络 数据 计数器 | ||
技术领域
本发明涉及一种网络通信领域,特别涉及一种用于时钟恢复的网络数据计数器。
背景技术
如图1所示,CES(Circuit Emulation Service)电路仿真提供一种从电路交换网到分组交换网的平稳过渡方案,发送端PE设备将TDM数据通过实时封装,经分组网络传输达接收端,在接收端PE设备接收端数据缓存队列恢复出同步时钟,同步时钟解封装数据帧,重组为TDM数据流;但因为TDM网是一种同步网,分组网为典型的异步网,TDM数据在通过分组网传送到接收端时会造成自身的时钟信息丢失,因此在接收端恢复TDM数据时的时钟恢复技术至关重要,数据时钟信息的恢复直接影响数据传输的质量,目前的时钟恢复技术存在着恢复所需时间长、恢复精度差等问题。
发明内容
本发明的目的在于克服现有技术中所存在的上述不足,提供一种恢复精度高、恢复所需时间短的基于TDM的网络时钟恢复系统;包括数据时钟分径模块、数据缓存模块、时钟恢复模块、并串处理模块;所述数据时钟分径模块分别与所述数据缓存模块、时钟恢复模块连接;所述数据缓存模块、所述时钟恢复模块均与所述并串处理模块连接。
所述数据时钟分径模块用于将从分组网络接收到的网络数据中的控制字部分送入时钟恢复模块。
所述数据缓存模块用于对所述网络数据进行排序、丢包处理。
所述时钟恢复模块用于接收所述网络数据的控制字部分,并计算、调整所述网络数据的恢复时钟。
所述并串处理模块用于将所述经过排序、丢包处理的网络数据和计算调整出的恢复时钟频率进行并串处理。
进一步的,所述时钟恢复模块包括网络数据计数模块和时钟调整模块,所述网络数据计数模块包括控制模块、计数模块、偏差计算模块;所述控制模块分别与所述计数模块和偏差计算模块连接;所述偏差计算模块与所述时钟调整模块连接;所述时钟调整模块的输出端与所述计数模块连接。
所述控制模块用于控制各个模块的运行;所述计数模块用于根据所述时钟调整模块输出的当前恢复时钟频率对接收到的数据进行计数;所述偏差计算模块用于计算当前恢复时钟频率的时钟偏差;所述时钟调整模块用于根据所述偏差计算模块的计算结果调整数据的恢复时钟,并将当前恢复时钟输出。
进一步的,所述偏差计算模块包括时钟计数值累加模块,时钟采样次数累加模块、平均时钟计数计算模块和平均时钟计数对比模块。
所述时钟计数值累加模块用于累加单一计算周期内的时钟计数累加值。
所述时钟采样次数模块用于记录单一计算周期内实际采样次数。
平均时钟计数计算模块用于计算并存储单一计算周期内的平均时钟计数,计算周期内的平均时钟计数=计算周期内的时钟计数累加值/计算周期内实际采样次数。
所述平均时钟计数对比模块用于对比当前时钟周期内平均时钟计数与上一时钟周期内的平均时钟计数的大小。
进一步的,所述时钟调整模块中包括基准脉冲产生模块、恢复时钟产生模块和脉冲增减模块。
所述基准脉冲产生模块用于产生基准脉冲。
所述恢复时钟产生模块用于根据所述基准脉冲产生当前恢复时钟。
所述脉冲增减模块用于根据所述偏差计算模块的计算结果对当前恢复时钟包含的基准脉冲进行增减操作。
优选的,所述基准脉冲频率为327.68MHz。
优选的,所述计数模块中采用递减的方式实现接收数据的计数。
进一步的,所述数据缓存模块包括写入控制模块、读出控制模块、抖动缓存模块,所述写入控制模块的输入端与数据接收端口连接,所述写入控制模块的输出端与所述抖动缓存模块连接,所述抖动缓存模块还与所述读出控制模块连接;所述写入控制模块用于控制网络数据的写入;所述抖动缓存模块用于存储所述网络数据;所述读出控制模块用于控制所述抖动缓存模块中网络数据的读出。
进一步的,所述抖动缓存模块包括标志存储模块和数据存储模块,所述标志存储模块包括写读标志存储模块和序列号存储模块;所述数据存储模块用于存储所述网络数据的净荷部分;所述读写标志存储模块用于存储与净荷部分一一对应的写读标志;所述序列号存储模块用于存储网络数据的序列号部分。
进一步的,所述写入控制模块还连接有写基准时钟产生模块,所述读出控制模块还连接有读恢复时钟产生模块,所述写基准时钟产生模块用于产生控制所述写入控制模块的基准时钟;所述读恢复时钟产生模块用于产生控制所述读出控制模块的恢复时钟。
优选的,所述写入数据步骤在81.92MHz基准时钟下工作,所述读出数据步骤在81.92MHz恢复时钟下工作。
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