[实用新型]一种全数字高频雷达应答器有效
| 申请号： | 201420171892.7 | 申请日： | 2014-04-09 |
| 公开（公告）号： | CN203773044U | 公开（公告）日： | 2014-08-13 |
| 发明（设计）人： | 周浩;方繁;文必洋;田应伟;谭剑 | 申请（专利权）人： | 武汉大学 |
| 主分类号： | G01S7/03 | 分类号： | G01S7/03 |
| 代理公司： | 武汉科皓知识产权代理事务所(特殊普通合伙) 42222 | 代理人： | 张火春;王汛琳 |
| 地址： | 430072 湖*** | 国省代码： | 湖北;42 |
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| 摘要： | |||
| 搜索关键词： | 一种 数字 高频 雷达 应答器 | ||
1.一种全数字高频雷达应答器，其特征在于：包括接收模块（1）、频率检测模块（2）、存储延时模块（3）、发射模块（4）和收发开关（5），所述的收发开关（5）的输出端与接收模块（1）的输入端相连，接收模块（1）的输出端分别与频率检测模块（2）的输入端和存储延时模块（3）的输入端相连，频率检测模块（2）的输出端分别与存储延时模块（3）的控制端和收发开关（5）的控制端相连，存储延时模块（3）的输出端与发射模块（4）的输入端相连，发射模块（4）的输出端与收发开关（5）的输入端相连。
2.根据权利要求1所述的全数字高频雷达应答器，其特征在于：所述的接收模块（1）主要由帯通滤波电路（101）和ADC采样电路（102）组成，所述的帯通滤波电路（101）的输出端与ADC采样电路（102）的输入端相连。
3.根据权利要求1所述的全数字高频雷达应答器，其特征在于：所述的发射模块（4）主要由DAC模数转换电路（401）和功率放大电路（402）组成，所述的DAC模数转换电路（401）的输出端与功率放大电路（402）的输入端相连。
4.根据权利要求1所述的全数字高频雷达应答器，其特征在于：所述的收发开关（5）在所述的全数字高频雷达应答器系统中为实现一根天线收发共用提供控制平台。
5.根据权利要求1所述的全数字高频雷达应答器，其特征在于：所述的频率检测模块（2）为基于FPGA的1024点FFT滑窗频率检测的模块，其窗的大小为512点。
6.根据权利要求1所述的全数字高频雷达应答器，其特征在于：所述的存储延时模块（3）为基于FGPA的RAM存储延时的模块，其在同一个帧周期内的延时相等，当前帧周期内的延时时间与前一帧周期内的延时时间相差一个常量，从而在接收信号中加入多普勒信息。
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