[实用新型]一种基于PCI-E总线技术的加解密卡有效
| 申请号： | 201420773575.2 | 申请日： | 2014-12-09 |
| 公开（公告）号： | CN204390237U | 公开（公告）日： | 2015-06-10 |
| 发明（设计）人： | 王卓;田心;刘振;孙葆青;罗世新 | 申请（专利权）人： | 航天信息股份有限公司 |
| 主分类号： | G06F21/77 | 分类号： | G06F21/77;G06F21/62 |
| 代理公司： | 北京工信联合知识产权代理事务所(普通合伙) 11266 | 代理人： | 李勇 |
| 地址： | 100195 北京市*** | 国省代码： | 北京;11 |
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| 摘要： | |||
| 搜索关键词： | 一种 基于 pci 总线技术 解密 | ||
1.一种基于PCI-E总线技术的加解密卡，其特征在于：包括FPGA处理芯片和一片以上的并行专用加解密算法芯片PCI-E单元，其中：
所述FPGA处理芯片适用于配置加解密卡和控制数据处理；
所述加解密卡与主机的数据交换基于PCI-E总线技术。
2.根据权利要求1所述的基于PCI-E总线技术的加解密卡，其特征在于：还包括配置程序存储单元Flash芯片，适用于配置所述加解密卡的所述FPGA处理芯片和所述专用加解密算法芯片的通信方式和/或算法选择。
3.根据权利要求1所述的基于PCI-E总线技术的加解密卡，其特征在于：所述PCI-E单元包括PCI-E接口模块和PCI-E接口控制芯片，所述PCI-E接口模块适用于所述加解密卡和主机间的数据传输，所述PCI-E接口控制芯片适用于控制所述PCI-E接口模块的数据通信，为所述FPGA处理芯片提供主机的请求数据。
4.根据权利要求3所述的基于PCI-E总线技术的加解密卡，其特征在于：还包括随机数发生单元，所述随机数发生单元与所述FPGA处理芯片相连接，适用于产生真随机数。
5.根据权利要求4所述的基于PCI-E总线技术的加解密卡，其特征在于：还包括存储单元，其与所述FPGA处理芯片相连接，适用于存储所述加解密卡处理前后的缓存数据。
6.根据权利要求5所述的基于PCI-E总线技术的加解密卡，其特征在于：所述缓存数据包括原始请求数据、所述FPGA处理芯片处理的运行缓存数据和加解密完毕数据。
7.根据权利要求6所述的基于PCI-E总线技术的加解密卡，其特征在于：所述专用加解密算法芯片适用于对数据的加解密运算，与所述FPGA处理芯片相连接，接收所述FPGA处理芯片发送的请求数据并向所述FPGA处理芯片发送加解密完毕数据。
8.根据权利要求7所述的基于PCI-E总线技术的加解密卡，其特征在于：所述专用加解密算法芯片为4片并行的专用加解密算法芯片。
9.根据权利要求1至8任一所述的基于PCI-E总线技术的加解密卡，其特征在于：还包括电源管理模块，适用于对所述加解密卡的芯片提供并且管理控制电流输出和信号负载电流。
10.根据权利要求1所述的基于PCI-E总线技术的加解密卡，其特征在于：所述FPGA处理芯片内置防火墙，适用于杜绝驱动程序和外部程序的恶意访问。
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