[实用新型]一种短路保护电路及供电装置有效

专利信息
申请号: 201420820403.6 申请日: 2014-12-23
公开(公告)号: CN204290295U 公开(公告)日: 2015-04-22
发明(设计)人: 李树鹏 申请(专利权)人: 青岛歌尔声学科技有限公司
主分类号: H02H7/26 分类号: H02H7/26
代理公司: 青岛联智专利商标事务所有限公司 37101 代理人: 邵新华
地址: 266061 山东省青岛市崂山区秦*** 国省代码: 山东;37
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摘要:
搜索关键词: 一种 短路 保护 电路 供电 装置
【说明书】:

技术领域

本实用新型属于电路保护技术领域,具体地说,是涉及一种短路保护电路以及采用所述短路保护电路设计的供电装置。

背景技术

传统用的供电电缆往往没有短路保护机制,当电缆对地短路时,往往会导致电缆烧毁,影响正常的工业和生活用电,甚至会引发火灾等安全事故,导致供电电缆的安全性比较差。

发明内容

本实用新型提供了一种短路保护电路,提高了供电电缆的安全性。

为解决上述技术问题,本实用新型采用以下技术方案予以实现:

一种短路保护电路,包括供电端,在所述供电端至少设置有两条供电电缆:第一供电电缆和第二供电电缆,所述供电端分别通过所述第一供电电缆和第二供电电缆为负载端供电,第一供电电缆的电压小于第二供电电缆的电压,所述第一供电电缆通过第一晶体管的开关通路连接所述负载端,所述第二供电电缆通过第二晶体管的开关通路连接所述负载端;还包括一开关电路,所述开关电路分别与第一供电电缆和第二供电电缆连接,并根据两个供电电缆的压差输出通断信号,所述通断信号传输至所述第一晶体管的控制端和第二晶体管的控制端,控制第一晶体管和第二晶体管的通断。

进一步的,所述开关电路包括三个晶体管:第三晶体管、第四晶体管、第五晶体管;所述第三晶体管的控制端连接所述第四晶体管的开关通路的一端,所述第四晶体管的开关通路的另一端连接所述第一供电电缆,所述第四晶体管的控制端与所述第二供电电缆连接;所述第三晶体管的控制端连接所述第五晶体管的开关通路的一端,所述第五晶体管的开关通路的另一端连接所述第二供电电缆,所述第五晶体管的控制端与所述第一供电电缆连接;所述第三晶体管的开关通路的一端连接直流电源,所述第三晶体管的开关通路的另一端输出所述的通断信号至所述第一晶体管的控制端和第二晶体管的控制端。

又进一步的,所述第一晶体管、第二晶体管、第三晶体管均为PMOS管,第四晶体管、第五晶体管均为NMOS管;所述第二供电电缆通过第二分压电路连接所述第四晶体管的栅极,所述第四晶体管的源极连接所述第一供电电缆,所述第二供电电缆通过第一分压电路分别连接第四晶体管的漏极和第五晶体管的漏极,所述第五晶体管的栅极连接所述第一供电电缆,所述第五晶体管的源极连接所述第二供电电缆;所述第三晶体管的栅极连接所述第一分压电路的分压节点,所述第三晶体管的源极连接所述直流电源,所述第三晶体管的漏极输出所述的通断信号至所述第一晶体管的栅极和所述第二晶体管的栅极;所述第一晶体管的栅极和所述第二晶体管的栅极分别通过下拉电阻接地。

再进一步的,所述第一分压电路包括第一分压电阻和第二分压电阻,所述第一分压电阻的一端连接所述第二供电电缆,所述第一分压电阻的另一端连接所述第二分压电阻的一端,所述第二分压电阻的另一端分别连接所述第四晶体管的漏极、所述第五晶体管的漏极,所述第三晶体管的栅极连接第一分压电阻和第二分压电阻的中间节点。

优选的,在所述第一分压电阻的两端并联有电容。

进一步的,所述第二分压电路包括第三分压电阻和第四分压电阻,所述第三分压电阻的一端连接所述第二供电电缆,所述第三分压电阻的另一端连接所述第四分压电阻的一端,所述第四分压电阻的另一端接地,所述第四晶体管的栅极连接第三分压电阻和第四分压电阻的中间节点。

又进一步的,所述第三晶体管的栅极通过第六晶体管的开关通路接地,所述第六晶体管的控制端与所述第三晶体管的漏极连接。

再进一步的,所述第六晶体管为NMOS管,所述第六晶体管的漏极连接所述第三晶体管的栅极,所述第六晶体管的源极接地,所述第六晶体管的栅极连接所述第三晶体管的漏极。

更进一步的,所述直流电源的电压与所述第二供电电缆的电压相等。

基于上述短路保护电路的结构设计,本实用新型还提出了一种采用所述短路保护电路设计的供电装置,包括供电端,在所述供电端至少设置有两条供电电缆:第一供电电缆和第二供电电缆,所述供电端分别通过所述第一供电电缆和第二供电电缆为负载端供电,第一供电电缆的电压小于第二供电电缆的电压,所述第一供电电缆通过第一晶体管的开关通路连接所述负载端,所述第二供电电缆通过第二晶体管的开关通路连接所述负载端;还包括一开关电路,所述开关电路分别与第一供电电缆和第二供电电缆连接,并根据两个供电电缆的压差输出通断信号,所述通断信号传输至所述第一晶体管的控制端和第二晶体管的控制端,控制第一晶体管和第二晶体管的通断。

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