[发明专利]移位寄存器单元及其驱动方法、栅极驱动电路、显示装置有效
申请号: | 201510053547.2 | 申请日: | 2015-02-02 |
公开(公告)号: | CN104575430B | 公开(公告)日: | 2017-05-31 |
发明(设计)人: | 吴博;祁小敬;谭文 | 申请(专利权)人: | 京东方科技集团股份有限公司;成都京东方光电科技有限公司 |
主分类号: | G09G3/36 | 分类号: | G09G3/36;G11C19/28 |
代理公司: | 北京天昊联合知识产权代理有限公司11112 | 代理人: | 柴亮,张天舒 |
地址: | 100015 *** | 国省代码: | 北京;11 |
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摘要: | |||
搜索关键词: | 移位寄存器 单元 及其 驱动 方法 栅极 电路 显示装置 | ||
技术领域
本发明属于显示技术领域,具体涉及一种移位寄存器单元及其制备方法、栅极驱动电路、显示装置。
背景技术
TFT-LCD(Thin Film Transistor-Liquid Crystal Display,薄膜晶体管液晶显示装置)实现一帧画面显示的基本原理是通过栅极(gate)驱动从上到下依次对每一行像素输入一定宽度的方波进行选通,再通过源极(source)驱动每一行像素所需的信号依次从上往下输出。目前制造这样一种结构的显示器件通常是栅极驱动电路和源极驱动电路通过COF(Chip On Film,覆晶薄膜)或COG(Chip On Glass,芯片直接固定在玻璃上)工艺制作在玻璃面板上的,但是当分辨率较高时,栅极驱动电路和源极驱动电路的输出均较多,驱动电路的长度也将增大,这将不利于模组驱动电路的压焊(Bonding)工艺。
为了克服以上问题,现有显示器件的制造采用GOA(Gate Drive On array)电路的设计,相比现有的COF或COG工艺,其不仅节约了成本,而且可以做到面板两边对称的美观设计,同时也可省去栅极驱动电路的Bonding区域以及外围布线空间,从而实现了显示装置窄边框的设计,提高了显示装置的产能和良率。但是现有的GOA电路的设计也存在着一定的问题,如图1所示,现有的GOA电路中的每个移位寄存器的薄膜晶体管(TFT)(M1~M6,M8~M14)的个数较多,且每个移位寄存器只能用于驱动一行栅线,故占用空间较大,所以进一步减小GOA电路的占用空间,才可以实现真正意义上的窄边框设计。
发明内容
本发明所要解决的技术问题包括,针对现有的栅极驱动电路存在的上述问题,提供一种结构简单、易于控制的移位寄存器单元及其制备方法、栅极驱动电路、显示装置。
解决本发明技术问题所采用的技术方案是一种移位寄存器单元,其包括:预充复位模块、上拉模块、下拉模块、第一下拉控制模块,以及第二下拉控制模块;其中,
所述预充复位模块,连接正向扫描控制信号输入端、反向扫描信号输入端、第一信号输入端、第二信号输入端,以及上拉控制节点,用于根据正向扫描控制信号输入端、反向扫描信号输入端、第一信号输入端、第二信号输入端所输入的信号将上拉控制节点的电位进行充电或复位;
所述上拉模块,连接上拉控制节点、第一时钟信号输入端、信号输出端,用于根据上拉控制节点的电位和第一时钟信号输入端所输入的信号将信号输出端的电位上拉;
所述第一下拉控制模块,连接下拉控制节点、正向扫描控制信号输入端、反向扫描信号输入端、第一信号输入端,以及第二信号输入端,用于根据正向扫描控制信号输入端、反向扫描信号输入端、第一信号输入端、第二信号输入端所输入的信号将控制下拉控制节点的电位;
所述第二下拉控制模块,连接下拉控制节点、时钟控制信号输入端,用于根据时钟控制信号输入端所输入的信号控制下拉控制节点的电位;
所述下拉模块,连接下拉控制节点、上拉控制节点,以及信号输出端,用于根据下拉控制节点的电位将上拉控制节点的电位和信号输出端的电位下拉。
优选的是,所述预充复位模块包括:第一晶体管和第二晶体管;其中,
所述第一晶体管的第一极连接正向扫描控制信号输入端,第二极连接上拉控制节点,控制极连接第一信号输入端;
所述第二晶体管的第一极连接上拉控制节点,第二极连接反向扫描控制信号输入端,控制极连接第二信号输入端。
优选的是,所述上拉模块包括:第三晶体管和第一存储电容;其中,
所述第三晶体管的第一极连接第一时钟信号输入端,第二极连接信号输出端,控制极连接上拉控制节点;
所述第一存储电容的第一端连接上拉控制节点,第二端连接信号输出端。
优选的是,所述第一下拉控制模块包括:第四晶体管和第五晶体管;其中,
所述第四晶体管的第一极连接下拉控制节点,第二极连接反向扫描控制信号输入端,控制极连接第一信号输入端;
所述第五晶体管的第一极连接下拉控制节点,第二极连接正向扫描控制信号输入端,控制极连接第二信号输入端。
优选的是,所述时钟控制信号输入端为:第二时钟信号输入端,所述第二下拉控制模块包括:第六晶体管,
所述第六晶体管的第一端连接高电位端,第二端连接下拉控制节点,控制极连接第二时钟信号输入端。
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