[发明专利]一种在FPGA平台上进行数据报文采集的方法有效
申请号: | 201510099042.X | 申请日: | 2015-03-06 |
公开(公告)号: | CN104765703B | 公开(公告)日: | 2017-11-21 |
发明(设计)人: | 刘凯;童元满;李仁刚;刘金广 | 申请(专利权)人: | 浪潮电子信息产业股份有限公司 |
主分类号: | G06F13/38 | 分类号: | G06F13/38;G06F12/08;H04L12/879 |
代理公司: | 济南信达专利事务所有限公司37100 | 代理人: | 姜明 |
地址: | 250101 山东*** | 国省代码: | 山东;37 |
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摘要: | |||
搜索关键词: | 一种 fpga 平台 进行 数据 报文 采集 方法 | ||
1.一种在FPGA平台上进行数据报文采集的方法,其特征在于,其具体实现过程为:
首先构建一个异步FIFO用于报文采集输出,该异步FIFO的主体为一个报文存储RAM,且输入和输出地址由外部信号可控,该报文存储RAM还连接可输入并控制使能信号的使能控制模块、可输入地址的输入地址控制模块、可输出地址的输出地址控制模块,其中异步FIFO输出使能信号是根据输入输出地址的关系得到的;
设置所需采集抓取的报文类型,并进行报文传输;
当传输过程中出现所对应的报文时,RAM的输入使能信号有效,相关报文输入RAM中;
完成输入后,输入数据地址位加一,完成了输入报文的存储;
使能控制模块检测到输入地址有变化,并与输出地址进行比较,得出当前RAM中已经采集存有所需报文,使输出的使能信号有效。
2.根据权利要求1所述的一种在FPGA平台上进行数据报文采集的方法,其特征在于,在异步FIFO的报文输入端设置计数模块,当报文存入异步FIFO中时,同时连同计数模块数值作为时间戳一起存入到该异步FIFO中。
3.根据权利要求1所述的一种在FPGA平台上进行数据报文采集的方法,其特征在于,所述异步FIFO的输入端对输入的报文进行过滤,且当处理器传输过来的为所需求分析报文时存入FIFO中,其他传输来的分析报文不存储入异步FIFO中。
4.根据权利要求1、2或3所述的一种在FPGA平台上进行数据报文采集的方法,其特征在于,所述输入地址与输出地址的比较是指比较输入地址、输出地址是否相同,在比较过程中当输入地址和输出地址不在同一时钟域中,且在输出地址的时钟域里使用输入地址时,通过格雷码转换对输入地址进行转换使两者处于同一时钟域内后,再对两者进行比较。
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