[发明专利]一种故障冗余处理的方法及系统有效
申请号: | 201510100219.3 | 申请日: | 2015-03-06 |
公开(公告)号: | CN104808482B | 公开(公告)日: | 2017-03-08 |
发明(设计)人: | 赖重平;罗京;朱跃欧;陈启发;李振;张文跃;姜宏伟;朱琳;宋建红;邓皓;汪婷 | 申请(专利权)人: | 南车株洲电力机车有限公司 |
主分类号: | G05B9/03 | 分类号: | G05B9/03 |
代理公司: | 北京集佳知识产权代理有限公司11227 | 代理人: | 罗满 |
地址: | 412001 *** | 国省代码: | 湖南;43 |
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摘要: | |||
搜索关键词: | 一种 故障 冗余 处理 方法 系统 | ||
技术领域
本申请涉及运动车辆故障处理领域,特别涉及一种故障冗余处理的方法及系统。
背景技术
随着技术的发展,人们对运动车辆的加速度故障冗余处理的方法要求越来越高。
现有的传感器内有两个加速度计,分别称为加速度计a和加速度计b。正常工作时只用一个加速度计的值进行滤波运算。这样做存在两个问题:一是增加元器件疲劳损耗,二是如果刚好这个使用的加速度计坏了就会造成加速度输出值错误。
因此,如何合理利用两个加速度计,减少元器件疲劳损坏,延长使用寿命是本领域技术人员目前需要解决的技术问题。
发明内容
本申请所要解决的技术问题是提供一种故障冗余处理的方法及系统,解决了现有技术中单独使用一个加速度计时,增加元器件疲劳损耗,并且如果刚好这个使用的加速度计坏了就会造成加速度输出值错误的问题。
其具体方案如下:
一种故障冗余处理的方法,所述方法应用于故障冗余处理的系统,所述系统包括存储器、DSP、FPGA和传感器,所述传感器包括第一加速度计和第二加速度计;
该方法包括:
每给所述DSP上一次电,所述存储器交替存储两个预设值中的一个预设值;
所述DSP从所述存储器中读取所述存储的一个预设值,当所述的一个预设值为第一预设值时,所述DSP向I/O口输出高电压,当所述的一个预设值为第二预设值时,所述DSP向所述I/O口输出低电压;
所述FPGA读取所述I/O口输出的电压值,当所述电压值为高电压时,所述FPGA对所述第一加速度计的信号进行滤波运算,当所述电压值为低电压时,所述FPGA对所述第二加速度计的信号进行滤波运算;将滤波后的加速度值发送给所述DSP。
上述的方法,优选的,还包括:
显示所述滤波后的加速度值。
一种故障冗余处理的系统,该系统包括:
依次相连接的存储器、DSP、FPGA和传感器;
所述传感器包括第一加速度计和第二加速度计;
所述存储器用于每给所述DSP上一次电,交替存储两个预设值中的一个预设值;
所述DSP用于从所述存储器中读取所述存储的一个预设值,当所述的一个预设值为第一预设值时,所述DSP向I/O口输出高电压,当所述的一个预设值为第二预设值时,所述DSP向所述I/O口输出低电压;
所述FPGA用于读取所述I/O口输出的电压值,当所述电压值为高电压时,所述FPGA对所述第一加速度计的信号进行滤波运算,当所述电压值为低电压时,所述FPGA对所述第二加速度计的信号进行滤波运算;将滤波后的加速度值发送给所述DSP。
上述的系统,优选的,所述存储器为EEPROM存储器。
上述的系统,优选的,还包括:
显示器,所述显示器与所述DSP相连接,用于显示所述滤波后的加速度值。
本申请提供的故障冗余处理的方法中,所述方法应用于故障冗余处理的系统,所述系统包括存储器、DSP、FPGA和传感器,所述传感器包括第一加速度计和第二加速度计;预先设置两个预设值,每给所述DSP上一次电,所述存储器交替存储所述两个预设值中的一个预设值;所述DSP从所述存储器中读取所述存储的一个预设值,当所述的一个预设值为第一预设值时,所述DSP向I/O口输出高电压,当所述的一个预设值为第二预设值时,所述DSP向所述I/O口输出低电压;所述FPGA读取所述I/O口输出的电压值,当所述电压值为高电压时,所述FPGA对所述第一加速度计的信号进行滤波运算,当所述电压值为低电压时,所述FPGA对所述第二加速度计的信号进行滤波运算;将滤波后的加速度值发送给所述DSP。本申请中每次上电均自动切换加速度计,使两个加速度计交替使用,以减少元器件疲劳损坏,延长使用寿命,在某个加速度计出现故障时,只需要重新激活一下磁悬浮列车,也即重新上电,即可使悬浮系统继续工作,保证悬浮系统的可靠性。
附图说明
为了更清楚地说明本申请实施例中的技术方案,下面将对实施例描述中所需要使用的附图作简单地介绍,显而易见地,下面描述中的附图仅仅是本申请的一些实施例,对于本领域普通技术人员来讲,在不付出创造性劳动性的前提下,还可以根据这些附图获得其他的附图。
图1是本申请的一种故障冗余处理的方法实施例的流程图;
图2是本申请的一种故障冗余处理的系统实施例的结构示意图;
图3是本申请中加速度输出值无变化的示意图;
图4是本申请中加速度输出值波动的示意图。
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