[发明专利]一种灵活高效的BMC在线烧录CPLD程序的方法在审
申请号: | 201510182948.8 | 申请日: | 2015-04-17 |
公开(公告)号: | CN104793971A | 公开(公告)日: | 2015-07-22 |
发明(设计)人: | 孔祥涛 | 申请(专利权)人: | 浪潮电子信息产业股份有限公司 |
主分类号: | G06F9/445 | 分类号: | G06F9/445 |
代理公司: | 济南信达专利事务所有限公司 37100 | 代理人: | 张靖 |
地址: | 250101 山东*** | 国省代码: | 山东;37 |
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摘要: | |||
搜索关键词: | 一种 灵活 高效 bmc 在线 cpld 程序 方法 | ||
技术领域
本发明涉及服务器BMC技术领域领域,具体涉及一种灵活高效的BMC在线烧录CPLD程序的方法。
背景技术
在服务器系统中,尤其是在8路服务器、刀片服务器或融合架构服务器中,硬件设计较为复杂。CPLD使用数量往往在两颗以上。并且一款服务器产品即便在上市后仍然面临着在线升级烧录CPLD的需要。所以有效地集中统一烧录CPLD,可提高服务器易用性、可管理性的特点。
申请号201410051235.3一种采用数字芯片侦测和控制主板各组电源的方法,其实现过程为:将所有的电源芯片的I2C结构都连接在一起,然后接到BMC上,每个芯片都设置一个唯一地址,这样BMC通过I2C总线找到电源芯片并进行一系列的操作,BMC通过编程配置好相应的寄存器,对每个寄存器的设定相应的范围,BMC会实时排查每个寄存器的状态,当侦测到的值不在范围内时就发出报警信号;将BMC连接到网口上,用户使用个人电脑通过网络访问BMC。该一种采用数字芯片侦测和控制主板各组电源的方法和现有技术相比,实时监控电源状态。
申请号201410291073.0一种更新CPLD/FPGA固件的方法、装置及烧录器,基于服务器系统Shell下更新CPLD/FPGA固件的方法、装置及烧录器,该方法包括:将CPLD/FPGA芯片的JTAG总线的IO接口连接到服务器的控制元件的IO接口上,并将所述控制元件的IO接口配置为JTAG总线的信号;在服务器系统开机进入Shell下后,在Shell命令提示行下运行烧录命令;所述控制元件接收到所述烧录命令后获取待更新固件,通过与所述CPLD/FPGA芯片之间的JTAG总线完成所述CPLD/FPGA芯片上待更新固件的烧录。该发明扩展了CPLD/FPGA固有的更新方式,烧录时通过服务器本身即可完成CPLD/FPGA烧录,可以有效提高服务器系统的可维护性。
BMC(Baseboard Management Controller,基板管理控制器)是一个独立的子系统存在于服务器的硬件系统中,并独立于操作系统,可以实现对主板的健康状态进行监控,包括:故障诊断、热分布监控、风扇控制、VR监控、硬盘状态监控等等。
发明内容
本发明要解决的技术问题是:本发明将多个CPLD组成JTAG Chain,通过BMC可对其JTAG Chain中CPLD实现同时烧录或选择性烧录。
本发明所采用的技术方案为:
一种灵活高效的BMC在线烧录CPLD程序的方法,利用现有服务器监控管理芯片BMC JTAG 接口(master),与多个CPLD 组成的JTAG Chain相连接,统一对JTAG Chain中CPLD进行程序烧录。其中的CPLD可以是不同厂商的设备。
对于同一厂商的n个CPLD设备,若CPLD1~CPLDn都需要烧录或更新程序,在CPLD所对应厂商提供的烧录软件中,建立链式烧录结构,将n份烧录程序打包生成烧录文件。
对于同一厂商的n个CPLD设备,若部分CPLD都需要烧录或更新程序,部分无需更新,在CPLD所对应厂商提供的烧录软件中,建立链式烧录结构,需要烧录或更新程序的CPLD中打包烧录程序,无需更新的CPLD则导入对应的BSD file(边界扫描文件),然后打包生成烧录文件。BSD file是对在烧录过程中对于无需更新程序的CPLD起到Bypass(旁路)的作用。这样不影响CPLD原有的程序,同时保证了JTAG Chain的完整连通性。
对于不同厂商的CPLD设备,在一次操作中同时烧录同一厂商CPLD程序,另外厂商的CPLD设备则导入对应的BSD file(边界扫描文件) ,然后打包生成烧录文件。
本发明的有益效果为:本发明可极大地节省烧录时间和简化操作复杂性以及增加烧录的灵活性,并且在多CPLD的应用中,这种JTAG链状结构,简化了BMC(即JTAG Master)所出JTAG接口的数量,从而简化硬件线路。
本发明共有4个显著特点:
特点1:灵活,可单独烧录其中任一个CPLD;
特点2:高效,可同时烧录多个CPLD;
特点3:兼容性,在JTAG Chain中可连接不同厂商设备;
特点4:在多CPLD应用中,简少Master端JTAG接口数量,简化了硬件线路。
附图说明
图1 为本发明BMC与CPLD组成的JTAG Chain示意图。
具体实施方式
下面通过说明书附图,结合具体实施方式对本发明进一步说明:
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