[发明专利]一种基于FPGA对图像数据进行分割处理和显示的方法有效
申请号: | 201510253984.9 | 申请日: | 2015-05-19 |
公开(公告)号: | CN104902193B | 公开(公告)日: | 2018-06-22 |
发明(设计)人: | 叶红磊;蒋亮亮;王勇;王凯;高猛 | 申请(专利权)人: | 上海集成电路研发中心有限公司;成都微光集电科技有限公司 |
主分类号: | H04N5/262 | 分类号: | H04N5/262 |
代理公司: | 上海天辰知识产权代理事务所(特殊普通合伙) 31275 | 代理人: | 吴世华;林彦之 |
地址: | 201210 上*** | 国省代码: | 上海;31 |
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摘要: | |||
搜索关键词: | 分割处理 图像数据 图像 数据处理能力 图像处理系统 最大处理能力 尺寸图像 存储设备 方法适合 图像拼接 像素数据 信号平均 原始图像 大图像 实时性 帧图像 分割 操控 摄录 小行 存储 输出 外部 维护 | ||
1.一种基于FPGA对需由DSP进行ISP处理的图像数据进行分割处理和显示的方法,其步骤包括:
1)根据摄录的一帧图像数据和DSP最大数据处理能力决定FPGA分割后图像的大小;
2)编写FPGA的分割程序;
3)传输数据;
4)图像数据逐行连续地存储到FPGA内部的memory中;
5)按分割程序设定,进行图像分割,将存入的每行图像数据平均分割成数个小行图像数据,为每个小行添加行消隐数据;
6)按分割程序设定,若干的小行数据组成一小帧图像数据,FPGA为每个小帧添加场消隐数据;
7)小帧图像数据按照DSP接口时序,传送到DSP;
8)完成数据传输;
9)DSP将接收到的图像数据进行ISP处理;
10)处理后的图像数据通过网口传送到PC;
11)重复步骤3~步骤9,对该帧图像的所有后续行数据进行逐行分割、处理和传送;
12)PC接受到所有数据后,进行图像拼接,最终显示输出一幅完整的经过ISP处理的图像。
2.如权利要求1所述的一种基于FPGA对图像数据进行分割处理和显示的方法,其特征在于,步骤1中所述的分割是将帧图像等分成若干小帧图像的集合,每个小帧不超过DSP最大处理能力。
3.如权利要求1所述的一种基于FPGA对图像数据进行分割处理和显示的方法,其特征在于,步骤2中所述分割程序确定了分割后小帧图像的尺寸,即行、列数。
4.如权利要求1所述的一种基于FPGA对图像数据进行分割处理和显示的方法,其特征在于,步骤3中所述数据包括行有效信号和场有效信号。
5.如权利要求1所述的一种基于FPGA对图像数据进行分割处理和显示的方法,其特征在于,步骤4中所述FPGA内部的memory分为两个FIFO区域,FIFO0和FIFO1,以乒乓操作的方式轮流作为图像数据的暂存区域,其数据写入和读出的顺序均为先进先出的方式。
6.如权利要求5所述的一种基于FPGA对图像数据进行分割处理和显示的方法,其特征在于,所述乒乓操作是指:最初,FIFO0先开始存储数据,此时FIFO1空置;当FIFO0数据写满时,则由FIFO1继续存储,此时FIFO0进行读操作;随后,当FIFO1数据写满时,则再换成由FIFO0进行数据存储,而FIFO1进行读操作;以此往复。
7.如权利要求1所述的一种基于FPGA对图像数据进行分割处理和显示的方法,其特征在于,步骤5中所述的平均分割是指FPGA按分割程序设定将存入数据分割成数个相等长度的小行数据,行消隐数据被添加在每个小行数据结束之后。
8.如权利要求1所述的一种基于FPGA对图像数据进行分割处理和显示的方法,其特征在于,步骤6中,按分割程序设定确定小帧图像的列数,在小帧图像数据结束后添加场消隐数据。
9.如权利要求5或7所述的一种基于FPGA对图像数据进行分割处理和显示的方法,其特征在于,所述的行消隐数据和场消隐数据均满足DSP的VPIF接口时序要求。
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