[发明专利]一种基于FPGA的网络服务质量IP核有效

专利信息
申请号: 201510307848.3 申请日: 2015-06-08
公开(公告)号: CN104965942B 公开(公告)日: 2018-01-02
发明(设计)人: 滕达;毕研山;姜凯;于治楼 申请(专利权)人: 浪潮集团有限公司
主分类号: G06F17/50 分类号: G06F17/50
代理公司: 济南信达专利事务所有限公司37100 代理人: 姜明
地址: 250101 山东*** 国省代码: 山东;37
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摘要:
搜索关键词: 一种 基于 fpga 网络 服务质量 ip
【权利要求书】:

1.一种基于FPGA的网络服务质量IP核,通过Avalon标准接口嵌入到已有的FPGA系统中,包括Avalon接口模块,五元组解析模块,Hash压缩模块,Qos查找表模块,I2C接口模块,数据缓存模块,优先级选择模块,令牌桶充值模块,令牌桶模块和优先级调度模块,通过Avalon接口模块来接收网络数据包,将网络数据包传递至五元组解析模块,在五元组解析模块内将网络数据包的五元组解析出来,此时网络数据包送至数据缓存电路进行缓存,而解析出的五元组送至Hash压缩模块进行位宽压缩,压缩完毕后,将五元组送至Qos查找表进行优先级的查询,其中的qos信息由CPU通过I2C接口进行下发,查询完毕后,优先级信息与原始网络数据包一起送入到优先级选择电路,根据产生的优先级送入到相应的令牌桶中,其令牌由令牌桶充值模块下发,最终优先级调度模块根据优先级策略,有选择的选择令牌桶输出。

2.根据权利要求1所述的一种基于FPGA的网络服务质量IP核,其特征在于,所述的令牌桶共有16个。

3.根据权利要求1所述的一种基于FPGA的网络服务质量IP核,其特征在于,所述的令牌桶的令牌由令牌桶充值模块进行充值,若令牌不够,则拒绝接受该优先级的网络数据包。

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