[发明专利]基于VME总线的光刻机双工件台控制系统多板卡通信方法在审

专利信息
申请号: 201510353871.6 申请日: 2015-06-24
公开(公告)号: CN104950768A 公开(公告)日: 2015-09-30
发明(设计)人: 陈兴林;张常江;宋法质;崔莹;韩记晓;宋跃;刘洋;万勇利;何良辰;赵为志 申请(专利权)人: 哈尔滨工业大学
主分类号: G05B19/042 分类号: G05B19/042
代理公司: 哈尔滨龙科专利代理有限公司 23206 代理人: 高媛
地址: 150000 黑龙*** 国省代码: 黑龙江;23
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摘要:
搜索关键词: 基于 vme 总线 光刻 双工 控制系统 板卡 通信 方法
【说明书】:

技术领域

发明涉及基于VME总线的多板卡与工控机之间实时通信,以及多板卡之间通信的方法,属于高精度运动控制领域的多板卡之间控制和通信领域。

背景技术

光刻机双工件台扫描系统是对实时性要求极高的位置伺服控制系统,其要求在200us周期内完成扫描、曝光、光刻等所有的操作。VME总线由Versa总线的电气标准和欧式卡(Eurocard)的机械架构两部分构成,是一种异步传输总线。由于其众多的功能、强大的兼容性和动态可配置性被广泛运用于军事、航空、航天、医疗、运输和工业控制系统中。VME总线具有高性能、并行性、实时性及高可靠性等特点,一直是实时嵌入式系统的首选,广泛用于工控机与各板卡的通信。现有多块不同类型板卡与工控机之间通信时存在的相互干扰,实时同步性能差的问题,以及多块板卡之间数据无法交互的问题。

发明内容

本发明目的是为了解决现有多块不同类型板卡与工控机之间通信时存在的相互干扰,实时同步性能差的问题,以及多块板卡之间数据无法交互的问题,提供了一种基于VME总线的光刻机双工件台控制系统多板卡通信方法。

本发明所述基于VME总线的光刻机双工件台控制系统多板卡通信方法,该方法涉及的多板卡通信装置包括上位机、主控CPU板、VME总线和n个从设备板卡;n为大于或等于1的自然数;

上位机:与主控CPU板相连接,用于对从设备板卡进行参数设置、指令发送和数据监控;

主控CPU板:负责任务调度,控制整个通信的运行,一方面通过TCP/IP网络通信协议和上位机进行数据交互,另一方面通过VME总线和n个从设备板卡进行通信;

VME总线:作为n个从设备板卡和主控CPU板两两板卡之间通信的中介,VME总线由VME工控机箱提供,主控CPU板与n个从设备板卡都是插在VME工控机箱上,并通过VME总线建立连接;

从设备板卡:采用DSP+FPGA的控制结构,从设备板卡包括VME P1/P2模块、电平转换CPLD模块、FPGA模块和DSP模块;

VME P1/P2模块为从设备板卡上的物理层外部VME硬件插口,从设备板卡通过VMEP1/P2模块与VME总线建立连接;

电平转换CPLD模块完成FPGA模块到VME P1/P2模块的电平转换;

DSP模块通过自带的外部存储扩展接口EMIF与FPGA模块进行通信,FPGA模块提供一个双口RAM的数据缓存区,DSP模块与FPGA模块之间的通信数据放到双口RAM中缓存,主控CPU板与FPGA模块进行交互的数据也是放到双口RAM中缓存;

通信时,主控CPU板首先解析来自上位机的指令,如果是向某一从设备板卡发送数据,则主控CPU板执行VME写操作,将数据通过VME总线写到待写入的从设备板卡中FPGA模块提供的双口RAM中,然后DSP模块再通过EMIF将数据从双口RAM中取出;如果是想读取某一从设备板卡中的数据,则该从设备板卡的DSP模块通过EMIF将数据放到FPGA模块提供的双口RAM中缓存,然后主控CPU板再执行VME读操作将数据从待读取的从设备板卡的双口RAM中取出并发送到上位机显示,由此实现上位机与n个从设备板卡间以及n个从设备板卡之间的通信。

本发明的优点:本发明应用VME总线模块,在主控CPU板中设计VME总线的主设备模块,其他板卡中设计VME总线的从设备模块,主设备可通过驱动地址线来选择不同的从设备进行数据交互,然后将工控机通过网口与主控制卡连接,从而实现工控机实时的对各个板卡进行指令传送和数据监控。不同板卡之间的通信则是以主控制卡作为桥梁进行,主控CPU板首先驱动地址线选中需要发送数据的板卡,并将数据读取出来,然后再将此数据发送到另一块需要接收此数据的板卡中。多块不同类型板卡与工控机之间通信时相互不干扰,实时同步性能好,多块板卡之间数据可以进行交互。

附图说明

图1是本发明所述基于VME总线的光刻机双工件台控制系统多板卡通信方法涉及装置的结构示意图;n=1;

图2是本发明所述基于VME总线的光刻机双工件台控制系统多板卡通信方法涉及装置的结构示意图;n>1;

图3是给出从设备板卡的具体实施例;

图4是主控CPU的具体结构示意图;

图5是FPGA模块内部VME总线逻辑控制时序图;

图6是从设备板卡内部通信原理图。

具体实施方式

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