[发明专利]用于锁相环的相位跟踪器有效

专利信息
申请号: 201510505612.0 申请日: 2015-08-17
公开(公告)号: CN105450218B 公开(公告)日: 2019-06-11
发明(设计)人: 克利斯汀·维克帕勒克;托马斯·迈耶;安德烈亚斯·迈耶;索斯藤·特拉赫特 申请(专利权)人: 英特尔IP公司
主分类号: H03L7/08 分类号: H03L7/08
代理公司: 北京东方亿思知识产权代理有限责任公司 11258 代理人: 李晓冬
地址: 美国加利*** 国省代码: 美国;US
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摘要:
搜索关键词: 用于 锁相环 相位 跟踪
【权利要求书】:

1.一种锁相环,包括:

锁相环电路,所述锁相环电路被配置为基于参考频率和当前信道字输出输出信号;以及

相位跟踪电路,所述相位跟踪电路被配置为基于所述锁相环电路的先前信道字和所述当前信道字来确定所述输出信号的相位漂移,

其中,所述相位跟踪电路包括累加器电路,所述累加器电路累加输入序列与所述先前信道字之差;并且

其中,所述输入序列包括所述当前信道字和调制数据。

2.如权利要求1所述的锁相环,其中,所述累加的差表示所述相位漂移。

3.如权利要求1所述的锁相环,其中,所述相位跟踪电路包括:

第一计算电路,所述第一计算电路被配置为基于所述当前信道字和调制数据来计算频率控制字;

第二计算电路,所述第二计算电路被配置为确定所述频率控制字与所述先前信道字之差,其中,该差表示所述输出信号中的所述相位漂移的斜率;以及

累加器电路,所述累加器被配置为累加与所述输出信号的输出频率的中断相关联的时间段内的表示所述斜率的差,其中,所述时间段内所累加的差表示由于所述中断导致的所述输出信号的所述相位漂移。

4.如权利要求1-3中的任一项所述的锁相环,其中,所述锁相环电路包括:

前馈路径,所述前馈路径被配置为接收参考信号和反馈信号,并且基于所述参考信号和所述反馈信号来输出所述输出信号;以及

反馈路径,所述反馈路径包括分频器电路,所述分频器电路接收所述输出信号、并且基于分频器控制信号来输出所述反馈信号,其中所述分频器控制信号是调制数据的函数。

5.一种锁相环,包括:

前馈路径,所述前馈路径接收具有参考频率的参考信号、并且输出具有输出频率的输出信号,所述输出信号是所述参考信号和反馈信号的函数;

反馈路径,所述反馈路径具有与其相关联的分频器电路,并且所述反馈路径被配置为接收所述输出信号、并且基于所述分频器电路的分频值来生成具有减小的频率的所述反馈信号,其中,所述反馈信号被提供给所述前馈路径;

调制器电路,所述调制器电路被配置为接收调制数据、并且将分频器控制信号提供给所述分频器电路以控制所述分频器电路的分频值;以及

相位跟踪电路,所述相位跟踪电路被配置为确定由于所述锁相环的锁定状态中的中断导致的、从所述输出信号的初始相位值的相位漂移的量。

6.如权利要求5所述的锁相环,其中,所述相位跟踪电路被配置为使用调制输入序列和先前信道字来确定由于中断导致的、从所述输出信号的所述初始相位值的所述相位漂移的量。

7.如权利要求6所述的锁相环,其中,所述调制输入序列包括调制数据、以及确定所述锁相环的新信道频率的新信道字。

8.如权利要求6所述的锁相环,其中,所述相位跟踪电路包括:

第一计算电路,所述第一计算电路被配置为将调制数据与新信道控制字相组合以形成用于由所述调制器电路使用的频率控制字;以及

第二计算电路,所述第二计算电路被配置为确定所述频率控制字与所述先前信道字之差,其中,所述差反映相位漂移的改变的率。

9.如权利要求8所述的锁相环,其中,所述相位跟踪电路还包括:累加器电路,所述累加器电路被配置为累加时间的周期内的从所述第二计算电路输出的所述差,其中,来自所述第二计算电路的所述差的累加的输出表示从所述初始相位值的相位漂移的量。

10.如权利要求9所述的锁相环,其中,所述累加器电路还包括截断电路,所述截断电路被配置为在累加的相位漂移量大于360度时执行折叠功能。

11.如权利要求10所述的锁相环,其中,所述截断电路被配置为通过丢弃来自所述第二计算电路的所述差的所述累加的输出的整数部分执行所述折叠功能。

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