[发明专利]一种3D显示装置及其驱动方法在审
申请号: | 201510556849.1 | 申请日: | 2015-09-02 |
公开(公告)号: | CN105093550A | 公开(公告)日: | 2015-11-25 |
发明(设计)人: | 郭仁炜;董学 | 申请(专利权)人: | 京东方科技集团股份有限公司;北京京东方光电科技有限公司 |
主分类号: | G02B27/22 | 分类号: | G02B27/22 |
代理公司: | 北京同达信恒知识产权代理有限公司 11291 | 代理人: | 黄志华 |
地址: | 100015 *** | 国省代码: | 北京;11 |
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摘要: | |||
搜索关键词: | 一种 显示装置 及其 驱动 方法 | ||
技术领域
本发明涉及到显示装置的技术领域,尤其涉及到一种3D显示装置及其驱动方法。
背景技术
裸眼3D也是一种3D形式,它通过光栅,区分进入人左右眼的信息,使人感觉有3D的效果,在大尺寸电视上应用较多。但是裸眼3D由于具有挡光光栅设计,在观测过程中,PPI降低很多,有时会降低1半的PPI,从而使观看3D效果降低。
虚拟显示技术在目前显示领域中应用十分广泛,通过像素公用,能够使视觉分辨率高于panel物理分辨率。目前韩国三星是使用虚拟技术最多的面板商,在由于OLED在做亚像素时,有机物resinpattern形成工艺难度较大,所以在制作更高的PPI显示屏上遇见瓶颈。通过虚拟技术能够很好的解决这个问题。提高人眼感受到的屏幕分辨率。这种虚拟算法技术命名为pentile技术,由三星进行垄断,在三星S3,S4等高端产品上均得到应用。S4pattern的排列图形是菱形状排列,目前最新技术来看,这种排列突破了传统一行或一列RGB排列的模式,这种显示方法只能使用像素公用的虚拟技术进行显示,并且最为难得的是这种排列进行显示的显示效果很好,值得我们借鉴。
如和将裸眼3D技术和虚拟显示技术相结合,制作出高清3D是一个挑战,将3D显示和虚拟算法相结合在目前的相关文献和专利中介绍较少。
发明内容
本发明提供了一种3D显示装置及其驱动方法,用以提高3D显示装置的3D显示效果。
本发明提供了一种3D显示装置,该3D显示装置包括像素阵列以及光栅,
所述像素阵列包括:多列亚像素组,每列亚像素组包括M*N个亚像素,其中M为亚像素颜色种类,N为大于3的正整数;其中,每个亚像素为矩形形状,奇数列亚像素组和偶数列亚像素组错位设置;
所述光栅为棋盘格形状,包含多个阵列排列的遮挡矩形,每个遮挡矩形用于遮挡列方向的至少一个亚像素;其中,相邻列中的遮挡矩形在列方向错位设置。
在上述技术方案中,通过采用错位设置的像素阵列,同时配合光栅形成遮挡像素阵列,同时,通过算法设计,灵活的控制亚像素的开启点位置,及采样区对应3D视图信号的关系,利用这种虚拟显示和3D相结合的方法能够将插入视图的视觉分辨率提高。从而提高3D虚拟显示分辨率,增加3D显示效果。
优选的,所述奇数列亚像素组和偶数列亚像素组错位设置宽度为亚像素在列方向宽度的一半;
所述相邻列中的遮挡矩形在列方向错位设置的宽度为亚像素在列方向宽度的一半。具体的错位关系。
优选的,所述遮挡矩形在列方向的宽度与亚像素单元在列方向宽的5/2倍,在行方向的宽度为单个亚像素的宽度。
优选的,所述M的个数为3,所述亚像素颜色的为红色、绿色及蓝色。
优选的,所述像素阵列为三角形阵列。
优选的,所述每列亚像素组中,M个亚像素为一个视图单元,且相邻的视图单元对应3D显示中的不同视图。
本发明还提供了一种3D显示装置的驱动方法,所述3D显示装置为上述任一项所述的3D显示装置;该方法包括:
分别将待显示的3D视图的第一视图和第二视图划分为多个视图单元,并确定每一个视图单元中各个颜色的颜色分量;
针对每一个视图的每一个亚像素,按照该亚像素对应的矩形采样区所覆盖的、属于该视图的各个视图单元中该亚像素的颜色的颜色分量确定该亚像素的发光亮度;
在上述技术方案中,通过采用错位设置的像素阵列,同时配合光栅形成遮挡像素阵列,同时,通过算法设计,灵活的控制亚像素的开启点位置,及采样区对应3D视图信号的关系,利用这种虚拟显示和3D相结合的方法能够将插入视图的视觉分辨率提高。从而提高3D虚拟显示分辨率,增加3D显示效果。
优选的,所述对位于遮挡矩形交错区域的亚像素进行显示时,以相邻列的亚像素组中位于所述遮挡矩形交错区域外且与该亚像素距离最近的一个用于显示同一视图且颜色一致的亚像素替代进行显示。
优选的,所述采样区为矩形采样区,且该采样区域以对应的亚像素的中心线为中心线,该采样区域在行方向的宽度为亚像素在行方向宽度的2倍,在列方向上的宽度为亚像素在列方向宽度的3倍;
针对偶数列的亚像素,每个亚像素对应的采样区在列方向覆盖位于该采样区对应的亚像素下方的亚像素的一部分;
针对奇数列的亚像素,每个亚像素对应的采样区与偶数列的亚像素对应的采样区相接,且奇数列的亚像素对应的采样区与偶数列的亚像素对应的采样区位置相错。
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