[发明专利]具有上拉升压器和下拉升压器的差分驱动器有效
申请号: | 201510607609.X | 申请日: | 2015-09-22 |
公开(公告)号: | CN105446923B | 公开(公告)日: | 2020-03-27 |
发明(设计)人: | W·张;H·黄;Y·范;R·斯珀利奇 | 申请(专利权)人: | 德克萨斯仪器股份有限公司 |
主分类号: | G06F13/40 | 分类号: | G06F13/40 |
代理公司: | 北京纪凯知识产权代理有限公司 11245 | 代理人: | 赵蓉民;赵志刚 |
地址: | 美国德*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 具有 升压 下拉 驱动器 | ||
本发明涉及具有上拉升压器和下拉升压器的差分驱动器。一种驱动器(100)包括第一电阻器和第二电阻器(RTN、RTP),该第一电阻器和第二电阻器被耦合至电源电压(VCC)并且在正输出节点和负输出节点(OUT_P和OUT_N)处被耦合至多对主晶体管(MAIN_1、MAIN_2、MAIN_3和MAIN_4)。第一对主晶体管和第二对主晶体管(MAIN_1、MAIN_2、MAIN_3和MAIN_4)将在正输出节点和负输出节点(OUT_P与OUT_N)上提供加重和去加重。驱动器(100)还包括延迟反相器(110)、上拉升压器(150)和下拉升压器(180)。延迟反相器(110)对一对差分输入信号(INP_PREDRV和INN_PREDRV)中的每个差分输入信号都进行延迟和反相,以提供延迟和反相的差分信号(INN_DE和INP_DE)。上拉升压器(150)提供旁路电流路径,该旁路电流路径对第一电阻器和第二电阻器(RTN、RTP)进行旁路但是包括第一对主晶体管和第二对主晶体管(MAIN_1、MAIN_2、MAIN_3和MAIN_4)中的至少一些。下拉升压器(180)提供从电源电压(VCC)穿过第一电阻器或第二电阻器(RTN、RTP)到地的附加电流路径。
相关申请的交叉引用
本申请要求2014年9月23日提交的、题目为“低压差分驱动器的输出摆幅增压电路(An Output Swing Boosting Circuit Of Low Voltage Differential Drivers)”的美国临时专利申请号62/054,196的优先权,在此通过引用将全文结合至本文。
背景技术
驱动器电路被用于发送电信号。对于高频传输,驱动器可以包括预加重和去加重用于对高频通道损失进行补偿。预加重/去加重(emphasis)意味着传输位的输出信号幅值被扩大到大于非传输信号位的输出信号幅值。也就是说,在输入信号转变期间电压幅值的绝对值高于在输入信号转变之间的稳态区域中的电压幅值的绝对值。电压模式驱动器与电流模式驱动器一样都是可用的。两种类型的驱动器都具有其优点和缺点,并且每种驱动器都最佳用于某些应用。
发明内容
在一个实施例中,驱动器包括被耦合至电源电压并且在正输出节点与负输出节点处被耦合至多对主晶体管的第一电阻器和第二电阻器。该第一对主晶体管和第二对主晶体管在该正输出节点与负输出节点上提供加重和去加重。该驱动器还包括延迟反相器、上拉升压器和下拉升压器。该延迟反相器延迟和反相一对差分输入信号中的每个差分输入信号,从而提供经延迟和反相的差分信号。该上拉升压器提供旁路电流路径,该旁路电流路径对该第一电阻器和第二电阻器进行旁路但是包括该第一对主晶体管和第二对主晶体管中的至少一些。该下拉升压器提供从该电源电压穿过该第一电阻器或第二电阻器到地的附加电流路径。
在另一个实施例中,差分驱动器包括第一电阻器,该第一电阻器被耦合至电源电压并且在正输出节点处被耦合至第一对主晶体管。第二电阻器将被耦合至电源电压并且在负输出节点处被耦合至第二对主晶体管。该第一对主晶体管和第二对主晶体管被配置为在该正输出节点与负输出节点上提供加重和去加重。上拉升压器被耦合至该第一电阻器和该第二电阻器,并且被配置为仅在差分输入信号的转变期间提供旁路电流路径,该旁路电流路径对该第一电阻器和该第二电阻器进行旁路但是包括该第一对主晶体管和该第二对主晶体管中的至少一些。
在又一个实施例中,差分驱动器包括第一电阻器,该第一电阻器有待被耦合至电源电压并且在正输出节点处被耦合至第一对主晶体管。第二电阻器将被耦合至电源电压并且在负输出节点处被耦合至第二对主晶体管。该第一对主晶体管和第二对主晶体管被配置为在该正输出节点与负输出节点上提供加重和去加重。延迟反相器被配置为延迟和反相一对差分输入信号中的每个差分输入信号,从而提供经延迟和反相的差分信号。下拉升压器被耦合至该正输出节点和该负输出节点,并且被配置为仅在差分输入信号的转变期间提供从该电源电压穿过该第一电阻器或第二电阻器到地的附加电流路径,该附加电流路径是除了从该电源电压穿过该第一电阻器或第二电阻器和该第一对主晶体管与该第二对主晶体管的至少一些的电流路径之外的电流路径。
附图说明
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