[发明专利]一种GOA电路及其驱动方法、液晶显示器有效

专利信息
申请号: 201510611786.5 申请日: 2015-09-23
公开(公告)号: CN105118464B 公开(公告)日: 2018-01-26
发明(设计)人: 肖军城;戴荣磊;曹尚操;颜尧 申请(专利权)人: 深圳市华星光电技术有限公司;武汉华星光电技术有限公司
主分类号: G09G3/36 分类号: G09G3/36
代理公司: 深圳市威世博知识产权代理事务所(普通合伙)44280 代理人: 何青瓦
地址: 518006 广东*** 国省代码: 广东;44
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摘要:
搜索关键词: 一种 goa 电路 及其 驱动 方法 液晶显示器
【说明书】:

技术领域

发明涉及显示技术领域,特别是涉及一种GOA电路及其驱动方法、液晶显示器。

背景技术

阵列基板行驱动(GOA,Gate Driver On Array或Gate On Array)电路,是利用现有薄膜晶体管显示装置(TFT-LCD)阵列(Array)制程将栅线(Gate)行扫描驱动信号电路制作在阵列基板上,以实现对栅线逐行扫描的驱动方式的一项技术。其与传统的柔性电路板(COF)和玻璃电路板(COG)工艺相比,不仅节省了制作成本,而且还可以省去栅极方向邦定(Bonding)的工艺,对提升产能极为有利,并提高了显示装置的集成度。

在实际使用时,由于显示装置通常需要搭配触摸屏(Touch Panel)功能进行使用,因此GOA电路需要实现信号中停以配合触摸屏的功能,如配合触摸屏的扫描。通常情况下,GOA电路在实现信号中停后,需将显示装置进行黑屏唤醒,此时GOA电路需要在一段时间内将所有的栅线均设置为导通状态,通过向数据线施加黑电压以清空像素电容中残留的电平,以使得显示装置的显示效果良好,此段时间称为栅线全开(AllGate On)阶段。但是现有技术中的GOA电路在实现All Gate On时会存在功能失效风险,进而不能稳定的实现All Gate On功能。

发明内容

本发明主要解决的技术问题是提供一种GOA电路及其驱动方法、液晶显示器,能够在显示器黑屏唤醒时打开各个像素的gate端,向各级像素入低电平信号,防止显示器在黑屏唤醒时漏电的情况,同时提高电路的稳定性。

为解决上述技术问题,本发明采用的一个技术方案是:提供一种GOA电路,用于液晶显示器,该GOA电路包括多个级联的GOA子电路,设定N为正整数,其中,第N级GOA子电路包括第N级级传电路、第N级Q点控制电路、第N级P点控制电路、第N级输出电路以及第一开关电路;其中,第N级级传电路连接第N级Q点控制电路,第N级Q点控制电路通过Q点连接第N级输出电路,第N级级传电路连接第N级P点控制电路,第N级P点控制电路通过P点连接第N级输出电路,第N级输出电路连接第N级扫描线G(N);第一开关电路连接第N级扫描线G(N),用于在液晶显示器显示前向第N级扫描线G(N)通入一开启信号,以使第N级扫描线G(N)连接的像素中的薄膜晶体管导通。

其中,第一开关电路包括第一薄膜晶体管T1,其源极连接第N级扫描线G(N),在液晶显示器显示前,第一薄膜晶体管T1的栅极接入一高电平的第一开启信号Gas1,以使第一薄膜晶体管T1的源极和漏极导通,并向第N级扫描线G(N)通入高电平信号,以使第N级扫描线G(N)连接的像素中的薄膜晶体管导通。

其中,GOA子电路还包括第二开关电路;第二开关电路包括第二薄膜晶体管T2,其漏极连接第N级扫描线G(N),在向第N级扫描线G(N)通入高电平信号后,向第二薄膜晶体管T2的栅极接入一高电平的第二开启信号Gas2,以使第二薄膜晶体管T2的源极和漏极导通,并向第N级扫描线G(N)通入低电平信号,以使第N级扫描线G(N)连接的像素中的薄膜晶体管关闭。

其中,第N级级传电路包括第三薄膜晶体管T3、第四薄膜晶体管T4、第五薄膜晶体管T5以及第六薄膜晶体管T6;第三薄膜晶体管T3和第四薄膜晶体管T4的栅极接入正向扫描控制信号U2D,用于在正向扫描期间通过第三薄膜晶体管T3接入第N-2级扫描信号G(N-2),并通过第四薄膜晶体管T4接入第N+1级时钟信号CK(N+1);第五薄膜晶体管T5和第六薄膜晶体管T6的栅极接入反向扫描控制信号D2U,用于在反向扫描期间通过第五薄膜晶体管T5接入第N+2级扫描信号G(N+2),并通过第六薄膜晶体管T6接入第N-1级时钟信号CK(N-1)。

其中,第N级Q点控制电路包括:第七薄膜晶体管T7,其栅极接入第N-2级时钟信号CK(N-2),其漏极在正向扫描期间接入第N-2级扫描信号G(N-2)或在反向扫描期间接入第N+2级扫描信号G(N+2),其源极连接Q点;第八薄膜晶体管T8,其栅极接入第N-2级扫描信号G(N-2),其漏极连接P点,其源极接入一低电平信号;第九薄膜晶体管T9,其栅极连接第八薄膜晶体管T8的漏极,其漏极连接第七薄膜晶体管T7的源极,其源极连接一低电平信号。

其中,第N级P点控制电路包括:第十薄膜晶体管T10,其栅极在正向扫描期间接入第N+1级时钟信号CK(N+1)或在反向扫描期间接入第N-1级时钟信号CK(N-1),其漏极接入一高电平信号,其源极连接P点;第十一薄膜晶体管T11,其栅极连接Q点,其漏极连接P点,其源极接入一低电平信号。

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