[发明专利]一种非正常失电状态记忆电路有效
| 申请号： | 201510992446.1 | 申请日： | 2015-12-25 |
| 公开（公告）号： | CN105653987B | 公开（公告）日： | 2019-08-20 |
| 发明（设计）人： | 朱凌 | 申请（专利权）人： | 延锋伟世通电子科技（上海）有限公司 |
| 主分类号： | G06F21/78 | 分类号： | G06F21/78 |
| 代理公司： | 上海世贸专利代理有限责任公司 31128 | 代理人： | 严新德 |
| 地址： | 200233 上海市徐汇*** | 国省代码： | 上海;31 |
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| 摘要： | |||
| 搜索关键词： | 一种 正常 状态 记忆 电路 | ||
1.一种非正常失电状态记忆电路，包括D触发器、施密特触发器和电压检测芯片，所述的D触发器包括一个PRE脚、一个CLR脚和一个CLK脚，所述的施密特触发器包括一个触发端、一个第一输出端和一个第二输出端，所述的电压检测芯片包括两个电压检测端和一个复位脚，其特征在于：所述的电压检测芯片的复位脚与所述的施密特触发器的触发端连接，施密特触发器的第一输出端与所述的D触发器的CLR脚连接，D触发器的PRE脚与施密特触发器的第二输出端连接，D触发器的CLK脚与一个微处理器的时钟信号输出端连接，利用电压检测芯片的两个电压检测端检测电压信号，在电压信号正常时，电压检测芯片的复位脚置于高电位，利用施密特触发器的第一输出端驱动并将高电位信号输入到D触发器的CLR脚，同时，利用施密特触发器的第二输出端将D触发器的PRE脚拉高，将D触发器置于可写状态，利用微处理器的时钟信号输出端和一个状态输出端向D触发器写入当前状态的标志位，在电压检测芯片的两个电压检测端检测到失电时，电压检测芯片的复位脚经施密特触发器将D触发器的CLR脚置低，同时施密特触发器将D触发器的PRE脚置低，将D触发器置于锁死状态，利用D触发器的一个输出端输出失电前被写入的状态。
2.根据权利要求1所述的非正常失电状态记忆电路，其特征在于: D触发器与一个应急电源连接。
3.根据权利要求2所述的非正常失电状态记忆电路，其特征在于: 施密特触发器和电压检测芯片均与所述的应急电源连接。
4.根据权利要求1所述的非正常失电状态记忆电路，其特征在于: D触发器的CLK脚与微处理器的时钟信号输出端之间连接有一个第一三极管驱动电路。
5.根据权利要求1所述的非正常失电状态记忆电路，其特征在于: 微处理器的状态输出端与D触发器的D脚连接有一个第二三极管驱动电路。
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