[实用新型]一种阵列基板、显示面板和显示装置有效
申请号: | 201520012864.5 | 申请日: | 2015-01-08 |
公开(公告)号: | CN204314581U | 公开(公告)日: | 2015-05-06 |
发明(设计)人: | 李盼;李文波;乔勇;程鸿飞;先建波 | 申请(专利权)人: | 京东方科技集团股份有限公司 |
主分类号: | G02F1/1362 | 分类号: | G02F1/1362;G02F1/1343;H01L23/50;H01L23/60 |
代理公司: | 北京同达信恒知识产权代理有限公司 11291 | 代理人: | 黄志华 |
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摘要: | |||
搜索关键词: | 一种 阵列 显示 面板 显示装置 | ||
技术领域
本实用新型涉及液晶显示技术领域,尤其涉及一种阵列基板、显示面板和显示装置。
背景技术
薄膜晶体管液晶显示器(Thin Film Transistor Liquid Crystal Display,TFT-LCD)具有厚度薄、功耗低、无辐射等特点,近年来得到了迅速地发展,在当前的平板显示器市场中占据了主导地位。目前,TFT-LCD在各种大中小尺寸的产品上得到了广泛的应用,几乎涵盖了当今信息社会的主要电子产品,在较大尺寸的产品上的应用如液晶电视和高清晰度数字电视。
现有技术中,为了实现多畴显示,需要把亚像素单元的像素电极设计成梳齿结构或者于少边缘为梳齿结构。但是,具有该梳齿结构的像素电极会对相邻的亚像素电极、栅线和数据线产生尖端放电,从而对相邻的亚像素单元形成较大的干扰,影响显示面板的显示效果。
实用新型内容
本实用新型的目的是提供一种阵列基板、显示面板和显示装置,以解决现有技术中,亚像素单元所包括的梳状电极的尖端放电对周围的数据线、栅线及相邻的所述亚像素单元造成干扰的问题。
本实用新型的目的是通过以下技术方案实现的:
本实用新型实施例提供一种阵列基板,包括衬底基板,所述衬底基板上形成有亚像素单元阵列,所述亚像素单元包括至少在边缘处为梳齿结构的像素电极,所述像素电极的至少一个边缘处设置有屏蔽电极,所述屏蔽电极与所述像素电极的梳齿结构的尖端电连接。本实施例中,在所述像素电极的至少一个边缘处设置所述屏蔽电极,从而消除所述像素电极的尖端放电对周围的所述数据线、所述栅线及相邻的所述亚像素单元造成的干扰。
优选的,每两行所述亚像素单元为一个亚像素单元组,每一个所述亚像素单元组的两行所述亚像素单元之间设置有两条栅线;
所述亚像素单元组的上一行所述亚像素单元的所述像素电极至少于上边缘处设置所述屏蔽电极,所述亚像素单元组的下一行所述亚像素单元的所述像素电极至少于下边缘处设置所述屏蔽电极。本实施例中,对于双栅驱动的亚像素单元阵列,由于相邻所述亚像素单元组之间所述像素电极距离较近,因此至少在所述亚像素单元组的上下两边设置所述屏蔽电极,从而使相邻所述亚像素单元组之间的干扰被屏蔽。
优选的,所述像素电极包括沿列方向由上至下排布的梳状的第一像素电极和第二像素电极,属于同一行的所述亚像素单元的所述第一像素电极和所述第二像素电极之间设置有一条栅线。
优选的,所述第一像素电极的上边缘处设置所述屏蔽电极,所述第二像素电极的下边缘处设置所述屏蔽电极。本实施例中,列方向上相邻两行所述亚像素单元之间的干扰被屏蔽。
优选的,所述第一像素电极的上边缘处及至少一个侧边缘处设置所述屏蔽电极,所述第二像素电极的下边缘处及至少一个侧边缘处设置所述屏蔽电极。本实施例中,列方向和行方向上相邻两行所述亚像素单元之间的干扰被屏蔽。
优选的,所述第一像素电极和所述第二像素电极的全部边缘处设置所述屏蔽电极。本实施例中,各所述亚像素单元之间、及所述第一像素电极和所述第二像素电极之间的干扰被屏蔽。
优选的,所述屏蔽电极与所述第一像素电极和所述第二像素电极同层设置。本实施例中,在同一层设置所述屏蔽电极、所述第一像素电极和所述第二像素电极,节省工序。
优选的,所述屏蔽电极的材料为ITO或IZO。
本实用新型实施例有益效果如下:在所述像素电极的至少一个边缘处设置所述屏蔽电极,从而消除所述像素电极的尖端放电对周围的所述数据线、所述栅线及相邻的所述亚像素单元造成的干扰,从而提高显示面板的显示效果。
本实用新型实施列提供一种显示面板,包括如上实施例提供的所述阵列基板。
本实用新型实施例有益效果如下:在所述像素电极的至少一个边缘处设置所述屏蔽电极,从而消除所述像素电极的尖端放电对周围的所述数据线、所述栅线及相邻的所述亚像素单元造成的干扰,从而提高显示面板的显示效果。
本实用新型实施列提供一种显示装置,包括如上实施例提供的所述显示面板。
本实用新型实施例有益效果如下:在所述像素电极的至少一个边缘处设置所述屏蔽电极,从而消除所述像素电极的尖端放电对周围的所述数据线、所述栅线及相邻的所述亚像素单元造成的干扰,从而提高显示面板的显示效果。
附图说明
图1为本实用新型提供的亚像素单元的结构示意图;
图2为本实用新型提供的优选的一种阵列基板的结构示意图;
图3为本实用新型提供的优选的另一种阵列基板的结构示意图;
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