[实用新型]相位插值器有效

专利信息
申请号: 201520329778.7 申请日: 2015-05-20
公开(公告)号: CN204578499U 公开(公告)日: 2015-08-19
发明(设计)人: 周玉镇;戴颉;李耿民;庄志青;职春星 申请(专利权)人: 灿芯半导体(上海)有限公司
主分类号: H03K5/13 分类号: H03K5/13
代理公司: 无锡互维知识产权代理有限公司 32236 代理人: 庞聪雅
地址: 201203 上海市浦东*** 国省代码: 上海;31
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摘要:
搜索关键词: 相位 插值器
【权利要求书】:

1.一种相位插值器,其特征在于,其包括:

时钟选择译码器,用于利用采样时钟对输入的插值控制码进行译码得到原始组时钟选择码和预先组时钟选择码,每组时钟选择码中均包括多个时钟选择码,其中预先组时钟选择码中的时钟选择码分别较原始组时钟选择码中的时钟选择码提前半个采样时钟周期变化;

时钟选择判断电路,其在预先组时钟选择码中的时钟选择码变化时,选择输出预先组时钟选择码,否则,选择输出原始组时钟选择码;

相位选择译码器,用于利用采样时钟对输入的插值控制码进行译码得到相位选择码;

第一时钟选择电路,其具有第一输入端、第二输入端和输出端,第一输入端接收第一时钟信号,第二输入端接收第三时钟信号,第一时钟选择电路根据时钟选择判断电路输出的一组时钟选择码有选择的输出第一时钟信号或第三时钟信号;

第二时钟选择电路,其具有第三输入端、第四输入端和输出端,第三输入端接收第二时钟信号,第四输入端接收第四时钟信号,第二时钟选择电路根据时钟选择判断电路输出的一组时钟选择码有选择的输出第二时钟信号或第四时钟信号;

相位插值电路,其第一输入端与第一时钟选择电路的输出端相连,其第二输入端与第二时钟选择电路的输出端相连,其控制端与相位选择译码器的输出端相连,其根据相位选择码对两个输入端输入的时钟信号进行插值,并输出插值后的时钟信号。

2.根据权利要求1所述的相位插值器,其特征在于,每组时钟选择码中均包括有第一时钟选择码、第二时钟选择码、第三时钟选择码和第四时钟选择码,其中预先组时钟选择码中的第一时钟选择码、第二时钟选择码、第三时钟选择码和第四时钟选择码分别较原始组时钟选择码中的第一时钟选择码、第二时钟选择码、第三时钟选择码和第四时钟选择码提前半个采样时钟周期变化,

第一时钟选择电路具有第一控制端和第二控制端,其第一控制端接收时钟选择判断电路输出的一组时钟选择码中的第一时钟选择码,其第二控制端接收时钟选择判断电路输出的一组时钟选择码中的第三时钟选择码,其在第一时钟选择码有效,且在第三时钟选择码无效时,输出第一时钟信号,其在第一时钟选择码无效,且在第三时钟选择码有效时,输出第三时钟信号;

第二时钟选择电路具有第三控制端和第四控制端,其第三控制端接收时钟选择判断电路输出的一组时钟选择码中的第二时钟选择码,其第四控制端接收时钟选择判断电路输出的一组时钟选择码中的第四时钟选择码,其在第二时钟选择码有效,且在第四时钟选择码无效时,输出第二时钟信号,其在第二时钟选择码无效,且在第四时钟选择码有效时,输出第四时钟信号。

3.根据权利要求2所述的相位插值器,其特征在于,

所述时钟选择判断电路,在预先组时钟选择码中的第一时钟选择码由无效变为有效且第三时钟选择码由有效变为无效,或者第二时钟选择码由无效变为有效且第四时钟选择码由有效变为无效时,选择输出预先组时钟选择码,否则,选择输出原始组时钟选择码;或者

所述时钟选择判断电路,在预先组时钟选择码中的第一时钟选择码由有效变为无效且第三时钟选择码由无效变为有效,或者第二时钟选择码由有效变为无效且第四时钟选择码由无效变为有效时,选择输出预先组时钟选择码,否则,选择输出原始组时钟选择码。

4.根据权利要求1所述的相位插值器,其特征在于,第一时钟信号和第三时钟信号的相位相差180度,第二时钟信号和第四时钟信号的相位相差180度,第一时钟信号和第二时钟信号的相位相差90度,第三时钟信号与第四时钟信号的相位相差90度。

5.根据权利要求1所述的相位插值器,其特征在于,所述相位选择码包括第一权重码和第二权重码,

第一权重码为第一时钟选择电路输出的时钟信号的插值权重,

第二权重码为第二时钟选择电路输出的时钟信号的插值权重,

相位插值电路根据第一权重码和第二权重码对两个输入端输入的时钟信号进行插值,并输出插值后的时钟信号,

第二权重码为第一权重码的和为恒定值。

6.根据权利要求5所述的相位插值器,其特征在于,相位选择译码器包括相位选择译码电路和相位选择采样电路,

所述相位选择译码电路对输入的插值控制码进行译码得到串行初始相位选择码,相位选择采样电路利用采样时钟对串行初始相位选择码进行采样得到并行的第一权重码和第二权重码。

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