[实用新型]GOA单元、栅极驱动电路及显示装置

说明书

技术领域

本实用新型涉及显示技术领域，具体地，涉及一种GOA单元、栅极驱动电路及显示装置。

背景技术

在显示装置中，栅极驱动电路提供开启信号，使多行像素依次、逐行开启，实现显示。一般地，栅极驱动电路包括多级移位寄存器，每级移位寄存器与一行像素对应；在一行像素开启时，该行像素对应的移位寄存器生成驱动信号，输入到与该行像素连接的栅线中，从而驱动该行像素开启。

目前，为了实现显示装置的轻薄化，越来越多的栅极驱动电路采用GOA技术(GateonArray，即把栅驱动芯片制备在阵列基板上)，在采用GOA技术的栅极驱动电路中，其移位寄存器称之为GOA单元。

在现有的显示装置中，每级GOA单元在驱动其对应的一行像素开启后输出关闭信号，且处于悬浮(Flooding)状态；在此情况下，由于信号串扰，处于悬浮状态的GOA单元容易被耦合进入的信号误开启，从而导致与该GOA单元对应的一行像素被充电，从而显示错误的图像，即所谓“画异”现象。

发明内容

本实用新型旨在至少解决现有技术中存在的技术问题之一，提出了一种GOA单元、栅极驱动电路及显示装置，其可以避免栅线的误开启，使像素不会被充电，显示错误的图像，这样就克服所谓“画异”现象。

为实现本实用新型的目的而提供一种GOA单元，其包括驱动模块，所述驱动模块用于将第一时钟信号从所述GOA单元的输出端输出，所述GOA单元还包括下拉模块，所述下拉模块与驱动模块连接，以及和至少一个低电压端连接，其用于在所述GOA单元输出关闭信号时，将至少一个低电压端提供的低电压信号输入到驱动模块的控制端，以使所述驱动模块在该低电压端的控制下处于关闭状态。

其中，所述下拉模块包括第一子模块、第二子模块和第三子模块；所述第一子模块的第一端与驱动模块的控制端连接，第二端与一低电压端连接，第三端与第二子模块和第三子模块连接；所述第二子模块的第一端连接输入信号端，第二端连接第二时钟信号，第三端和第一子模块连接；第三子模块的第一端与一低电压端连接，第二端与驱动模块的控制端连接，第三端与第一子模块连接。

其中，所述下拉单元还包括第四子模块；所述第四子模块的第一端与所述GOA单元的输出端连接，第二端与一低电压端连接，第三端与第二子模块和第三子模块连接。

其中，所述第一子模块包括第四晶体管；所述第四晶体管的控制极属于第一子模块的第三端，其和第二子模块、第三子模块连接；源极属于第一子模块的第二端，其和一低电压端连接；漏极属于第一子模块的第一端，其与驱动模块的控制端连接。

其中，所述第四子模块包括第五晶体管；所述第五晶体管的控制极为第四子模块的第三端，其与第二子模块、第三子模块连接；源极为第四子模块的第二端，其和一低电压端连接；漏极为第四子模块的第一端，其与所述GOA单元的输出端连接。

其中，所述第二子模块包括第一晶体管和第二晶体管；所述第一晶体管的控制极为所述第二子模块的第二端，其与第二时钟信号连接；源极为所述第二子模块的第一端，其与输入信号端连接；漏极与第二晶体管的控制极和源极连接；所述第二晶体管的漏极为所述第二子模块的第三端，其与第一子模块连接；所述输入信号端为高电压端或第二时钟信号。

其中，所述第三子模块包括第三晶体管；所述第三晶体管的控制极为所述第三子模块的第二端，其与驱动模块的控制端连接；源极为所述第三子模块的第一端，其与一低电压端连接；漏极为所述第三子模块的第三端，其与第一子模块连接。

其中，所述第一子模块包括第四晶体管；所述第二子模块包括第一晶体管和第二晶体管；所述第三子模块包括第三晶体管；

所述第一晶体管的控制极与第二时钟信号连接，源极与输入信号端连接，漏极与第二晶体管的控制极和源极连接；

所述第二晶体管的漏极与第四晶体管的控制极连接；

所述第三晶体管的控制极与驱动模块的控制端连接，源极与一低电压端连接，漏极与第四晶体管的控制极连接；

所述第四晶体管的源极与一低电压端连接，漏极与驱动模块的控制端连接；所述输入信号端为高电压端或第二时钟信号。

其中，与所述第三晶体管的源极连接的低电压端和与第四晶体管的源极连接的低电压端为同一电压端。

其中，所述下拉模块还包括第四子模块，所述第四子模块包括第五晶体管；所述第五晶体管的控制极与第二子模块、第三子模块连接；源极和一低电压端连接；漏极与所述GOA单元的输出端连接。