[实用新型]基于UDP的TDMA协议控制平台有效
申请号: | 201520781655.7 | 申请日: | 2015-10-09 |
公开(公告)号: | CN205051727U | 公开(公告)日: | 2016-02-24 |
发明(设计)人: | 严忠;黄华东;黄祥;彭宇;李国治;刘月;余召仿;钟秉飞;喻磊;童嘉新;高立;付培培 | 申请(专利权)人: | 武汉中元通信股份有限公司 |
主分类号: | H04L29/06 | 分类号: | H04L29/06;H04L29/08 |
代理公司: | 武汉开元知识产权代理有限公司 42104 | 代理人: | 樊戎 |
地址: | 430205 湖北省武*** | 国省代码: | 湖北;42 |
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摘要: | |||
搜索关键词: | 基于 udp tdma 协议 控制 平台 | ||
技术领域
本实用新型涉及一种基于UDP的TDMA协议控制平台,具体地说是在UDP数据传输协议下,实现基于TDMA的信道接入控制的平台。
背景技术
随着互联网的飞速发展,以太网的应用也越来越广泛,速度也越来越快。目前,近八成的网络都采用的是以太网技术。同时,随着技术的不断成熟与进步,以太网的应用范围也不再局限于局域网,基于以太网的接入技术也得到了广泛的应用。物理层与链路层间的接口是接入网领域中不断发展的技术,其职能是负责从物理层得到的数据中提取ATM,IP分组,通过物理层与链路层间的高速接口提交给专用ASIC或网络处理器进行处理。物理层与链路层间的接口负责在物理层和链路层之间传输数据,通常发送方向定义为链路层到物理层的数据传输,接收方向定义为物理层到链路层的数据传输,一般支持变长的数据包格式传输,并且要求数据的发送方和接收方都拥有独立的流量控制。数据的发送方提供发送数据的有效标识,数据接收方提供接收空间的有效标识。
基于UDP的TDMA协议控制技术研究对于以太网接入技术有着重大的意义,随着制造工艺的不断提升,集成电路的集成度也越来越高,相同面积可以集成更多的元件,但是这也使得制造一片芯片所需要的时间和成本也相应的提高了。这些问题给FPGA提供了很好的发展机遇,在FPGA上实现UDP的TDMA协议控制,并将其应用到以太网的相关应用中,是有一定的实际意义的。
实用新型内容
本实用新型的目的是提供一种基于UDP的TDMA协议控制平台,在此平台上实现TDMA协议的控制,从而使得上MAC软件与物理层软件实现互联互通。
为了达到上述目的,本实用新型采用的技术方案是:
一种基于UDP的TDMA协议控制平台,其平台包括:综合业务处理模件1,ATOM核心板模件2、变频板模件3。综合业务处理模件1和ATOM核心板模件2通过网口相连,与变频板模件3构成了基于UDP的TDMA协议控制平台。
所述综合业务处理模件1为模块化结构,包括1个FPGA芯片11,1个中频DAC信号处理器12,1个USB串口13,1个以太网口14,1个FLASH15,1个JTAG口16。
所述ATOM核心板模件2,包括1个CPU21,1个收发频率控制单元22,1个发功率控制单元23,1个人机接口板24,1个FLASH模块25。
所述变频板模件3,包括1个FPGA芯片31,1个频合指示单元32,1个ADC转化模块33。
本实用新型提供基于UDP的TDMA协议控制平台,采用模块化结构设计,明确接口标准,以简明的结构建立硬件平台,侧重以功能和电路模块对应。具体是将综合业务软件、上MAC软件对应硬件平台的综合业务电路模件、ATOM核心板电路模件。该平台只需要网线和PC机就可以实现媒体传输功能。同时本实用新型具有理念新颖、设计简单、方法可靠、实用性强,操作灵活快捷,整体结构合理等特点。
附图说明
图1本实用新型电路模件电原理框图
图中符号说明:
1为综合业务处理模件,2为ATOM核心板模件,3为变频板模件。
11为FPGA芯片,12为中频DAC信号处理器,13为USB串口,14为以太网口,15为FLASH,16为JTAG口。
21为CPU,22为收发频率控制单元,23为发功率控制单元,24为人机接口板,25为FLASH模块。
31为FPGA芯片,32为频合指示单元,33为ADC转化模块。
具体实施方式
请参阅图1所示,为本实用新型具体实施例。
从图1可以看出:
一种基于UDP的TDMA协议控制平台,其平台包括:综合业务处理模件1,ATOM核心板模件2、变频板模件3。综合业务处理模件1和ATOM核心板模件2通过网口相连,与变频板模件3构成了一个整体,形成了基于UDP的TDMA协议控制平台。其中:
所述综合业务处理模件1为模块化结构,包括1个FPGA芯片11,1个中频DAC信号处理器12,1个USB串口13,1个以太网口14,一个FLASH15,1个JTAG口16;中频DAC信号处理器12、USB串口13,以太网口14,FLASH15,JTAG口16分别通过脚A2、A3、A4、A5、A6与FPGA芯片11进行控制信息与数据的交互。FPGA芯片11的A7脚与ATOM板的CPU的B4脚相连进行控制信息的交流。FPGA芯片11的FIFO与ATOM板的B3相连进行数据交互。
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