[实用新型]一种降低电源输入冲击电流的缓启动电路有效
申请号: | 201520967296.4 | 申请日: | 2015-11-27 |
公开(公告)号: | CN205356135U | 公开(公告)日: | 2016-06-29 |
发明(设计)人: | 王笃俊;贾军强;张润东;崔梦宇;尹首钦;邱常玉;任立英 | 申请(专利权)人: | 北京航天万源科技公司 |
主分类号: | H02M1/36 | 分类号: | H02M1/36 |
代理公司: | 核工业专利中心 11007 | 代理人: | 王洁 |
地址: | 100176 北京市大兴*** | 国省代码: | 北京;11 |
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摘要: | |||
搜索关键词: | 一种 降低 电源 输入 冲击 电流 启动 电路 | ||
技术领域
本实用新型属于一种应用于某电源开机时,降低其输入冲击电流的缓启动电路。目的是保证电源在开机时,其前级的供电电源不跳闸,使电源的工作更加稳定。
背景技术
对于应用于通讯、工业控制、军工、航天等关键领域的电源产品的可靠性具有较高的要求。由于目前大功率电源产品的输入端电解电容容量较大,电源在开机瞬间会有很大的开机冲击电流,为了满足电源开机时,减小输入冲击电流,提高电源的工作可靠性,在电源输入端设计开机缓启动电路是十分必要的。本实用新型提供了一种降低电源输入冲击电流的缓启动电路。
发明内容
本实用新型的目的在于提供一种降低电源输入冲击电流的缓启动电路。
本实用新型所采用的技术方案是:
一种降低电源输入冲击电流的缓启动电路,包括依次连接的缓启动时间电路、缓启动驱动电路、缓启动隔离电路和缓启动执行电路。
所述降低电源输入冲击电流的缓启动电路还包括缓启动时序电路,缓启动时序电路和缓启动驱动电路并联后一端与缓启动时间电路连接,另一端依次串联缓启动隔离电路和缓启动执行电路。
所述缓启动时间电路包括时间控制电路和第一路比较器,时间控制电路为第一路比较器的输入信号。
所述时间控制电路包括电阻R11、电阻R12、电阻R13、电容C7、电容C9和二极管V3;电阻R12与电容C7并联,并联后的一端经电阻R11与电源连接,同时该端与第一路比较器的负向输入端连接,并联后的另一端直接接地;电阻R13与二极管V3并联,并联后的一端与电容C9连接然后接地,同时该端还连接第一路比较器的正向输入端,并联后的另一端与电源连接;第一路比较器的4脚接负压供电电源,8脚接正压供电电源。
所述缓启动时序电路包括由分压电阻及第二路比较器,分压电阻R16一端连接电源,另一端与电阻R17和电容C11的并联结构串联后接地,电阻R16的另一端同时还连接第二路比较器5脚的正向输入端;缓启动时间电路的第一路比较器的输出端与第二路比较器6脚的反向输入端连接。
所述缓启动驱动电路包括时基电路及三极管电路。
所述缓启动时间电路中的第一路比较器输出端通过电阻R9连接时基电路的4脚,时基电路的3脚依次连接电阻R7、电阻R6和电源,电阻R6的一端连接三极管Q1的发射极2,另一端连接三极管Q1的基极,三极管Q1的集电极连接缓启动隔离电路4,三极管Q1的集电极连接缓启动隔离电路;延时驱动信号通过电阻R9进入时基电路,时基电路发出一个连续的高频方波信号;当高频方波信号处于高电平时,由R6、R7、Q1及12V电压组成的三极管电路处于开关截止的状态;当方波信号处于低电平时,由R6、R7、Q1及12V电压组成的三极管电路处于开关导通的状态,并将所得到的电压及集电极电流传递给缓启动隔离电路。
所述缓启动隔离电路包括缓启动隔离变压器、二极管V1和电阻R4;缓启动隔离变压器的二次侧与缓启动驱动电路连接,缓启动隔离变压器的一次侧与二极管V14串联,然后和电阻R4并联;缓启动驱动电路的信号经过缓启动隔离变压器进入二极管V14的阳极,二极管V1的阴极输出的信号进入缓启动执行电路。
所述缓启动执行电路包括晶闸管和缓启动电阻;晶闸管VT1的门级连接缓启动隔离电路,晶闸管VT1与电阻R1并联,晶闸管VT1的阳极与整流硅桥的输出端,阴极接滤波电容C2;交流电信号经整流硅桥通过缓启动执行电路中的缓启动电阻R1给电解电容C2充电,当缓启动隔离电路将缓启动驱动信号发出后,缓启动执行电路中的晶闸管门级接收该驱动信号,此时,交流电信号经整流硅桥整流后通过晶闸管给电解电容C2充电。
所述电阻R11与电阻R12阻值相同;电阻R16与电阻R17阻值相等。
本实用新型的有益效果:
本实用新型提供了一种降低电源输入冲击电流的缓启动电路,能够满足电源开机时减小输入冲击电流,避免大功率电源产品在开机瞬间会有很大的开机冲击电流,造成设备损坏,提高电源的工作可靠性。
附图说明
图1为本实用新型所提供的一种降低电源输入冲击电流的缓启动电路示意图;
图2为本实用新型所提供的一种降低电源输入冲击电流的缓启动电路原理图;
图3为图1中缓启动时间电路的局部放大图;
图4为图1中缓启动时序电路的局部放大图;
图5为图1中缓启动驱动电路的局部放大图;
图6为图1中缓启动隔离电路的局部放大图;
图7为图1中缓启动执行电路的局部放大图。
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