[实用新型]一种信号发生器有效
申请号: | 201521010558.4 | 申请日: | 2015-12-08 |
公开(公告)号: | CN205179018U | 公开(公告)日: | 2016-04-20 |
发明(设计)人: | 孙敏;宋烨曦;杨光 | 申请(专利权)人: | 四川九洲电器集团有限责任公司 |
主分类号: | H03L7/16 | 分类号: | H03L7/16;H03L7/24 |
代理公司: | 北京同达信恒知识产权代理有限公司 11291 | 代理人: | 黄志华 |
地址: | 621000*** | 国省代码: | 四川;51 |
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摘要: | |||
搜索关键词: | 一种 信号发生器 | ||
技术领域
本实用新型涉及电子技术领域,特别涉及一种信号发生器。
背景技术
信号发生器被广泛应用于现代雷达系统、现代通信系统中。信号发生器可 以根据实际需要来产生不同形式信号。具体的,以信号发生器为捷变频信号发 生器为例,由于捷变频频率源不仅具有优良的抗干扰能力,而且大大提高了系 统的处理能力,因此捷变频信号发生器被广泛应用。但随着科学技术的不断发 展,除了捷变频功能以外,现在的通信系统、雷达系统还要求捷变频信号发生 器具有多种调制功能,能够产生多种方式进行调制的调制信号,如最小频移键 控(MinimumShiftKeying,MSK)、二进制相移键控(BinaryPhaseShiftKeying, BPSK)、幅移键控(AmplitudeShiftKeying,ASK)、线性调频等。
在现有技术中,这种多功能的捷变频调制信号发生器实现起来是比较复杂 的。通常采用现场可编程门阵列(FieldProgrammableGateArray,FPGA)来 进行调制方式的控制,但在现有技术中,FPGA需要有独立的FPGA时钟源来 提供时钟信号。且现有技术中的信号发生器需要设置混频电路对信号进行变频 得到预定频段的调制信号。
由上所述,由于引入了混频电路和独立的FPGA时钟源,现有技术中的信 号发生器存在体积较大的技术问题。
实用新型内容
本申请实施例提供一种信号发生器,用于解决现有技术中的信号发生器存 在体积较大的技术问题,实现了减小信号发生器体积的技术效果。
本申请实施例提供一种信号发生器,包括:
控制单元;
时钟信号发生器,与所述控制单元相连,其中,所述控制单元控制所述时 钟信号发生器产生第一时钟信号;
频率合成器,与所述控制单元及所述时钟信号发生器相连,其中,所述时 钟信号发生器将所述第一时钟信号发送至所述频率合成器,所述频率合成器基 于所述第一时钟信号,生成第一信号以及第二时钟信号,所述第一时钟信号为 所述频率合成器的时钟信号,所述第二时钟信号为所述控制单元的时钟信号, 所述频率合成器将所述第二时钟信号发送至所述控制单元。
可选的,所述频率合成器用于对所述第一时钟信号进行分频处理,得到所 述第二时钟信号,其中,所述第一信号以及所述第二时钟信号的相位相同。
可选的,所述控制单元用于控制所述频率合成器对所述第一信号进行调制 处理,获得第一调制信号。
可选的,所述信号发生器还包括:
带通滤波器,与所述频率合成器相连,用于对所述第一调制信号进行滤波 处理,获得第二调制信号,所述第二调制信号的杂散干扰满足预设杂散干扰范 围。
可选的,所述信号发生器还包括:
放大器,与所述带通滤波器相连,用于对所述第二调制信号进行功率放大, 获得第三调制信号,所述第三调制信号的功率满足预设功率范围。
可选的,所述控制单元为现场可编程门阵列或复杂可编程逻辑器件。
可选的,所述频率合成器为直接数字式频率合成器或间接频率合成器或直 接模拟频率合成器。
可选的,所述直接数字式频率合成器为AD9914芯片。
可选的,所述第一信号为L波段信号。
本申请实施例中的上述一个或多个技术方案,至少具有如下一种或多种技 术效果:
一、本申请实施例中的方案中,频率合成器基于时钟信号发生器产生并发 送的第一时钟信号,一方面生成第一信号进行进一步调制处理,另一方面生成 第二时钟信号为控制单元提供所需要的时钟信号。而不用像现有技术那样单独 为控制单元提供独立的时钟源,节约了设置时钟源的空间。因此,本申请实施 例中的方案有效解决了现有技术中的信号发生器存在体积较大的技术问题,实 现了减小信号发生器体积的技术效果。
二、本申请实施例中的信号发生器通过采用直接数字式频率合成器,直接 生成L波段的第一信号,而不用像现有技术那样通过混频电路进行变频得到L 波段的信号,因此,不用引入混频电路,节约了空间,进一步减小了信号发生 器的体积和重量,同时降低了信号发生器的成本。
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