[发明专利]一种GOA电路及液晶显示装置有效
申请号: | 201610089925.7 | 申请日: | 2016-02-18 |
公开(公告)号: | CN105529010B | 公开(公告)日: | 2018-03-13 |
发明(设计)人: | 黄笑宇 | 申请(专利权)人: | 深圳市华星光电技术有限公司 |
主分类号: | G09G3/36 | 分类号: | G09G3/36 |
代理公司: | 深圳翼盛智成知识产权事务所(普通合伙)44300 | 代理人: | 黄威 |
地址: | 518132 广东*** | 国省代码: | 广东;44 |
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摘要: | |||
搜索关键词: | 一种 goa 电路 液晶 显示装置 | ||
【技术领域】
本发明涉及显示器技术领域,特别是涉及一种GOA电路及液晶显示装置。
【背景技术】
随着薄膜晶体管液晶显示器(TFT-LCD,Thin Film Transistor Liquid Crystal Display)的不断发展,TFT-LCD已经成为了现代IT、视讯产品中重要的显示平台,也使得用户对其要求越来越高。为了满足超窄边框及低成本的需求,使得GOA(Gate On Array,栅级驱动芯片集成于阵列基板)技术得到了飞速发展。
在实际驱动过程中,栅极电压输出的下降沿变化过快会影响面板内部的基准电压,且影响的程度与单位时间内电压的变化正相关。传统架构的设计中,会通过PCB端的设计对栅极的输出进行削角,即将高电平下降到低电平的时间延长,以减小对基准电压影响。图1为经过削角后的栅极电压的输出波形图,该高电平例如为V2(比如为33V),低电平为V1(比如为-7V)。然而GOA技术由于其栅极输入电压是在阵列基板上形成,所以无法通过PCB端的设计对栅极的输出电压进行削角,从而使得现有的GOA技术的液晶显示装置基准电压容易受到影响,降低了显示效果。
因此,有必要提供一种GOA电路及液晶显示装置,以解决现有技术所存在的问题。
【发明内容】
本发明的目的在于提供一种GOA电路及液晶显示装置,以解决现有技术的GOA技术的液晶显示装置,由于无法延长栅极输入电压的下降时间,从而导致容易影响基准电压,降低了显示效果的技术问题。
为解决上述技术问题,本发明构造了一种GOA电路,其包括:多个用于向扫描线输入扫描信号的栅极驱动模块,所述栅极驱动模块包括:
GOA单元,用于提供初始扫描电压;
输出控制单元,与所述GOA单元连接;所述输出控制单元包括:
第一控制支路,用于控制所述栅极驱动模块输出与所述初始扫描电压相关联的切换扫描电压;
第二控制支路,用于控制所述栅极驱动模块输出与所述初始扫描电压不关联的切换扫描电压;
第三控制支路,用于当所述栅极驱动模块处于第一工作模式时,控制所述第一控制支路开启;以及当所述栅极驱动模块处于第二工作模式时,控制所述第二控制支路的开启;其中所述栅极驱动模块具有所述第一工作模式、所述第二工作模式、第三工作模式;
第四控制支路,用于当所述栅极驱动模块处于所述第三工作模式时,控制输出所述初始扫描电压。
在本发明的GOA电路中,所述输出控制单元具有控制电压和高电平电源;
所述第一控制支路包括第一薄膜晶体管、所述第二控制支路包括第二薄膜晶体管、所述第三控制支路包括第三薄膜晶体管、所述第四控制支路包括第四薄膜晶体管;所述第一薄膜晶体管具有第一输入端、第一控制端、第一输出端;所述第二薄膜晶体管具有第二输入端、第二控制端、第二输出端;所述第三薄膜晶体管具有第三输入端、第三控制端、第三输出端;所述第四薄膜晶体管具有第四输入端、第四控制端、第四输出端;
所述第一控制端和所述第二控制端连接所述控制电压,所述第一输入端连接所述初始扫描电压;所述第一输出端分别与所述第二输出端以及所述第三输入端连接;所述第二输入端连接所述高电平电源;所述第三控制端和所述第四控制端连接所述初始扫描电压;所述第四输入端连接所述第四控制端,所述第三输出端连接所述第四输出端,所述第四输出端还连接所述扫描线。
在本发明的GOA电路中,所述第一薄膜晶体管为PNP型薄膜晶体管,所述第二薄膜晶体管为NPN型薄膜晶体管;所述第三薄膜晶体管为NPN型薄膜晶体管,所述第四薄膜晶体管为PNP型薄膜晶体管。
在本发明的GOA电路中,所述控制电压具有高电平和低电平;所述初始扫描电压也具有高电平和低电平;
当所述栅极驱动模块处于所述第一工作模式时,所述初始扫描电压为高电平,且所述控制电压为低电平,所述切换扫描电压等于所述初始扫描电压;
当所述栅极驱动模块处于所述第二工作模式时,所述初始扫描电压为高电平,且所述控制电压为高电平,所述切换扫描电压等于所述高电平电源的电压;
当所述栅极驱动模块处于所述第三工作模式时,所述初始扫描电压为低电平,所述切换扫描电压等于所述初始扫描电压。
在本发明的GOA电路中,当所述栅极驱动模块处于所述第一工作模式时,所述第一薄膜晶体管闭合,所述第二薄膜晶体管断开;所述第三薄膜晶体管闭合,所述第四薄膜晶体管断开;
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