[发明专利]源极驱动器及显示系统有效

专利信息
申请号: 201610105369.8 申请日: 2016-02-25
公开(公告)号: CN105590603B 公开(公告)日: 2018-07-03
发明(设计)人: 孙盟哲 申请(专利权)人: 硅谷数模半导体(北京)有限公司;硅谷数模国际有限公司
主分类号: G09G3/36 分类号: G09G3/36
代理公司: 北京康信知识产权代理有限责任公司 11240 代理人: 韩建伟;张永明
地址: 100086 北京市海淀*** 国省代码: 北京;11
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摘要:
搜索关键词: 源极驱动模块 视频数据流 源极驱动器 控制命令 显示系统 接收端 驱动器 时序控制模块 时序控制器 时序 尺寸增大 独立芯片 系统功耗 像素阵列 种源 图像 驱动 传递
【说明书】:

发明公开了一种源极驱动器及显示系统。其中,该源极驱动器包括:接收端,用于接收视频数据流和控制命令;源极驱动模块,用于驱动像素阵列以显示与视频数据流对应的图像;时序控制模块,连接在接收端和源极驱动模块之间,用于根据控制命令将来自接收端的视频数据流以指定时序传递给源极驱动模块。本发明解决了相关技术中由于源极驱动器和时序控制器必须分别设置在独立芯片上而造成系统尺寸增大、系统功耗增加的技术问题。

技术领域

本发明涉及电子器件领域,具体而言,涉及一种源极驱动器及显示系统。

背景技术

图1是根据现有技术的一种传统基于嵌入式显示端口(embedded DisplayPort,简称为eDP)的LCD显示系统的结构图。如图1所示,视频源10’(video source)通过eDP接口的发送端(简称为eDPTX 102’)将视频图像对应的视频数据流以帧为单位发送给时序控制器20’(TCON),其中,视频数据流通过eDPTX 102’的主链路(main l ink)发出,控制命令及状态报告通过eDPTX 102’的辅助链路(AUX CH)传输,主链路可以包含1至4条高速数据通道(如lane0-lane3),辅助通道只包含有一条低速数据通道。时序控制器20’收到视频数据流及控制命令后,会先对每帧数据进行处理,再将处理后的数据按指定格式和指定时序发送给显示面板30’上的源极驱动器40’,同时生成指定的时钟信号发送给栅极驱动器50’(gatedriver)。源极驱动器40’和栅极驱动器50’协同驱动像素阵列60’(pixel array)来显示一帧数据。显示系统中可以有多个源极驱动器40’,每个源极驱动器40’单独设置在一个芯片上,每个源极驱动器40’与时序控制器20’之间通常通过厂商指定的高速接口连接,时序控制器20’单独设置在一颗芯片上,且独立于显示面板30’(display panel)之外。

可见,传统结构中时序控制器与上游视频源及下游源极驱动器之间均通过高速串行接口连接,且必须单独设置在一块独立于显示面板和系统主板的电路板上,这样会导致系统尺寸增大、系统功耗增加。

针对上述的问题,目前尚未提出有效的解决方案。

发明内容

本发明实施例提供了一种源极驱动器及显示系统,以至少解决相关技术中由于源极驱动器和时序控制器必须分别设置在独立芯片上而造成系统尺寸增大、系统功耗增加的技术问题。

根据本发明实施例的一个方面,提供了一种源极驱动器,包括:接收端,用于接收视频数据流和控制命令;源极驱动模块,用于驱动像素阵列以显示与上述视频数据流对应的图像;时序控制模块,连接在上述接收端和上述源极驱动模块之间,用于根据上述控制命令将来自上述接收端的上述视频数据流以指定时序传递给上述源极驱动模块。

进一步地,上述源极驱动器还包括:主从控制器,连接至上述接收端,且连接至上述时序控制模块,用于将上述控制命令传递给其他源极驱动器,以及使各源极驱动器保持同步。

根据本发明实施例的另一方面,还提供了一种显示系统,包括:像素阵列;一个或者多个上述的源极驱动器。

进一步地,上述显示系统还包括:栅极驱动器,连接至一个或者多个上述源极驱动器中的主源极驱动器,用于与所有源极驱动器配合来驱动上述像素阵列以显示与视频数据流对应的图像,其中,上述栅极驱动器用于对上述像素阵列进行行扫描,上述源极驱动器用于上述像素阵列的每行像素点进行显示。

进一步地,上述显示系统还包括:具有发送端的视频源,发送端具有包含一条或多条高速数据通道的主链路以及一条辅助链路,上述高速数据通道根据实际需求连接至各源极驱动器,上述辅助链路连接至上述主源极驱动器,其中,上述主链路用于传输视频数据流,上述辅助链路用于传输控制命令和各源极驱动器的状态报告。

进一步地,每个源极驱动器连接一条或者多条高速数据通道。

进一步地,当源极驱动器为多个时,各源极驱动器接收等量的视频数据流。

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