[发明专利]时钟占空比调整装置及方法在审

专利信息
申请号: 201610109399.6 申请日: 2016-02-26
公开(公告)号: CN105577142A 公开(公告)日: 2016-05-11
发明(设计)人: 张利;方海涛 申请(专利权)人: 昆腾微电子股份有限公司
主分类号: H03K3/017 分类号: H03K3/017
代理公司: 暂无信息 代理人: 暂无信息
地址: 100195 北*** 国省代码: 北京;11
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摘要:
搜索关键词: 时钟 调整 装置 方法
【权利要求书】:

1.一种时钟占空比调整装置,其特征在于,包括:

延时模块,用于对输入时钟信号进行延时,生成n个延时时钟信号, 其中,n为大于或等于2的自然数;

选择模块,用于根据期望的时钟占空比,从所述延时时钟信号中选择 1个延时时钟信号,作为目标延时时钟信号;

时钟合成模块,用于将所述输入时钟信号和所述目标延时时钟信号合 成为目标时钟信号,所述目标时钟信号的占空比为所述期望的时钟占空比。

2.根据权利要求1所述的装置,其特征在于,所述延时模块包括n个 串联连接的延时单元,每个延时单元输出1个延时时钟信号。

3.根据权利要求2所述的装置,其特征在于,所述延时模块还包括:

控制单元,用于根据所述输入时钟信号和第n个延时单元输出的延时 时钟信号生成控制信号;

所述延时单元用于根据所述控制信号,控制所述延时单元的延时。

4.根据权利要求1所述的装置,其特征在于,所述时钟合成模块包括:

第一触发器,所述输入时钟信号与所述第一触发器的时钟端连接,所 述第一触发器的输出端用于输出所述目标时钟信号;

第二触发器,所述目标延时时钟信号与所述第二触发器的时钟端连接;

逻辑处理单元,输入端与所述第一触发器的输出端和所述第二触发器 的输出端连接,输出端与所述第一触发器的复位端和所述第二触发器的复 位端连接。

5.根据权利要求1所述的装置,其特征在于,所述时钟合成模块包括:

脉宽合成单元,用于提取第一脉宽信号和第二脉宽信号,将所述第一 脉宽信号和所述第二脉宽信号合成为内部时钟信号,其中,所述第一脉宽 信号为所述输入时钟信号的变化沿的脉宽信号,所述第二脉宽信号为所述 目标延时时钟信号的变化沿的脉宽信号;

分频单元,用于对所述内部时钟信号进行分频,生成所述目标时钟信 号。

6.一种时钟占空比调整方法,其特征在于,包括:

采用延时模块,对输入时钟信号进行延时,生成n个延时时钟信号, 其中,n为大于或等于2的自然数;

采用选择模块,根据期望的时钟占空比,从所述延时时钟信号中选择 1个延时时钟信号,作为目标延时时钟信号;

采用时钟合成模块,将所述输入时钟信号和所述目标延时时钟信号合 成为目标时钟信号,所述目标时钟信号的占空比为所述期望的时钟占空比。

7.根据权利要求6所述的方法,其特征在于,所述延时模块包括n个 串联连接的延时单元,所述生成n个延时时钟信号具体为:

每个延时单元输出1个延时时钟信号。

8.根据权利要求7所述的方法,其特征在于,所述延时模块还包括控 制单元,所述方法还包括:

所述控制单元根据所述输入时钟信号和第n个延时单元输出的延时时 钟信号生成控制信号;

所述延时单元根据所述控制信号,控制所述延时单元的延时。

9.根据权利要求6所述的方法,其特征在于,所述时钟合成模块包括:

第一触发器,所述输入时钟信号与所述第一触发器的时钟端连接,所 述第一触发器的输出端输出所述目标时钟信号;

第二触发器,所述目标延时时钟信号与所述第二触发器的时钟端连接;

逻辑处理单元,输入端与所述第一触发器的输出端和所述第二触发器 的输出端连接,输出端与所述第一触发器的复位端和所述第二触发器的复 位端连接。

10.根据权利要求6所述的方法,其特征在于,所述时钟合成模块包 括脉宽合成单元和分频单元,所述将所述输入时钟信号和所述目标延时时 钟信号合成为目标时钟信号具体为:

所述脉宽合成单元提取第一脉宽信号和第二脉宽信号,将所述第一脉 宽信号和所述第二脉宽信号合成为内部时钟信号,其中,所述第一脉宽信 号为所述输入时钟信号的变化沿的脉宽信号,所述第二脉宽信号为所述目 标延时时钟信号的变化沿的脉宽信号;

所述分频单元对所述内部时钟信号进行分频,生成所述目标时钟信号。

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