[发明专利]移位寄存器及其驱动方法、驱动电路和显示装置有效
申请号: | 201610191328.5 | 申请日: | 2016-03-30 |
公开(公告)号: | CN105654905B | 公开(公告)日: | 2018-01-26 |
发明(设计)人: | 马占洁 | 申请(专利权)人: | 京东方科技集团股份有限公司 |
主分类号: | G09G3/3225 | 分类号: | G09G3/3225;G11C19/28 |
代理公司: | 北京天昊联合知识产权代理有限公司11112 | 代理人: | 汪源,陈源 |
地址: | 100015 *** | 国省代码: | 北京;11 |
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摘要: | |||
搜索关键词: | 移位寄存器 及其 驱动 方法 电路 显示装置 | ||
技术领域
本发明涉及显示技术领域,尤其涉及一种移位寄存器及其驱动方法、驱动电路和显示装置。
背景技术
随着有源矩阵有机发光二极体(Active-Matrix Organic Light Emitting Diode,AMOLED)技术的不断发展,通过控制发光占空比的方式调制有源矩阵有机发光二极体亮度的技术日趋成熟。现有技术将发光控制移位寄存器整合至扫描控制移位寄存器的结构之中,导致时钟信号的数量增加,从而降低了驱动效率,提高了产品成本。
发明内容
为解决上述问题,本发明提供一种移位寄存器及其驱动方法、驱动电路和显示装置,用于解决现有技术将发光控制移位寄存器整合至扫描控制移位寄存器的结构之中,导致时钟信号的数量增加的问题。
为此,本发明提供一种移位寄存器,包括:
上拉单元,分别与第一输入端、第一信号端、第一电压端、下拉节点以及上拉节点连接,用于根据所述第一输入端、所述第一电压端和所述第一信号端的输入信号以及所述下拉节点的电位控制所述上拉节点的电位;
下拉单元,分别与第二输入端、第二电压端、第一电压端、上拉节点以及下拉节点连接,用于根据所述第二输入端、所述第二电压端、所述第一电压端的输入信号和所述上拉节点的电位控制所述下拉节点的电位;
输出单元,分别与第一电压端、第二信号端、输出端、下拉节点以及上拉节点连接,用于根据所述第一电压端、第二信号端的输入信号以及所述下拉节点和所述上拉节点的电位控制所述输出端的输出信号。
可选的,所述输出单元包括:
第一输出模块,分别与第一电压端、输出端以及下拉节点连接,用于根据所述第一电压端的输入信号和所述下拉节点的电位控制所述输出端的输出信号;
第二输出模块,分别与第二信号端、输出端以及上拉节点连接,用于根据所述第二信号端的输入信号和所述上拉节点的电位控制所述输出端的输出信号。
可选的,所述上拉模块包括第一晶体管和第六晶体管;
所述第一晶体管的栅极与所述上拉节点连接,所述第一晶体管的第一极与所述下拉节点连接,所述第一晶体管的第二极与所述第一电压端连接;
所述第六晶体管的栅极与所述第一信号端连接,所述第六晶体管的第一极与所述第一输入端连接,所述第六晶体管的第二极与所述上拉节点连接。
可选的,所述下拉模块包括第二晶体管和第五晶体管;
所述第二晶体管的栅极与所述下拉节点连接,所述第二晶体管的第一极与所述第一电压端连接,所述第二晶体管的第二极与所述上拉节点连接;
所述第五晶体管的栅极与所述第二输入端连接,所述第五晶体管的第一极与所述第二电压端连接,所述第五晶体管的第二极与所述下拉节点连接。
可选的,所述第一输出模块包括第三晶体管和第一电容;
所述第三晶体管的栅极与所述下拉节点连接,所述第三晶体管的第一极与所述第一电压端连接,所述第三晶体管的第二极与所述输出端连接;
所述第一电容并联于所述下拉节点与所述第一电压端之间。
可选的,所述第二输出模块包括第四晶体管和第二电容;
所述第四晶体管的栅极与所述上拉节点连接,所述第四晶体管的第一极与所述输出端连接,所述第四晶体管的第二极与所述第二信号端连接;
所述第二电容并联于所述上拉节点与所述输出端之间。
本发明还提供一种移位寄存器的驱动方法,所述移位寄存器包括上述任一所述的移位寄存器,所述第一电压端为高电平,所述第二电压端为低电平,所述驱动方法包括:
第一阶段,所述第一输入端的输入信号为高电平,所述第二输入端的输入信号为低电平,所述第一信号端的输入信号为低电平,所述第二信号端的输入信号为高电平,以使所述上拉单元控制所述上拉节点为高电平,所述下拉单元控制所述下拉节点为低电平,所述输出单元控制所述输出端输出高电平;
第二阶段,所述第一输入端的输入信号为高电平,所述第二输入端的输入信号为低电平,所述第一信号端的输入信号为高电平,所述第二信号端的输入信号为低电平,以使所述上拉单元控制所述上拉节点为高电平,所述下拉单元控制所述下拉节点为低电平,所述输出单元控制所述输出端输出高电平;
第三阶段,所述第一输入端的输入信号为低电平,所述第二输入端的输入信号为高电平,所述第一信号端的输入信号为低电平,所述第二信号端的输入信号为高电平,以使所述上拉单元控制所述上拉节点为低电平,所述下拉单元控制所述下拉节点为高电平,所述输出单元控制所述输出端输出高电平;
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