[发明专利]一种基于可配置删余表的删余方法及装置有效

专利信息
申请号: 201610939730.7 申请日: 2016-11-01
公开(公告)号: CN108023663B 公开(公告)日: 2021-04-13
发明(设计)人: 张科峰;石琴琴 申请(专利权)人: 武汉芯泰科技有限公司
主分类号: H04L1/00 分类号: H04L1/00;H03M13/00
代理公司: 暂无信息 代理人: 暂无信息
地址: 430074 湖北省武汉市东湖开发区关东工业园东*** 国省代码: 湖北;42
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摘要:
搜索关键词: 一种 基于 配置 删余表 方法 装置
【权利要求书】:

1.一种基于可配置删余表的删余方法,其特征在于,包括如下步骤:

S1、基于多种通信协议的输入比特信息属性和输出比特信息需求,定义初始删余表的深度;其中,所述输入比特信息属性包括输入比特信息码率和输入比特信息路数,所述输出比特信息需求包括输出比特信息码率和输出比特信息路数;其中,所述初始删余表可配置;

S2、基于当前通信协议的删余需求配置所述初始删余表,以获得与所述当前通信协议匹配的任务删余表;

S3、基于所述任务删余表对输入的第一码率的比特信息进行删余处理,以获得并输出第二码率的比特信息;

其中,所述步骤S2具体包括:

S21a、在所述初始删余表中,定义与当前通信协议的输入比特信息属性相对应的临时删余表;其中,所述临时删余表的行与输入比特信息路数相对应,所述临时删余表的列与输入比特信息码率相对应;

S22a、基于当前通信协议的删余需求,向所述临时删余表中配置删余指示符号,以获得与所述当前通信协议匹配的第一任务删余表;

所述步骤S2还包括:

S21b、基于当前通信协议类型,判断输入比特信息是否分为信息位和校验位;

S22b、当输入比特信息分为信息位和校验位时,基于当前通信协议的删余需求配置所述初始删余表,以获得与所述当前通信协议匹配的第二任务删余表;其中,所述第二任务删余表用于对所述校验位进行删余处理。

2.如权利要求1所述的基于可配置删余表的删余方法,其特征在于,所述步骤S22a具体为:

根据当前通信协议的删余需求,在所述临时删余表的由行列交叉形成的单元格中配置第一删余指示符号或第二删余指示符号;其中,所述当前通信协议的输入比特信息中与所述第一删余指示符号对应的比特位为删除位,与所述第二删余指示符号对应的输入位为保留位。

3.如权利要求1或2所述的基于可配置删余表的删余方法,其特征在于,所述步骤S3具体包括:

S31、周期性读取所述任务删余表中的信息,以对输入的第一码率的比特信息进行删余处理,获得临时删余比特信息;

S32、对所述临时删余比特信息进行并串转换,以获得并输出第二码率的比特信息。

4.一种基于可配置删余表的删余装置,其特征在于,包括

删余表深度定义单元,用于基于多种通信协议的输入比特信息属性和输出比特信息需求,定义初始删余表的深度;其中,所述输入比特信息属性包括输入比特信息码率和输入比特信息路数,所述输出比特信息需求包括输出比特信息码率和输出比特信息路数;其中,所述初始删余表可配置;

任务删余表获取单元,用于基于当前通信协议的删余需求配置所述初始删余表,以获得与所述当前通信协议匹配的任务删余表;

删余单元,用于基于所述任务删余表对输入的第一码率的比特信息进行删余处理,以获得并输出第二码率的比特信息;

其中,所述任务删余表获取单元,具体包括:

临时删余表获取模块,用于在所述初始删余表中,定义与当前通信协议的输入比特信息属性相对应的临时删余表;其中,所述临时删余表的行与输入比特信息路数相对应,所述临时删余表的列与输入比特信息码率相对应;

第一删余表获取模块,用于基于当前通信协议的删余需求,向所述临时删余表中配置删余指示符号,以获得与所述当前通信协议匹配的第一任务删余表;

所述任务删余表获取单元,还包括:

协议类型判断模块,用于基于当前通信协议类型,判断输入比特信息是否分为信息位和校验位;

第二删余表获取模块,用于在所述协议类型判断模块判定输入比特信息分为信息位和校验位时,基于当前通信协议的删余需求配置所述初始删余表,以获得与所述当前通信协议匹配的第二任务删余表;其中,所述第二任务删余表用于对所述校验位进行删余处理。

5.如权利要求4所述的基于可配置删余表的删余装置,其特征在于,所述删余表获取模块,具体用于:

根据当前通信协议的删余需求,在所述临时删余表的由行列交叉形成的单元格中配置第一删余指示符号或第二删余指示符号;其中,所述当前通信协议的输入比特信息中与所述第一删余指示符号对应的比特位为删除位,与所述第二删余指示符号对应的输入位为保留位。

6.如权利要求4或5所述的基于可配置删余表的删余装置,其特征在于,所述删余单元具体包括:

删余信息读取模块,用于周期性读取所述任务删余表中的信息,以对输入的第一码率的比特信息进行删余处理,获得临时删余比特信息;

并串转换模块,用于对所述临时删余比特信息进行并串转换,以获得并输出第二码率的比特信息。

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