[发明专利]扫描线驱动器和包括该扫描线驱动器的显示装置有效
申请号: | 201611020043.1 | 申请日: | 2016-11-18 |
公开(公告)号: | CN107068030B | 公开(公告)日: | 2021-07-02 |
发明(设计)人: | 印海静;郑宝容 | 申请(专利权)人: | 三星显示有限公司 |
主分类号: | G09G3/20 | 分类号: | G09G3/20 |
代理公司: | 北京铭硕知识产权代理有限公司 11286 | 代理人: | 刘灿强;尹淑梅 |
地址: | 韩国京畿*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 扫描 驱动器 包括 显示装置 | ||
1.一种扫描线驱动器,所述扫描线驱动器包括:
驱动电路,被构造为基于扫描输入信号和多个时钟信号向第一驱动节点提供第一驱动信号并向第二驱动节点提供第二驱动信号,其中,所述驱动电路包括多个驱动晶体管和多个重置晶体管;以及
缓冲电路,被构造为基于所述第一驱动信号和所述第二驱动信号产生扫描输出信号,其中,所述缓冲电路包括多个缓冲晶体管,
其中,所述多个驱动晶体管和所述多个缓冲晶体管中的每个包括包含浮置栅极的浮置栅极晶体管,所述浮置栅极被构造为传输与比第一逻辑低电平低的第二逻辑低电平对应的电压,并且
其中,所述浮置栅极晶体管还包括具有第一端子和第二端子的传输晶体管,所述浮置栅极电连接到所述第一端子,所述第二端子被构造为接收与所述第二逻辑低电平对应的电压,并且所述传输晶体管被构造为基于设定的信号而导通。
2.根据权利要求1所述的扫描线驱动器,其中,所述浮置栅极晶体管还包括:
栅极电容器,被构造为电连接所述浮置栅极晶体管的栅电极和所述浮置栅极。
3.根据权利要求1所述的扫描线驱动器,其中,所述多个重置晶体管包括具有电连接到所述第一驱动节点的第一端子以及第二端子的第一重置晶体管,
其中,所述第一重置晶体管的所述第二端子被构造为接收与所述第一逻辑低电平对应的电压,
其中,所述第一重置晶体管被构造为在所述设定的信号具有比所述第一逻辑低电平和所述第二逻辑低电平大的逻辑高电平时导通,
其中,所述第一驱动节点被构造为接收与所述第一逻辑低电平对应的电压。
4.根据权利要求1所述的扫描线驱动器,其中,所述扫描线驱动器具有包括设置期的多个操作期,其中,在所述设置期期间,所述设定的信号具有逻辑高电平,其中,所述多个时钟信号中的每个在所述设置期期间具有所述第一逻辑低电平。
5.根据权利要求4所述的扫描线驱动器,其中,所述操作期还包括重置期,其中,所述设定的信号在所述重置期期间具有比所述第二逻辑低电平低的第三逻辑低电平,其中,所述多个时钟信号中的每个在所述重置期期间具有所述逻辑高电平。
6.根据权利要求5所述的扫描线驱动器,其中,所述操作期还包括连续驱动期,其中,所述多个时钟信号包括第一时钟信号、第二时钟信号和第三时钟信号,其中,在所述连续驱动期期间在所述第一时钟信号具有所述逻辑高电平时,所述第二时钟信号和所述第三时钟信号中的每个具有所述第一逻辑低电平。
7.一种显示装置,所述显示装置包括:
多个扫描线驱动器,均被构造为基于多个时钟信号和扫描输入信号向扫描线提供扫描输出信号;以及
像素阵列,被构造为基于所述扫描输出信号被驱动,
其中,所述多个扫描线驱动器中的每个包括:驱动电路,被构造为基于所述扫描输入信号和所述多个时钟信号向第一驱动节点提供第一驱动信号并且向第二驱动节点提供第二驱动信号,其中,所述驱动电路包括多个驱动晶体管和多个重置晶体管;以及缓冲电路,被构造为基于所述第一驱动信号和所述第二驱动信号产生扫描输出信号,其中,所述缓冲电路包括多个缓冲晶体管,
其中,所述多个驱动晶体管和所述多个缓冲晶体管中的每个包括包含浮置栅极的浮置栅极晶体管,所述浮置栅极被构造为传输与比第一逻辑低电平低的第二逻辑低电平对应的电压,
其中,所述浮置栅极晶体管还包括具有第一端子和第二端子的传输晶体管,其中,所述浮置栅极电连接到所述第一端子,其中,所述第二端子被构造为接收与所述第二逻辑低电平对应的电压,并且其中,所述传输晶体管被构造为基于设定的信号而导通。
8.一种扫描线驱动器,所述扫描线驱动器包括:
驱动电路,被构造为基于扫描输入信号和多个时钟信号向第一驱动节点提供第一驱动信号并向第二驱动节点提供第二驱动信号,其中,所述驱动电路包括多个驱动晶体管和多个重置晶体管;以及
缓冲电路,被构造为基于所述第一驱动信号和所述第二驱动信号产生扫描输出信号,其中,所述缓冲电路包括多个缓冲晶体管,
其中,所述多个驱动晶体管和所述多个缓冲晶体管中的每个包括包含浮置主体的浮置主体晶体管,所述浮置主体被构造为传输与比第一逻辑低电平低的第二逻辑低电平对应的电压,并且
其中,所述浮置主体晶体管还包括具有第一端子和第二端子的传输晶体管,所述浮置主体电连接到所述第一端子并且与所述第二逻辑低电平对应的电压被提供到所述第二端子,并且所述传输晶体管被构造为基于设定的信号而导通。
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