[实用新型]一种双屏解码模组及双屏一体机有效

专利信息
申请号: 201621157182.4 申请日: 2016-10-31
公开(公告)号: CN206339962U 公开(公告)日: 2017-07-18
发明(设计)人: 王智勇;孔意强 申请(专利权)人: 惠科股份有限公司
主分类号: G06F3/14 分类号: G06F3/14
代理公司: 深圳中一专利商标事务所44237 代理人: 张全文
地址: 518000 广东省深圳市宝安区石*** 国省代码: 广东;44
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摘要:
搜索关键词: 一种 双屏 解码 模组 一体机
【说明书】:

技术领域

实用新型属于屏幕控制技术领域,尤其涉及一种双屏解码模组及双屏一体机。

背景技术

显示屏是一种将一定的电子文件通过特定的传输设备显示到屏幕上再反射到人眼的显示工具,显示屏作为一种常用的工具,广泛应用在银行柜台、超市收银柜台、证券交易等等。

现有的显示屏是单屏显示一体机,现有单屏显示一体机的缺陷是:在交易柜台只能一方看到具体的实时交易数据,另一方只能“被动”接受到数据;另外,两人或多人要实时看到相关数据,只能配两台或多台单屏一体机,这样会增加成本。

实用新型内容

本实用新型实施例的目的在于提供一种双屏解码模组及双屏一体机,旨在解决现在使用单屏显示一体机存在成本高的问题。

本实用新型实施例是这样实现的,一种双屏解码模组,所述双屏解码模组包括:

显卡;

分别与所述显卡连接的第一解码模块和第二解码模块,所述第一解码模块和第二解码模块之间通过I2C通讯线连接,所述第一解码模块和第二解码模块集成在一解码板上;

分别与所述第一解码模块和第二解码模块对应连接的第一屏幕和第二屏幕;

分别与所述第一解码模块和第一屏幕连接的第一背光模块;

分别与所述第二解码模块和第二屏幕连接的第二背光模块。

上述结构中,所述双屏解码模组还包括分别与所述第一解码模块和第二解码模块对应连接的第一按键板和第二按键板。

上述结构中,所述第一解码模块和第二解码模块分别将所述显卡输出的eDP信号转换成低电压差分信号。

上述结构中,所述第一解码模块采用第一解码芯片U1,所述第一解码芯片U1的信号输入端IN1接所述显卡,所述第一解码芯片U1的控制输入端IN2接所述第一按键板,所述第一解码芯片U1的第一输出端OUT1接所述第一屏幕,所述第一解码芯片U1的第二输出端OUT2接所述第一背光模块,所述第一解码芯片U1的I2C通讯端I2C接所述第二解码模块。

上述结构中,所述第二解码模块采用第二解码芯片U2,所述第二解码芯片U2的信号输入端IN1接所述显卡,所述第二解码芯片U2的控制输入端IN2接所述第二按键板,所述第二解码芯片U2的第一输出端OUT1接所述第二屏幕,所述第二解码芯片U2的第二输出端OUT2接所述第二背光模块,所述第二解码芯片U2的I2C通讯端I2C接所述第一解码芯片U1的I2C通讯端I2C。

本实用新型实施例的另一目的在于提供一种双屏一体机,所述双屏一体机包括双屏解码模组,所述双屏解码模组包括:

显卡;

分别与所述显卡连接的第一解码模块和第二解码模块,所述第一解码模块和第二解码模块之间通过I2C通讯线连接,所述第一解码模块和第二解码模块集成在一解码板上;

分别与所述第一解码模块和第二解码模块对应连接的第一屏幕和第二屏幕;

分别与所述第一解码模块和第一屏幕连接的第一背光模块;

分别与所述第二解码模块和第二屏幕连接的第二背光模块。

上述结构中,所述双屏解码模组还包括分别与所述第一解码模块和第二解码模块对应连接的第一按键板和第二按键板。

上述结构中,所述第一解码模块和第二解码模块分别将所述显卡输出的eDP信号转换成低电压差分信号。

上述结构中,所述第一解码模块采用第一解码芯片U1,所述第一解码芯片U1的信号输入端IN1接所述显卡,所述第一解码芯片U1的控制输入端IN2接所述第一按键板,所述第一解码芯片U1的第一输出端OUT1接所述第一屏幕,所述第一解码芯片U1的第二输出端OUT2接所述第一背光模块,所述第一解码芯片U1的I2C通讯端I2C接所述第二解码模块。

上述结构中,所述第二解码模块采用第二解码芯片U2,所述第二解码芯片U2的信号输入端IN1接所述显卡,所述第二解码芯片U2的控制输入端IN2接所述第二按键板,所述第二解码芯片U2的第一输出端OUT1接所述第二屏幕,所述第二解码芯片U2的第二输出端OUT2接所述第二背光模块,所述第二解码芯片U2的I2C通讯端I2C接所述第一解码芯片U1的I2C通讯端I2C。

在本实用新型实施例中,双屏解码模组包括第一解码模块和第二解码模块,第一解码模块和第二解码模块集成在一解码板上,通过一片解码板解决两片屏幕的图像解码及驱动显示控制,可节约板卡成本,也能有效减少生产时的加工工序。

附图说明

图1是本实用新型实施例提供的双屏解码模组的模块结构图;

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