[实用新型]一种微处理器运行时鉴权保护电路

说明书

技术领域

本实用新型涉及一种鉴权保护电路，特别是一种微处理器运行时鉴权保护电路，用以防止电路被仿冒、盗版。

背景技术

在国内知识产权技术侵权维权难且代价高、而侵权仿制成本又相对代价低廉但职能部门打击力度有限的大背景下，造成辛勤投入的原创技术被以低成本破解仿造现象时有发生，为增强技术原创研发的权益保护，亟待开发研制伴随产品功能的辅助防盗版功能的技术。

实用新型内容

本实用新型的目的是提供一种微处理器运行时鉴权保护电路，其可使用在具有兼顾打击盗版目的需求的应用电路中。

为实现上述目的，本实用新型采取以下设计方案：

一种微处理器运行时鉴权保护电路，其特征在于包括有：

一作为主控的微处理器CPU芯片；

一组通信存储器芯片，至少为四路单端口通信存储器芯片；

一组串联电阻，包括至少四路串联电阻；

所述的单端口通信存储器芯片的电源和IO端口复用引脚通过串联电阻后，连接到主控的微处理器芯片在主应用电路中剩余闲置下来的通用GPIO引脚上。

所述微处理器运行时鉴权保护电路中，所述的微处理器芯片是带有通用IO接口的任何CPU内核芯片，且采取只用一个GPIO引脚连接一路单端口通信存储器芯片的接线方式。

所述微处理器运行时鉴权保护电路中，所述的一组通信存储器芯片采用四路单端口通信存储器芯片，作为主控的微处理器芯片的GPIO端口依次通过串接四个电阻(R1、R2、R3、R4)后，分别顺次连接到四路单端口通信存储器芯片(U1、U2、U3、U4)的第一引脚上，这些单端口通信存储器芯片(U1、U2、U3、U)4的第二引脚悬空不接，这些单端口通信存储器芯片(U1、U2、U3、U4)的第三引脚统一接地。

所述微处理器运行时鉴权保护电路中，所述的单端口通信存储器芯片采用美国Atmel公司的双引脚自供电串行EEPROM存储器(AT21CS11)。

所述微处理器运行时鉴权保护电路中，所述鉴权保护电路芯片的封装结构形式采用和普通表面贴装三极管(SOT23)一样的封装结构形式。

本实用新型所述微处理器运行时鉴权保护电路，通过给微处理器芯片外接引脚精简式非易失性存储器，并相应在处理器程序中加入鉴权交互算法的方式，使不知道原创设计者意图的盗版抄袭电路在某些场合下工作出现异常，从而达到打击盗版的目的。

本实用新型的优点是：首先由于单端口通信存储器芯片的电源和IO端口引脚是复用的，一方面在芯片封装结构上实现引脚数目精简化，可以“隐蔽成”和普通表贴三极管一样的封装外观；另一方面由于引脚复用，使得读写数据的通讯时序是特别专有的，具有一定操作难度，加上主要的在微处理器程序方面插入了特别的运行时鉴权算法，使不知道设计原创思想的盗版防制品会在某一些情况下才会出现运行错误，实现有效的间接打击盗版的目的。

附图说明

图1为本实用新型微处理器运行时鉴权保护电路的原理图。

下面结合附图及具体实施例对本实用新型做进一步详细说明。

具体实施方式

参阅图1所示，本实用新型微处理器运行时鉴权保护电路的构成主要是针对需鉴权保护的一个微处理器芯片配接一组通信存储器芯片和一组串联电阻，所述的一组可以是一个以上。

参见图1所示的一具体实施例中，作为主控的微处理器CPU芯片的四个GPIO端口依次通过串接电阻R1、R2、R3、R4后，顺次连接到四个单端口通信存储器芯片U1、U2、U3和U4的第一引脚上，单端口通信存储器芯片U1、U2、U3和U4的第二引脚悬空不接，单端口通信存储器芯片U1、U2、U3和U4的第三引脚统一接地。通过这样简单的外加硬件器件连接，再配合下面微处理器程序上插入的专有鉴权算法配合，可以实现对整体电路的防盗版保护目的。

本实用新型微处理器运行时鉴权保护电路中的主控微处理器芯片可以是带有通用IO接口的任何CPU内核芯片，通信存储器芯片选用单端口通信存储器芯片，且采取只用主控微处理器芯片一个GPIO引脚连接一路单端口通信存储器芯片的接线方式。

所述的单端口通信存储器芯片采用美国Atmel公司的双引脚自供电串行EEPROM存储器AT21CS11，其是美国Atmel公司2015年推出全球最具创新性的双引脚自供电串行EEPROM存储器，每个存储器位置都可以完成超过1,000,000次写入循环，以满足当今应用对高写入耐久度的需求，是实现简单产品识别的理想解决方案。