[发明专利]用于过电压保护的装置和方法有效
申请号: | 201680010460.X | 申请日: | 2016-03-14 |
公开(公告)号: | CN107408555B | 公开(公告)日: | 2021-01-19 |
发明(设计)人: | E·J·考尼 | 申请(专利权)人: | 亚德诺半导体集团 |
主分类号: | H01L27/02 | 分类号: | H01L27/02 |
代理公司: | 中国贸促会专利商标事务所有限公司 11038 | 代理人: | 刘倜 |
地址: | 百慕大群岛(*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 用于 过电压 保护 装置 方法 | ||
1.一种电子系统,包括:
连接在输入节点和待保护节点之间的一个或多个过电压保护结型场效应晶体管,其中所述一个或多个过电压保护结型场效应晶体管响应于所述输入节点处的电过应力事件在所述输入节点和所述待保护节点之间提供电压阻塞,其中所述一个或多个过电压保护结型场效应晶体管中的至少第一过电压保护结型场效应晶体管包括:
栅极,配置用于接收固定电压;以及
一个或多个场板,其覆盖处于漏极区域和所述栅极之间的沟道区域的一部分,所述一个或多个场板被配置用于在不同位置以不同的量修改所述沟道区域的表面处的电场梯度;
电连接到所述待保护节点的内部电路,其中所述一个或多个过电压保护结型场效应晶体管具有小于所述内部电路的击穿电压的夹断电压;和
连接在所述输入节点和放电节点之间的过电压保护双极装置,其中所述过电压保护双极装置响应于所述输入节点处的所述电过应力事件从高阻抗状态转变到低阻抗状态。
2.根据权利要求1所述的电子系统,还包括第一管芯和第二管芯,其中所述一个或多个过电压保护结型场效应晶体管和所述过电压保护双极装置集成在所述第一管芯上,并且其中所述内部电路集成在所述第二管芯上。
3.根据权利要求2所述的电子系统,其中所述第一管芯包括硅芯片,并且所述第二管芯包括化合物半导体芯片。
4.根据权利要求2所述的电子系统,其中所述第一管芯和所述第二管芯实现为封装的电子部件。
5.根据权利要求2所述的电子系统,其中所述第一管芯和所述第二管芯在多芯片模块中实现。
6.根据权利要求1所述的电子系统,其中所述夹断电压大于所述待保护节点的标称工作电压。
7.根据权利要求1所述的电子系统,其中所述夹断电压小于所述过电压保护双极装置的触发电压。
8.根据权利要求1所述的电子系统,在所述过电压保护双极装置从所述高阻抗状态转变到所述低阻抗状态时,其中所述一个或多个过电压保护结型场效应晶体管可操作地禁止所述待保护节点处的电压过冲。
9.根据权利要求1所述的电子系统,其中所述过电压保护双极装置具有下列中的至少一个:可控触发电压或可控保持电压。
10.根据权利要求1所述的电子系统,其中所述过电压保护双极装置包括:
半导体层;
在所述半导体层中的基极区域;
在所述半导体层中的集电极区域;和
在所述半导体层中的发射极区域,其中所述集电极区域和所述发射极区域彼此相邻,其中所述集电极区域、所述基极区域和所述发射极区域作为水平双极晶体管工作。
11.根据权利要求10所述的电子系统,其中所述过电压保护双极装置还包括在所述基极区域下方间隔开并以与所述基极区域相同的导电类型掺杂的半导体掩埋区域,其中所述掩埋区域抑制垂直双极晶体管的形成。
12.根据权利要求11所述的电子系统,其中所述集电极区域和所述基极区域之间的间隔宽度建立所述过电压保护双极装置的触发电压。
13.根据权利要求11所述的电子系统,其中所述基极区域的空间参数建立所述过电压保护双极装置的保持电压。
14.根据权利要求1所述的电子系统,其中所述沟道区域和所述漏极区域具有第一掺杂类型,并且其中所述一个或多个过电压保护结型场效应晶体管还包括:
在所述沟道区域中的第二掺杂型的顶部栅极区域,以及
通孔,连接到所述顶部栅极区域,所述一个或多个场板从所述通孔延伸。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的