[发明专利]基于多核块的指令集架构中的寄存器重命名有效

专利信息
申请号: 201680011585.4 申请日: 2016-02-02
公开(公告)号: CN107250978B 公开(公告)日: 2020-06-02
发明(设计)人: G·M·赖特 申请(专利权)人: 高通股份有限公司
主分类号: G06F9/38 分类号: G06F9/38
代理公司: 北京律盟知识产权代理有限责任公司 11287 代理人: 杨林勳
地址: 美国加利*** 国省代码: 暂无信息
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摘要:
搜索关键词: 基于 多核 指令 架构 中的 寄存器 重命名
【权利要求书】:

1.一种用于映射架构寄存器的设备,所述设备包括:

存储器,其经配置以存储核内寄存器重命名映射表和核间寄存器重命名映射表,所述核内寄存器重命名映射表经配置以将所述架构寄存器映射到多核处理器的第一核心的物理寄存器,所述核间寄存器重命名映射表经配置以响应于确定所述物理寄存器是已由所述第一核心执行、正在所述第一核心上执行,或预期在所述第一核心上执行的向所述架构寄存器的最近写入的位置,使所述架构寄存器与所述第一核心的识别有关,所述最近写入是根据程序次序,

其中所述多核处理器是根据基于块的微架构来配置,所述第一核心经配置以执行指派给指令块的指令,且所述指令块是根据基于块的指令集架构来配置,

其中所述核内寄存器重命名映射表包括与第一指令块相关联的第一输入核内寄存器重命名映射表、与所述第一指令块相关联的第一输出核内寄存器重命名映射表、与第二指令块相关联的第二输入核内寄存器重命名映射表,以及与所述第二指令块相关联的第二输出核内寄存器重命名映射表,且

其中所述第一指令块包含具有写入掩码的块标头,所述写入掩码具有对应于所述架构寄存器的位,所述位的值经配置以指示所述架构寄存器是否为预期在所述第一核心上执行的所述第一指令块的写入指令的目标;以及

控制电路,其经配置以维持所述核内寄存器重命名映射表和所述核间寄存器重命名映射表。

2.根据权利要求1所述的设备,其中所述设备经配置以结合读取指令的执行,而参考所述第一输入核内寄存器重命名映射表来确定所述物理寄存器是否为已由所述第一核心执行的向所述架构寄存器的所述最近写入的所述位置。

3.根据权利要求1所述的设备,其中所述第一输出核内寄存器重命名映射表是所述第二输入核内寄存器重命名映射表。

4.根据权利要求3所述的设备,其中所述核内寄存器重命名映射表包括对应于所述架构寄存器的记录,所述记录具有用以存储已映射到所述架构寄存器的所述物理寄存器的识别的第一字段,所述记录具有第二字段,所述第二字段的值经配置以指示所述物理寄存器是否为已由所述第一核心执行的向所述架构寄存器的所述最近写入的所述位置,

其中所述设备经配置以结合所述写入指令的执行,而确定所述第一指令块与具有后续写入指令的后续指令块之间的中间指令块,且所述设备经配置以将存储在所述第一输出核内寄存器重命名映射表的所述第一字段中的所述物理寄存器的所述识别复制到与所述中间指令块相关联的输出核内寄存器重命名映射表的对应第一字段。

5.根据权利要求4所述的设备,其中所述存储器进一步经配置以存储实时写入掩码,所述控制电路进一步经配置以维持所述实时写入掩码,所述实时写入掩码与所述第一指令块相关联,所述实时写入掩码具有对应于所述架构寄存器的位,且所述实时写入掩码的所述位的值经配置以指示作为预期在所述第一核心上执行的所述第一指令块的所述写入指令的所述目标的所述架构寄存器实际上将维持曾由先前指令块的写入指令写入的值。

6.根据权利要求5所述的设备,其中所述设备经配置以响应于确定所述架构寄存器实际上将维持曾由所述先前指令块的所述写入指令写入的所述值,确定所述第一指令块与具有后续写入指令的后续指令块之间的中间指令块,且所述设备经配置以将存储在所述第一输入核内寄存器重命名映射表的所述第一字段中的所述物理寄存器的所述识别复制到所述第一输出核内寄存器重命名映射表的对应第一字段,且复制到与所述中间指令块相关联的输出核内寄存器重命名映射表的对应第一字段。

7.根据权利要求6所述的设备,其中所述设备经配置以结合读取指令的执行,而参考所述实时写入掩码来确定所述架构寄存器是否为已由所述第一核心执行、正在所述第一核心上执行,或预期在所述第一核心上执行的所述第一指令块的所述写入指令的所述目标。

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