[发明专利]一种自适应速率配置方法及网元在审
申请号: | 201710008428.4 | 申请日: | 2017-01-05 |
公开(公告)号: | CN106713179A | 公开(公告)日: | 2017-05-24 |
发明(设计)人: | 刘邦;唐良建;李繁 | 申请(专利权)人: | 京信通信技术(广州)有限公司 |
主分类号: | H04L12/917 | 分类号: | H04L12/917 |
代理公司: | 北京同达信恒知识产权代理有限公司11291 | 代理人: | 黄志华 |
地址: | 510663 广东*** | 国省代码: | 广东;44 |
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摘要: | |||
搜索关键词: | 一种 自适应 速率 配置 方法 | ||
技术领域
本发明涉及通信技术领域,尤其涉及一种自适应速率配置方法及网元。
背景技术
在通信系统中,不同网元之间,很多采用以太网传输通信信号,在不同的应用场景中,有不同的以太网带宽,为便于通信系统灵活组网传输,要求通信系统网元可适应不同带宽,这样不仅组网灵活,亦可削减组网成本。
传统通信系统以太网设计中,一般是使用不同的硬件实体分别支持不同带宽,例如需要网元支持10M、100M及1000M传输速率时,则需要在网元内部设置三套硬件实体,分别支持10M、100M及1000M的传输速率。
这种传统的做法势必会造成占用过多资源,因为不同硬件实体之间仅仅是存在着传输速率的不同,而其它处理都是相同的,因而造成资源冗余,且不够灵活。
发明内容
本发明提供一种自适应速率配置方法及网元,用以实现在一套硬件实体中实现多种速率的切换,从而减少硬件实体的开销。
第一方面,本发明实施例提供一种自适应速率配置方法,包括:
网元的处理单元检测所述网元的物理层芯片的传输状态,所述物理层芯片用于与其他网元协商传输速率;
所述处理单元在所述传输状态发生变化后,获取所述物理层芯片的协商速率,并将所述协商速率配置给所述网元的各网络接口,使各网络接口更新传输速率,所述网络接口支持多种传输速率。
可选地,所述网元还包括数据传输单元,所述处理单元通过所述数据传输单元与所述物理层芯片连接;
所述处理单元将所述协商速率配置给所述网元的各网络接口,包括:
所述处理单元将所述协商速率配置给自身的网络接口;
所述处理单元将所述协商速率配置给所述数据传输单元,所述数据传输单元将所述协商速率配置给自身的网络接口。
可选地,所述处理单元包括与所述数据传输单元连接的第一网络接口、检测单元和第一配置单元,所述数据传输单元包括第二配置单元、与所述处理单元连接的第二网络接口、与所述物理层芯片连接的第三网络接口,所述检测单元分别与所述第一网络接口及所述第一配置单元连接,所述第一配置单元与所述第二配置单元连接,所述第二配置单元分别与所述第二网络接口和所述第三网络接口连接,所述第二网络接口和所述第三网络接口连接;
所述处理单元检测所述网元的物理层芯片的传输状态,包括:所述处理单元的所述检测单元检测所述网元的物理层芯片的传输状态;
所述处理单元将所述协商速率配置给自身的网络接口,包括:所述处理单元的所述检测单元将所述协商速率配置给所述第一网络接口;
所述数据传输单元将所述协商速率配置给自身的网络接口,包括:所述第二配置单元接收所述第一配置单元发送的所述协商速率,并将所述协商速率配置给所述第二网络接口和所述第三网络接口,所述第一配置单元的所述协商速率来自所述检测单元。
可选地,所述处理单元为MCU或FPGA。
可选地,所述处理单元为FPGA;所述FPGA内的网络接口的第一侧为125M时钟GMII接口,所述网络接口的第二侧为125M/25M/2.5M输出时钟可选的RGMII/MII接口,所述网络接口的第一侧用于对所述网元内部收发信号,所述网络接口的第二侧用于对网元外部收发信号;
所述协商速率为1000M,所述处理单元配置所述GMII接口为1个时钟传输1个数据;或者所述协商速率为100M,所述处理单元配置所述GMII接口为10个时钟传输1个数据;所述协商速率为10M,所述处理单元配置所述GMII接口为100个时钟传输1个数据。可选地,所述网络接口的第二侧为125M输出时钟,所述第二侧的网络接口为RGMII接口;或者
所述网络接口的第二侧为25M或2.5M输出时钟,所述第二侧的网络接口为MII接口。
可选地,所述处理单元为MCU;所述MCU内的网络接口由所述MCU内部网络接口硬核构成。
第二方面,本发明实施例提供一种网元,包括处理单元及物理层芯片,所述物理层芯片用于与其他网元协商传输速率;
所述处理单元,用于检测所述物理层芯片的传输状态,在所述传输状态发生变化后,获取所述物理层芯片的协商速率,并将所述协商速率配置给所述网元的各网络接口,使各网络接口更新传输速率,所述网络接口支持多种传输速率。
可选地,所述网元还包括数据传输单元,所述处理单元通过所述数据传输单元与所述物理层芯片连接;
所述处理单元,具体用于将所述协商速率配置给自身的网络接口;将所述协商速率配置给所述数据传输单元;
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