[发明专利]非易失性存储器的数据路径控制有效
申请号: | 201710022600.1 | 申请日: | 2017-01-12 |
公开(公告)号: | CN107025069B | 公开(公告)日: | 2021-09-28 |
发明(设计)人: | 欧阳婧雯;呂子宜;H.张;陈映彰 | 申请(专利权)人: | 桑迪士克科技有限责任公司 |
主分类号: | G06F3/06 | 分类号: | G06F3/06 |
代理公司: | 北京市柳沈律师事务所 11105 | 代理人: | 万里晴 |
地址: | 美国得*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 非易失性存储器 数据 路径 控制 | ||
1.一种用于控制非易失性存储器的数据路径的设备,包括:
一个或多个存储器裸芯,存储器裸芯包括,
存储器核心,包括非易失性存储器单元的阵列和内部数据管线;
缓冲器,存储与存储器核心的存储操作相关联的数据;以及
内部控制器,与存储器核心通信以启动存储操作,其中,所述内部控制器响应于确定内部数据管线和缓冲器没有空的级而延迟启动存储操作,其中,响应于所述缓冲器中存在空的级,用来自所述内部数据管线的数据填充所述缓冲器中的空的级,从而在内部数据管线中创建空的级,可用于接收另外的存储操作的数据,
其中,所述内部控制器响应于确定内部数据管线和缓冲器中综合地包括空的级而启动存储操作。
2.如权利要求1所述的设备,其中:
根据存储器裸芯的内部时钟信号控制所述内部控制器启动存储操作、所述存储器核心执行存储操作、和用于存储操作的在所述存储器核心和所述缓冲器之间的数据传送;以及
根据外部时钟信号控制在缓冲器和外部控制器之间的数据传送。
3.如权利要求2所述的设备,其中,所述缓冲器包括基于内部时钟信号和外部时钟信号更新的异步先入先出(FIFO)缓冲器。
4.如权利要求2所述的设备,其中,所述内部时钟信号独立于所述外部时钟信号。
5.如权利要求2所述的设备,其中,所述内部时钟信号的时钟周期比用于在缓冲器和外部控制器之间传送存储操作的数据的时间更短。
6.如权利要求1所述的设备,进一步包括计数器,所述计数器跟踪已经由内部控制器启动的存储操作的数目和已经完成的存储操作的数目之间的差值,以确定所述内部数据管线和所述缓冲器没有空的级。
7.如权利要求6所述的设备,进一步包括同步器,所述同步器将用于在缓冲器和外部控制器之间传送存储操作的数据的、来自外部时钟域的数据传送信号转换为用于更新计数器的、在内部时钟域中的计数器更新信号。
8.如权利要求7所述的设备,其中,所述同步器包括:
输入电路,响应于所述数据传送信号的脉冲而翻转外部时钟域中的中间信号;
同步电路,将所述中间信号转换到内部时钟域;以及
输出电路,响应于已转换中间信号翻转,输出用于内部时钟域中的计数器更新信号的脉冲。
9.如权利要求8所述的设备,其中,所述同步电路包括从外部时钟域接收中间信号的第一触发器、和从第一触发器接收输出信号的第二触发器,所述第一和第二触发器在内部时钟域中操作。
10.如权利要求9所述的设备,其中,所述第二触发器的时钟输入与所述第一触发器的时钟输入相比反相。
11.如权利要求8所述的设备,其中:
所述输入电路包括接收外部时钟域中的数据传送信号作为时钟输入的触发器、和将所述输入电路的触发器的反相输出耦合到所述输入电路的触发器的数据输入的“非”门;以及
所述输出电路包括延迟已转换中间信号的触发器和基于已转换中间信号和延迟的已转换中间信号产生用于计数器更新信号的脉冲的“异或”门。
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