[发明专利]一种服务器及其处理数据的方法在审
申请号: | 201710047334.8 | 申请日: | 2017-01-22 |
公开(公告)号: | CN106708779A | 公开(公告)日: | 2017-05-24 |
发明(设计)人: | 姜凯;于治楼;王子彤 | 申请(专利权)人: | 济南浪潮高新科技投资发展有限公司 |
主分类号: | G06F15/78 | 分类号: | G06F15/78 |
代理公司: | 济南信达专利事务所有限公司37100 | 代理人: | 李世喆 |
地址: | 250100 山东省济南市*** | 国省代码: | 山东;37 |
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摘要: | |||
搜索关键词: | 一种 服务器 及其 处理 数据 方法 | ||
1.一种服务器,其特征在于,包括:处理器、第一总线、至少一条第二总线以及至少一个异构单元;
每一个所述异构单元分别通过一条所述第二总线与所述处理器相连;每一个所述异构单元均与所述第一总线相连;
所述处理器,用于当确定接收到外部输入的数据为非事务型数据时,在所述至少一个异构单元中确定至少一个目标异构单元,并将所述非事务型数据发送至所述至少一个目标异构单元;
每一个所述异构单元,用于在接收到所述处理器发送的所述非事务型数据时,对所述非事务型数据进行处理。
2.根据权利要求1所述的服务器,其特征在于,所述异构单元,包括:至少三个FPGA芯片和第三总线;
所述至少三个FPGA芯片均与所述第三总线相连;
所述至少三个FPGA芯片中的任一个FPGA芯片与对应的所述第二总线相连。
3.根据权利要求1所述的服务器,其特征在于,所述异构单元中可以包括:至少两个FPGA芯片;
每一个所述FPGA芯片分别与对应的所述第二总线相连。
4.根据权利要求1所述的服务器,其特征在于,所述异构单元,包括:至少三个FPGA芯片;
所述至少三个FPGA芯片依次连接;
处于首位的FPGA芯片和处于末位的FPGA芯片分别与对应的所述第二总线相连。
5.根据权利要求2至4任一所述的服务器,其特征在于,
与对应的所述第二总线相连的任一所述FPGA芯片与外部的至少一个存储硬盘相连。
6.根据权利要求1所述的服务器,其特征在于,进一步包括:固态硬盘和机械硬盘;
所述处理器,进一步用于接收每一个所述异构单元反馈的处理结果;将所述处理结果发送至所述固态硬盘;
所述固态硬盘,分别与所述处理器和所述机械硬盘相连,用于接收所述处理器发送的所述处理结果,存储所述处理结果;将存储的所述处理结果传输至所述机械硬盘;当接收到所述处理器发送处理结果时开始计时,当累积时长达到预先设定的时长时,删除存储的所述处理结果;
所述机械硬盘,用于接收所述固态硬盘传输的所述处理结果,并存储。
7.根据权利要求1所述的服务器,其特征在于,进一步包括:内存;
每一个所述异构单元,进一步用于将处理所述非事务型数据的过程中产生的中间数据发送至所述处理器;发送调用指令至所述处理器,接收所述处理器传输的所述中间数据;
所述处理器,进一步用于将所述中间数据发送至所述内存;根据所述异构单元发送的所述调用指令从所述内存中调取所述中间数据,并将所述中间数据发送给所述异构单元;
所述内存,用于存储所述处理器发送的所述中间数据。
8.根据权利要求1至4任一所述的服务器,其特征在于,
所述总线包括:外设部件互连标准PCIE总线或高速串行口SRIO总线;
和/或,
所述固态硬盘为非易失性存储器标准NVMe固态存储硬盘;
所述机械硬盘为串行连接SAS扩展盘阵。
9.一种利用权利要求1至8任一所述服务器处理数据的方法,其特征在于,包括:
当所述处理器确定接收到外部输入的数据为非事务型数据时,在所述至少一个异构单元中确定至少一个目标异构单元,并将所述非事务型数据发送至所述至少一个所述目标异构单元;
利用每一个所述目标异构单元接收所述处理器发送的所述非事务型数据,对所述非事务型数据进行处理。
10.根据权利要求9所述的方法,其特征在于,所述利用每一个所述目标异构单元接收所述处理器发送的所述非事务型数据,对所述非事务型数据进行处理之后,进一步包括:
利用所述处理器接收每一个所述目标异构单元反馈的处理结果,将所述处理结果发送至所述固态硬盘;
利用所述固态硬盘接收所述处理器发送的处理结果,存储所述处理结果,并将存储的所述处理结果传输至所述机械硬盘;当接收到所述处理器发送处理结果时开始计时,当累积时长达到预先设定的时长时,删除存储的所述处理结果;
利用所述机械硬盘接收所述固态硬盘传输的所述处理结果,并存储;
和/或,
进一步包括:
所述目标异构单元将处理所述非事务型数据的过程中产生的中间数据发送至所述处理器;
利用所述处理器接收所述目标异构单元发送的所述中间数据,并将所述中间数据发送至所述内存;
利用所述内存存储所述处理器发送的所述中间数据;
当接收到所述目标异构单元发送的调取指令时,利用所述处理器调取所述内存中存储的所述中间数据,并将所述中间数据发送给所述目标异构单元。
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