[发明专利]一种液晶显示装置的像素结构及液晶显示装置

说明书

技术领域

本发明涉及了像素结构技术领域，特别是涉及了一种液晶显示装置用的像素结构以及液晶显示装置。

背景技术

随着LCD技术的不断发展，为了进一步降低LCD功耗，一种新型的超低频率的液晶显示器得以出现。为了降低TFT三级管中漏电流的流失，提高存储电容维持显示的时间，在一个像素内设置两个晶体管。

如图1所示，其为现有新型的双晶体管的像素结构的电路原理示意图。该像素结构左右两端引出的是数据线2’，下端引出的是扫描线1’；该像素结构具体包括阵列排布的多条扫描线1’和多条数据线2’、以及由两条扫描线11’、12’和一数据线2’定义的像素单元3’，每一像素像素单元3’包括串联设置的两个晶体管T1’、T2’、像素电极Clc’和公共电极Vcom’，所述公共电极Vcom’形成在所述像素电极Clc’的上方，使像素电极Clc’与公共电极Vcom’形成存储电容Cs’在公共电极Vcom’上的结构形式；其中，第1个晶体管T1’和第2个晶体管T2’的栅极G分别连接位于同一像素单元3’内的两条扫描线11’、12’；第1个晶体管T1’的漏极D与第2个晶体管T2’的源极S连接，第1个晶体管T1’的源极S与所述数据线2’连接，第2个晶体管T2’的漏极D连接所述像素电极Clc’。

但是，现有双晶体管的像素结构由于每个像素单元内包含两条扫描线，分别连接两个晶体管，则扫描线的数量与现有单晶体管的像素结构相比增加了一倍，则需要相应减小存储电容面积或增大像素尺寸，而且还提高了负载阻抗和寄生电容，极大地影响显示效果。

发明内容

有鉴于此，本发明所要解决的技术问题是提供了一种液晶显示装置的像素结构，其通过在任一扫描线上直接连接位于相邻的两个像素单元内的不同位置的晶体管，扫描线的数量减少了一半，不仅节省空间，可增大存储电容面积或减小像素尺寸，提高PPI，提高显示效果。

本发明还提供了一种液晶显示装置。

本发明所要解决的技术问题通过以下技术方案予以实现：

一种液晶显示装置的像素结构，包括平行设置的若干条扫描线、沿垂直于扫描线的方向设置的若干条数据线以及交叉的扫描线和数据线定义出的多个像素单元；每一像素单元包括液晶电容及相互串联连接的第一晶体管和第二晶体管，所述第二晶体管耦合到该液晶电容；其中，任意一根所述扫描线与位于其一侧的像素单元内的第一晶体管连接，还与位于其另一侧的像素单元内的第二晶体管连接。

位于同一像素单元内的第一晶体管和第二晶体管的栅极G分别与相邻的扫描线连接；所述第一晶体管的漏极D与第二晶体管的源极S连接，第一晶体管的源极S与所述数据线连接；第二晶体管的漏极D耦合至所述液晶电容。

一种液晶显示装置，其包括形成有上述的像素结构的阵列基板、数据驱动器和扫描驱动器，所述数据驱动器位于所述阵列基板的两侧，用于向所述阵列基板上的数据线提供数据信号 ；所述扫描驱动器用于驱动所述阵列基板上的扫描线。所述扫描驱动器集成在阵列基板上。

本发明具有如下有益效果：本发明的像素结构通过在任一扫描线上直接连接位于相邻的两个像素单元内的不同位置的晶体管，即每个像素单元内的扫描线连接第一晶体管和第二晶体管，扫描线的数量减少了一半，不仅节省空间，可增大存储电容面积或减小像素尺寸，提高PPI，提高显示效果。另一方面，由于扫描线的数量减少，其负载阻抗和寄生电容也减少，其RC延迟减少，从而通过晶体管对液晶电容的充电越足。

附图说明

图1为现有双晶体管像素结构的电路原理图；

图2为本发明双晶体管像素结构的电路原理图；

图3为图2像素结构一种工作方式的波形图。

具体实施方式

下面结合实施例对本发明进行详细的说明，实施例仅是本发明的优选实施方式，不是对本发明的限定。

现有双晶体管像素结构设计由于像素内空间有限，且为了尽可能降低刷新频率，必须尽量增大存储电容，以维持画面更长时间；但现有双晶体管的像素结构由于每个像素单元内包含两条扫描线，分别连接两个晶体管，则扫描线的数量与现有单晶体管的像素结构相比增加了一倍，则需要相应减小存储电容面积但会导致存储电容降低，存储的电量不足以维持显示到下一次像素充电时间；或者，相应增大像素尺寸但会降低PPI，减小相同显示尺寸下会降低分辨率；无论是减小存储电容面积还是增大像素尺寸，都极大地影响显示效果。同时也增大了Cgs等寄生电容和负载阻抗，进一步影响显示效果。