[发明专利]一种数字多道脉冲幅度分析器的硬件电路设计方法在审
| 申请号： | 201710206742.3 | 申请日： | 2017-03-31 |
| 公开（公告）号： | CN107817512A | 公开（公告）日： | 2018-03-20 |
| 发明（设计）人： | 刘召贵;李胜辉;黄冲 | 申请（专利权）人： | 江苏天瑞仪器股份有限公司 |
| 主分类号： | G01T1/36 | 分类号： | G01T1/36 |
| 代理公司： | 暂无信息 | 代理人： | 暂无信息 |
| 地址： | 215347 江苏省苏州市昆*** | 国省代码： | 江苏;32 |
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| 摘要： | |||
| 搜索关键词： | 一种 数字 多道 脉冲幅度 分析器 硬件 电路设计 方法 | ||
1.一种数字多道脉冲幅度分析器的硬件电路设计方法，其特征在于,包括：模拟前端、A/D转换器、FPGA芯片、EMIF接口、DSP系统、SDRAM、串口、FLASH、USB、USB接口和计算机，步骤如下：
经过前端处理后的核脉冲模拟信号送入到高速所述A/D转换器进行转换，所述A/D转换器在所述FPGA的控制下将模数转换后的数字信号送入到所述FPGA，经过滤波预处理后送入所述FPGA外扩的所述SDRAM里面缓存起来，然后再送入所述DSP系统对数字化核脉冲信号进行极零相消、梯形成形和峰值检测处理得到核脉冲峰值，最后将取出的核脉冲峰值通过所述DSP系统自带的所述USB接口送到计算机上做谱分析处理。
2.根据权利要求1所述的一种数字多道脉冲幅度分析器的硬件电路设计方法，其特征在于，从探测器输出的信号经过初步放大处理后送入所述模拟前端及数据采集部分。
3.信号经过极零相消电路后送入低噪所述OPA642对信号进行放大，送入所述A/D芯片所述ADS807E中完成模数转换，所述ADS807E在FPGA的控制下进行A/D转换。
4.根据权利要求1所述的一种数字多道脉冲幅度分析器的硬件电路设计方法，其特征在于，所述FPGA芯片是所述EP1C3TC144，主要完成数据的采集、数字滤波处理、数据缓冲、以及与所述DSP的数据通信。
5.根据权利要求1所述的一种数字多道脉冲幅度分析器的硬件电路设计方法，其特征在于， 所述FPGA芯片输出的数据以DＭＡ的方式送入所述DSP外扩的大容量系统所述SDRAM存储器中，所述DSP主程序完成数据算法。
6.根据权利要求1所述的一种数字多道脉冲幅度分析器的硬件电路设计方法，其特征在于，在所述DSP中完成的算法数据经过ＵSB接口送入到PC机中对数据进行进一步处理。
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