[发明专利]电路装置、振荡器、电子设备以及移动体有效

专利信息
申请号: 201710223991.3 申请日: 2017-04-07
公开(公告)号: CN107306134B 公开(公告)日: 2022-09-09
发明(设计)人: 中岛克仁 申请(专利权)人: 精工爱普生株式会社
主分类号: H03L7/183 分类号: H03L7/183
代理公司: 北京三友知识产权代理有限公司 11127 代理人: 李辉;邓毅
地址: 日本*** 国省代码: 暂无信息
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摘要:
搜索关键词: 电路 装置 振荡器 电子设备 以及 移动
【说明书】:

电路装置、振荡器、电子设备以及移动体。电路装置包含:相位比较部,其进行基准信号与基于振荡信号的输入信号之间的相位比较;处理部,其对基于相位比较的结果的频率控制数据进行信号处理;以及振荡信号生成电路,其生成根据信号处理后的频率控制数据设定的振荡频率的振荡信号。并且,相位比较部包含利用输入信号进行计数动作的计数器,并将基准信号的n个周期(n是2以上的整数)中的计数器的计数值和计数值的期望值进行整数比较,由此进行相位比较。

技术领域

发明涉及电路装置、振荡器、电子设备以及移动体。

背景技术

一直以来,公知有OCXO(oven controlled crystal oscillator:恒温晶体振荡器)、TCXO(temperature compensated crystal oscillator:温度补偿晶体振荡器)等振荡器。在使用这样的振荡器作为基准信号源的基站、网络路由器、测量设备等中,构成包含振荡器的PLL(Phase Locked Loop:锁相环)电路,使振荡器的振荡信号与GPS信号等基准信号同步。

例如在日本特开平08-056153号公报中公开了振荡电路,该振荡电路包含:GPS接收器,其输出基准脉冲;压控振荡器,其输出时钟信号;计数器,其对基准信号的1个周期中的时钟信号的时钟数进行计数;差计算电路,其求出计数值和期望值之间的误差;以及控制电压生成电路(平均化电路和转换电路、D/A转换电路),其生成使得减小该误差的压控振荡器的控制电压。

在OCXO、TCXO等振荡器中,要求振荡信号的振荡频率的高精度化。即,在使振荡信号与基准信号同步的PLL电路中,存在想要抑制锁定状态下的基准信号和振荡信号的相位误差的要求。另一方面,期望使控制振荡器的电路装置小规模化。

发明内容

根据本发明的几个方式,可提供一种能够抑制PLL电路的锁定状态下的相位误差并且使电路装置小规模化的电路装置、振荡器、电子设备以及移动体等。

本发明正是为了解决上述课题中的至少一部分而完成的,可作为以下方式或形式来实现。

本发明的一个方式涉及电路装置,该电路装置包含:相位比较部,其进行基准信号与基于振荡信号的输入信号之间的相位比较;处理部,其对基于所述相位比较的结果的频率控制数据进行信号处理;以及振荡信号生成电路,其生成根据来自所述处理部的所述信号处理后的所述频率控制数据设定的振荡频率的所述振荡信号,所述相位比较部包含利用所述输入信号进行计数动作的计数器,进行将所述基准信号的n个周期(n是可设定为2以上的整数)中的所述计数器的计数值和所述计数值的期望值进行整数比较的所述相位比较。

根据本发明的一个方式,相位比较部进行将计数器的计数值和期望值进行整数比较的相位比较,由此能够以简单的结构来构成相位比较部。由此,能够使电路装置小规模化。此外,根据本发明的一个方式,相位比较部对基准信号的n个周期中的计数器的计数值和计数值的期望值进行整数比较。并且,n可设定为2以上。由此,能够减小由相位比较部检测的相位误差的时间分辨率。即,能够抑制包含相位比较部的PLL电路的锁定状态下的相位误差。

此外,在本发明的一个方式中,也可以是,在包含所述相位比较部的PLL电路的至少锁定状态下,将所述n设定为k1(k1是2以上的整数)。

这样,通过在锁定状态下将n设定为2以上的整数,能够在锁定状态下减小相位误差的时间分辨率,能够生成与基准信号高精度地同步的振荡信号。

此外,在本发明的一个方式中,也可以是,在所述PLL电路的起动时,将所述n设定为k2(k2是1以上且比k1小的整数)。

这样,通过在PLL电路的起动时,设定比锁定状态下的n=k1小的n=k2,相位比较的周期比锁定状态短,能够缩短从开始同步动作起到成为锁定状态为止的时间。

此外,在本发明的一个方式中,也可以是,在测试模式下,将所述n设定为k3(k3是1以上且比k1小的整数)。

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