[发明专利]相位校准方法及相关的锁相回路电路在审
申请号: | 201710316418.7 | 申请日: | 2017-05-08 |
公开(公告)号: | CN108880533A | 公开(公告)日: | 2018-11-23 |
发明(设计)人: | 卓庭楠;郑凯文;童泰来 | 申请(专利权)人: | 晨星半导体股份有限公司 |
主分类号: | H03L7/08 | 分类号: | H03L7/08;H03L7/085 |
代理公司: | 上海专利商标事务所有限公司 31100 | 代理人: | 骆希聪 |
地址: | 中国台湾新竹县*** | 国省代码: | 中国台湾;71 |
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摘要: | |||
搜索关键词: | 相位误差 导引 子帧 锁相回路电路 相位补偿信号 滤波信号 相位校准 标头 头子 无线通讯装置 导引数据 已知数据 预测 检测 | ||
一种处理相位校准的方法,用于一无线通讯装置中一锁相回路电路,包含计算一输入信号中一帧的一标头子帧的一标头相位误差及该帧中一导引子帧的一导引相位误差,其中该标头子帧及该导引子帧为已知数据;根据该标头相位误差及该导引相位误差间的关系,产生一预测相位误差;根据该预测相位误差及一滤波信号,产生一相位补偿信号;根据该相位补偿信号,调整该输入信号,以产生一补偿输入信号;检测该补偿输入信号中对应于该导引子帧的一导引数据子帧与一参考信号间的一相位误差;以及根据该相位误差,产生该滤波信号。
技术领域
本发明是指一种相位校准方法及相关的锁相回路电路,尤指一种能够依据输入信号中已知数据计算所得的相位误差间的关系,预测输入信号中未知数据的相位误差的相位校准方法及相关的锁相回路电路。
背景技术
锁相回路(Phase Locked-Loop)电路用以产生一周期性输出信号,且该周期性输出信号预期与一周期性输入信号间具有固定的相位关系。锁相回路电路被广泛地应用于各式各样的电路系统中,如无线通讯系统的数据及时钟恢复电路(Clock and DataRecovery)、收发模块(Transceiver)或时脉产生器(Frequency Synthesizer),且不限于此。
请参考图1,图1为已知技术中一锁相回路电路10的示意图。锁相回路电路10用来校准一输入信号IN与一参考信号(未绘示于图1)间的相位误差。如图1所示,锁相回路电路10包含有一乘法器100、一相位误差检测单元102、一滤波器104、一振荡器106及一相位误差预测模块108。乘法器100用来依据振荡器106产生的相位补偿信号PC调整输入信号IN的相位,以产生补偿输入信号CIN至相位误差检测单元102。相位误差检测单元102用来计算补偿输入信号CIN与一参考信号间的一相位误差Φ并输出相位误差Φ至滤波器204。滤波器104根据相位误差Φ调整振荡器106所产生的相位补偿信号PC。借由乘法器100、相位误差检测单元102、滤波器104及振荡器106形成的回路,锁相回路电路10可校准补偿输入信号CIN与参考信号间的相位误差Φ。
在图1中,相位误差预测模块108用来计算输入信号IN中已知数据的相位误差,作为输入至振荡器106的一预测相位误差ΦES。预测相位误差ΦES被用来作为锁相回路电路10校准输入信号IN中未知数据的的相位误差Φ时的起始值,以增加校准速度。然而,当用来产生预测相位误差ΦES的已知数据长度不足时,预测相位误差ΦES可能会偏离真实相位误差,降低锁相回路电路10的校准速度。因此,如何在已知数据长度不足的情况下,避免预测相位误差ΦES偏离真实相位误差,便成为业界亟欲探讨的议题。
发明内容
为了解决上述的问题,本发明提供一种能够依据输入信号中已知数据计算所得的相位误差间的关系,预测输入信号中未知数据的相位误差的相位校准方法及相关的与锁相回路电路。
在一方面,本发明揭露一种处理相位校准的方法,用于一无线通讯装置中一锁相回路电路。所述方法包含有计算一输入信号中一帧的一标头子帧的一标头相位误差及该帧中一导引子帧的一导引相位误差,其中该标头子帧及该导引子帧为已知数据;根据该标头相位误差及该导引相位误差间的关系,产生一预测相位误差;根据该预测相位误差及一滤波信号,产生一相位补偿信号;根据该相位补偿信号,调整该输入信号,以产生一补偿输入信号;检测该补偿输入信号中对应于该导引子帧的一导引数据子帧与一参考信号间的一相位误差;以及根据该相位误差,产生该滤波信号。
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