[发明专利]一种串行解串链路发射机的驱动器在审

专利信息
申请号: 201710515649.0 申请日: 2017-06-29
公开(公告)号: CN109213708A 公开(公告)日: 2019-01-15
发明(设计)人: 黄银涛;罗多纳;俞捷;罗星云;俞恢春 申请(专利权)人: 华为技术有限公司
主分类号: G06F13/40 分类号: G06F13/40;G06F13/42
代理公司: 北京同达信恒知识产权代理有限公司 11291 代理人: 冯艳莲
地址: 518129 广东*** 国省代码: 广东;44
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摘要:
搜索关键词: 预驱动信号 驱动电路 驱动器 发射机 放大处理 第一级 解串 链路 共模电压调节电路 电压调节电路 电压调节 共模电压 实时调节 实时接收 实时响应 数据信号 指示信息 阻抗匹配 输出 码流 时差
【说明书】:

一种串行解串链路发射机的驱动器,包括:第一级驱动电路,用于对实时接收的数据信号进行放大处理,得到并输出实时预驱动信号;共模电压调节电路,与所述第一级驱动电路连接,用于实时响应电压调节指示信息,以对所述实时预驱动信号的共模电压进行实时调节,得到调节后的实时预驱动信号;第二级驱动电路,与所述电压调节电路连接,用于对所述调节后的实时预驱动信号进行放大处理及阻抗匹配处理,得到并输出实时差分数据码流。

技术领域

发明实施例涉及通信技术领域,尤其涉及一种串行解串链路发射机的驱动器。

背景技术

随着通信技术的不断发展,高速串行/解串(Serializer/Deserializer,SERDES)通信链路由于可承载的数据量大和通信速度快的特点,逐渐成为高速数据通信的研究热点。

高速SERDES通信链路有多种连接方式,请参考图1,为背板通信SERDES链路的示意图,是高速SERDES通信链路的一种。在图1中,通信子板通过背板连接器与背板连接,通信子板的个数可以为两个,如图1所示,当然也可以设置两个以上。以图1为例,图1中的其中一个通信子板上配置信号发射机芯片,另一个通信子板上配置信号接收机芯片。由信号发射机芯片产生的差分数据码流,经由印制电路板(Print Circuit Board,PCB)走线以及该通信子板中的板级无源器件,到达与该通信子板连接的背板连接器,然后,通过背板中的背板信号链路,将该差分数据码流传输至与配置了信号接收机芯片的通信子板连接的背板连接器,并通过配置了信号接收机芯片的通信子板的板级无源器件、PCB走线等,最终到达信号接收机芯片。

通常来讲,在高速PCB及系统设计中,高频信号线、集成电路的引脚、各类接插件等都可能成为具有天线特性的辐射干扰源,并发射电磁波,从而造成电磁干扰(Electromagnetic Interference,EMI),导致本系统或者其他相邻的系统中的部分装置无法正常工作、系统中传输的信号失真等。而随着集成度的提高,高速SERDES通信链路中各个辐射干扰源的距离更近,EMI的问题也就越来越严重。可见,解决高速SERDES通信链路的EMI的问题迫在眉睫。

EMI主要分为共模辐射(Common-mode radiation,CM radiation)干扰和差模辐射(Differential-mode radiation,DM radiation)干扰两种。而经研究表明,无论高速SERDES通信链路是何种连接方式,EMI的共模辐射干扰都比差模辐射干扰更加显著。因此,在高速SERDES通信链路中,控制共模辐射干扰在解决EMI的问题上尤为重要。

现有技术中,可以通过对差分数据码流的上升沿和下降沿做补偿来控制共模辐射干扰。具体来讲,通过调整差分数据码流的上升沿和/或下降沿的转换速率,使差分数据码流的上升沿和下降沿始终处于匹配状态,从而削弱单个频点处的共模噪声分量。

上述技术方案实质是将单一频点处的共模噪声分量均匀分散到了整个宽带频谱上,虽然消除了共模噪声分量在单一频点的峰值,从而在一定程度上降低了差分数据码流的共模噪声,但是,在对差分数据码流的上升沿和/或下降沿的转换速率(Slew rate)进行调整时,会增加上升沿和/或下降沿上的数据的抖动,从而使得输出的差分数据码流眼图质量下降,影响通信质量。因此,如何降低差分数据码流的共模噪声且尽可能减小对通信质量的影响,是目前亟待解决的技术问题。

发明内容

本发明实施例提供一种串行解串链路发射机的驱动器,用以在保证高速SERDES通信链路的性能不变的前提下降低差分数据码流的共模噪声分量。

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