[发明专利]集成电路以及其制作方法在审
申请号: | 201710628490.3 | 申请日: | 2017-07-28 |
公开(公告)号: | CN109309085A | 公开(公告)日: | 2019-02-05 |
发明(设计)人: | 邱久容;林宏展;陈禹钧 | 申请(专利权)人: | 联华电子股份有限公司 |
主分类号: | H01L27/02 | 分类号: | H01L27/02;H01L27/04;H01L29/92 |
代理公司: | 北京市柳沈律师事务所 11105 | 代理人: | 陈小雯 |
地址: | 中国台*** | 国省代码: | 中国台湾;71 |
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摘要: | |||
搜索关键词: | 图案化介电层 底板 绝缘层 上板 集成电路 金属电容器 板设置 金属 电连接 制作 贯穿 | ||
1.一种集成电路,包括:
第一绝缘层,其中一第一沟槽贯穿该第一绝缘层;
底板,部分设置于该第一绝缘层上且部分设置于该第一沟槽中;
第一图案化介电层,设置于该底板上,其中至少部分的该第一图案化介电层设置于该第一沟槽中;
中板,设置于该第一图案化介电层上,其中至少部分的该中板设置于该第一沟槽中,且该底板、该第一图案化介电层以及该中板构成一第一金属-绝缘层-金属(metal-insulator-metal,MIM)电容器;
第二图案化介电层,设置于该中板上;以及
上板,设置于该第二图案化介电层上,其中该中板、该第二图案化介电层以及该上板构成一第二金属-绝缘层-金属电容器,且该底板与该上板电连接。
2.如权利要求1所述的集成电路,其中该上板于该第一绝缘层的一厚度方向上的投影面积小于该中板于该第一绝缘层的该厚度方向上的投影面积。
3.如权利要求1所述的集成电路,其中该中板部分设置于该第一绝缘层上且部分设置于该第一沟槽中,且该第二图案化介电层设置于该第一沟槽之外。
4.如权利要求1所述的集成电路,还包括:
第二沟槽,贯穿该第一绝缘层,其中部分的该底板、部分的该第一图案化介电层以及部分的该中板设置于该第二沟槽中。
5.如权利要求1所述的集成电路,其中至少部分的该第二图案化介电层以及至少部分的该上板设置于该第一沟槽中。
6.如权利要求1所述的集成电路,还包括:
导电层,设置于该第一绝缘层之下,其中该第一沟槽设置于该导电层上,且位于该第一沟槽内的该底板与该导电层电连接。
7.如权利要求6所述的集成电路,还包括:
第二绝缘层,设置于该第一绝缘层与该上板上;
第三沟槽,贯穿该第二绝缘层且暴露出部分的该上板;
第四沟槽,贯穿该第二绝缘层以及该第一绝缘层并暴露出部分的该导电层;以及
第一连接结构,设置于该第三沟槽以及该第四沟槽中,其中该底板通过该导电层以及该第一连接结构而与该上板电连接。
8.如权利要求7所述的集成电路,还包括:
第二连接结构,设置于该中板上且与该中板电连接,其中该第二连接结构与该第一连接结构电性分离。
9.如权利要求1所述的集成电路,其中该第一沟槽被该底板、该第一图案化介电层以及该中板填满。
10.如权利要求1所述的集成电路,其中该第一沟槽被该底板、该第一图案化介电层、该中板、该第二图案化介电层以及该上板填满。
11.一种集成电路的制作方法,包括:
形成一第一沟槽贯穿一第一绝缘层;
形成一底板,该底板部分形成于该第一绝缘层上且部分形成于该第一沟槽中;
在该底板上形成一第一图案化介电层,其中至少部分的该第一图案化介电层形成于该第一沟槽中;
在该第一图案化介电层上形成一中板,其中至少部分的该中板形成于该第一沟槽中,且该底板、该第一图案化介电层以及该中板形成一第一金属-绝缘层-金属(metal-insulator-metal,MIM)电容器;
在该中板上形成一第二图案化介电层;以及
在该第二图案化介电层上形成一上板,其中该中板、该第二图案化介电层以及该上板形成一第二金属-绝缘层-金属电容器,且该底板与该上板电连接。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的