[发明专利]一种面向时间触发通信的动态锁定时槽方法有效
申请号: | 201710676640.8 | 申请日: | 2017-08-09 |
公开(公告)号: | CN107332794B | 公开(公告)日: | 2020-07-17 |
发明(设计)人: | 哈云雪;曲超;卢飞;赵海婷 | 申请(专利权)人: | 西安微电子技术研究所 |
主分类号: | H04L12/937 | 分类号: | H04L12/937;H04W72/04;H04W72/10 |
代理公司: | 西安通大专利代理有限责任公司 61200 | 代理人: | 徐文权 |
地址: | 710065 陕西*** | 国省代码: | 陕西;61 |
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摘要: | |||
搜索关键词: | 一种 面向 时间 触发 通信 动态 锁定 方法 | ||
1.一种面向时间触发通信的动态锁定时槽方法,其特征在于,包括以下步骤:
步骤一,在发送端,软件配置TT帧寄存器时,配置下一个TT帧时槽是否有TT帧需要传输的信息;
步骤二,TT帧组帧时,需要传输的信息将填充在目的地址的对应字节内,同时,该信息会被存储在发送调度模块的本地fifo中;
步骤三,当TT帧时槽到来时,软件会将本帧发送,同时,读取发送调度模块存储下一个TT帧是否有效的本地存储单元,如果有效,则将下一时槽留给下一个TT帧进行发送;如果无效,则根据优先级由高到低的原则,判断此时如果有RC帧,则该TT时槽留给RC帧,没有RC帧,则将该TT帧时槽留给BE帧进行发送;
步骤四,当交换机收到TT帧时,解析帧的目的地址为填充有需要传输的信息的字节;
步骤五,判断下一个TT时槽是否还是TT帧,若是,则返回步骤二,若否,则所有TT帧发送完成;
发送端包括主机内存、逻辑储存和发送仲裁,逻辑储存和发送仲裁均为FPGA;其中主机内存是在软件层面做的,逻辑存储和发送仲裁是FPGA做的;
软件在发送TT帧时遇到下一帧无帧发送的情况就将标识TT帧有无的信息位置0,随后传递给FPGA,FPGA先解析该信息位,如果为1,则将该帧写入FPGA缓存中,同时,将信息位写入标志TT帧有无的缓存空间;信息位如果为0,则将该帧不被写入FPGA缓存中,但信息位仍会写入FPGA中标志TT帧有无的缓存空间;与此同时,需要发送的RC帧和BE帧会被写入各自的缓存空间;FPGA控制发送时,在TT帧的时槽,先查找信息位,如果信息位为1,则在下一个TT帧时槽读取TT帧缓存,发送到链路;如果为0,则查看RC帧,如果有,则在下一个TT帧时槽发送RC帧,若无,则发送BE帧;如果是SM发到CM的帧,接收时还按照原先接收方式接收,在CM发送时,会按照新的链路号重新分配链路,同时按照TT帧的有无,综合上述机制,将TT帧和标志位分别写入缓存,发送即可;
帧格式中目的地址的高4字节中有30个比特位都是没有定义的,用这30个比特位来作为下一帧TT帧时槽是否有TT帧需要传输的标识。
2.根据权利要求1所述的一种面向时间触发通信的动态锁定时槽方法,其特征在于,接收端的FPGA根据接收到信息的帧头携带的帧类型信息将TT帧、RC帧和BE帧分别接收缓存。
3.根据权利要求1所述的一种面向时间触发通信的动态锁定时槽方法,其特征在于,所述步骤二中,发送端在TT帧组帧时,在目的地址段的常数域中加入下一帧TT帧时槽是否有TT帧需要传输的标志位,在下一帧发送时解析该标志位,若有TT帧需要传送,则在TT帧时槽传送TT帧,如果没有,则该时槽传输RC帧或BE帧。
4.根据权利要求1所述的一种面向时间触发通信的动态锁定时槽方法,其特征在于,交换机转发数据帧时,进行时槽的动态锁定。
5.根据权利要求4所述的一种面向时间触发通信的动态锁定时槽方法,其特征在于,交换机设备接收到TT、RC和BE帧时会分类存储。
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