[发明专利]一种USBType‑C线缆的双向信号调节芯片及USBType‑C线缆在审

专利信息
申请号: 201710801163.3 申请日: 2017-09-07
公开(公告)号: CN107544934A 公开(公告)日: 2018-01-05
发明(设计)人: 陶成;陈余;徐希;祝欣 申请(专利权)人: 龙迅半导体(合肥)股份有限公司
主分类号: G06F13/40 分类号: G06F13/40;G06F13/42
代理公司: 北京集佳知识产权代理有限公司11227 代理人: 王宝筠
地址: 230601 安徽省合肥市*** 国省代码: 安徽;34
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摘要:
搜索关键词: 一种 usbtype 线缆 双向 信号 调节 芯片
【权利要求书】:

1.一种USB Type-C线缆的双向信号调节芯片,其特征在于,所述芯片包括:存储器、处理器以及转接驱动器,所述转接驱动器用于对高速信号从USB Type-C线缆第一端到USBType-C线缆第二端或者从USB Type-C线缆第二端到USB Type-C线缆第一端进行再生传输;

所述存储器用于存储程序代码,所述处理器用于调用所述程序代码,当所述程序代码被执行时,用于执行以下操作:

判断USB Type-C线缆的数据传输方向;

判断所述USB Type-C线缆上的传输数据所支持的类型;

依据所述数据传输方向和传输数据所支持的类型配置所述转接驱动器中用于传输数据信号的各个缓冲器的通断状态,使得所述转接驱动器的数据输出方向与所述数据传输方向保持一致;

其中,所述双向信号调节芯片内每条数据传输线路上配置有两个方向相反的缓冲器;

所述转接驱动器包括:

设置在USB Type-C线缆第一端的TX2A±高速差分对接口和线缆第二端的TX2B±高速差分对接口之间的第一A缓冲器和第一B缓冲器,所述第一A缓冲器的输入端与所述TX2B±高速差分对接口相连,所述第一A缓冲器的输出端与所述TX2A±高速差分对接口相连;所述第一B缓冲器的输入端与所述TX2A±高速差分对接口相连,所述第一B缓冲器的输出端与所述TX2B±高速差分对接口相连;

设置在USB Type-C线缆第一端的RX2A±高速差分对接口和线缆第二端的RX2B±高速差分对接口之间的第二A缓冲器和第二B缓冲器,所述第二A缓冲器的输入端与所述RX2B±高速差分对接口相连,所述第二A缓冲器的输出端与所述RX2A±高速差分对接口相连;所述第二B缓冲器的输入端与所述RX2A±高速差分对接口相连,所述第二B缓冲器的输出端与所述RX2B±高速差分对接口相连;

设置在USB Type-C线缆第一端的TX1A±高速差分对接口和线缆第二端的TX1B±高速差分对接口之间的第三A缓冲器和第三B缓冲器,所述第三A缓冲器的输入端与所述TX1B±高速差分对接口相连,所述第三A缓冲器的输出端与所述TX1A±高速差分对接口相连;所述第三B缓冲器的输入端与所述TX1A±高速差分对接口相连,所述第三B缓冲器的输出端与所述TX1B±高速差分对接口相连;

设置在USB Type-C线缆第一端的RX1A±高速差分对接口和线缆第二端的RX1B±高速差分对接口之间的第四A缓冲器和第四B缓冲器,所述第四A缓冲器的输入端与所述RX1B±高速差分对接口相连,所述第四A缓冲器的输出端与所述RX1A±高速差分对接口相连;所述第四B缓冲器的输入端与所述RX1A±高速差分对接口相连,所述第四B缓冲器的输出端与所述RX1B±高速差分对接口相连。

2.根据权利要求1所述的USB Type-C线缆的双向信号调节芯片,其特征在于,所述控制器在依据所述数据传输方向和传输数据所支持的类型配置所述转接驱动器中用于传输数据信号的各个缓冲器的通断状态时,具体用于执行以下操作:

当检测到所述USB Type-C线缆由第一端向第二端进行数据传输时,如果所述传输数据所支持的类型为第一类型,则控制第一B缓冲器、第三B缓冲器、第二A缓冲器和第四A缓冲器开启,其他缓冲器关闭;如果所述数据传输所支持的类型为第二类型或所述数据传输所支持的类型为第三类型且Pin Assignment类型为C/E型时,则控制所述第一B缓冲器、第二B缓冲器、第三B缓冲器和第四B缓冲器开启,其他缓冲器关闭;如果所述数据传输所支持的类型为第三类型且Pin Assignment类型为D/F型时,则控制所述第一B缓冲器、第二B缓冲器、第三B缓冲器和第四A缓冲器开启,其他缓冲器关闭;

当检测到所述USB Type-C线缆由第二端向第一端进行数据传输时,如果所述传输数据所支持的类型为第一类型,则控制第一B缓冲器、第三B缓冲器、第二A缓冲器和第四A缓冲器开启,其他缓冲器关闭;如果所述数据传输所支持的类型为第二类型或所述数据传输所支持的类型为第三类型且Pin Assignment类型为C/E型时,则控制所述第一A缓冲器、第二A缓冲器、第三A缓冲器和第四A缓冲器开启,其他缓冲器关闭;如果所述数据传输所支持的类型为第三类型且PIN ASSIGNMENT类型为D/F型时,则控制所述第一B缓冲器、第二A缓冲器、第三A缓冲器和第四A缓冲器开启,其他缓冲器关闭。

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