[发明专利]一种基于片外缓存的流水统计方法和统计芯片有效

专利信息
申请号: 201710813179.6 申请日: 2017-09-11
公开(公告)号: CN107766284B 公开(公告)日: 2021-09-07
发明(设计)人: 陈水忠;陈腾;孟晶;刘长辉 申请(专利权)人: 中国航空工业集团公司洛阳电光设备研究所
主分类号: G06F15/78 分类号: G06F15/78
代理公司: 郑州睿信知识产权代理有限公司 41119 代理人: 崔旭东
地址: 471009 *** 国省代码: 河南;41
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摘要:
搜索关键词: 一种 基于 缓存 流水 统计 方法 芯片
【权利要求书】:

1.一种基于片外缓存的流水统计方法,其特征在于,步骤如下:

根据统计地址读取缓存,将读取的统计地址以及累加值存入内部RAM矩阵中,RAM矩阵由至少两个RAM单元构成;每个RAM单元的深度为n,n对应统计芯片读取数据延迟;每个RAM单元均设置有对应的地址寄存器及累加寄存器,每个RAM单元包括有效标志、统计地址和累加值,每个时钟周期写入一次统计地址以及累加值;每个时钟周期往每个RAM单元对应的地址寄存器中写入有效标志,若当前时钟周期不需要统计,则将有效标志置为0,否则置为1;

每个时钟周期,对RAM矩阵中的一个RAM单元做累加统计,从而对每个RAM单元进行累加统计,对地址一致的累加值做累加;

读取的数据到来时,将RAM矩阵的累加值与读取的数据做累加,将统计结果再写回缓存芯片。

2.根据权利要求1所述的一种基于片外缓存的流水统计方法,其特征在于,每个RAM单元对应一个从0~n-1的循环统计寄存器作为每个RAM单元的地址寄存器。

3.一种统计芯片,其特征在于,所述统计芯片用于连接缓存芯片,设有RAM矩阵,RAM矩阵由至少两个RAM单元构成,每个RAM单元的深度为n,n对应统计芯片读取数据延迟;每个RAM单元均设置有对应的地址寄存器及累加寄存器,每个RAM单元包括有效标志、统计地址和累加值;所述统计芯片用于:根据统计地址读取缓存,将读取的统计地址以及累加值存入内部RAM矩阵中,每个时钟周期写入一次统计地址以及累加值;每个时钟周期往每个RAM单元对应的地址寄存器中写入有效标志,若当前时钟周期不需要统计,则将有效标志置为0,否则置为1;每个时钟周期,对RAM矩阵中的一个RAM单元做累加统计,从而对每个RAM单元进行累加统计,对地址一致的累加值做累加;读取的数据到来时,将RAM矩阵的累加值与读取的数据做累加,将统计结果再写回缓存芯片。

4.根据权利要求3所述的一种统计芯片,其特征在于,每个RAM单元对应一个从0~n-1的循环统计寄存器作为每个RAM单元的地址寄存器。

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