[发明专利]一种安全计算机的处理器系统有效
申请号: | 201710973157.6 | 申请日: | 2017-10-18 |
公开(公告)号: | CN107832244B | 公开(公告)日: | 2020-10-20 |
发明(设计)人: | 孙超;刘贞;左林;王一民 | 申请(专利权)人: | 北京全路通信信号研究设计院集团有限公司 |
主分类号: | G06F13/40 | 分类号: | G06F13/40;G06F13/20;G06F13/42 |
代理公司: | 北京知联天下知识产权代理事务所(普通合伙) 11594 | 代理人: | 王冲;吴鑫 |
地址: | 100070 北京市丰台区丰*** | 国省代码: | 北京;11 |
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摘要: | |||
搜索关键词: | 一种 安全 计算机 处理器 系统 | ||
本发明提供了一种安全计算机的处理器系统,该系统包括:载板和主板,载板与主板之间的接口为通用定义接口,其中,载板包括:主处理器最小系统,用于进行安全数据处理;主板包括:协处理器,用于为主处理器最小系统拓展低速总线接口,协处理器通过低速总线接口进行底层输入输出控制。通过本发明的协处理器,可以拓展主处理器最小系统不具备的低速总线接口,从而可以实现底层IO控制。
技术领域
本发明涉及通信领域,具体地,涉及一种安全计算机的处理器系统。
背景技术
目前,在工业设备领域,通常要求安全计算机具有较高的运算、传输和控制能力,在全生命周期(10-15年)具有良好通用型,可升级维护性。但是,目前高速处理器芯片升级很快,传统计算机设备在3-5年后,初始设计的处理器已经停产,若要继续对计算机维护和升级,只能对整个系统进行重新设计。并且,目前高运算性能处理器普遍对各种低速端口(例如,SPI(Serial Peripheral Interface,串行外设接口)、I2C、CAN(ControllerAreaNetwork,控制器局域网络)、UART(Universal Asynchronous Receiver/Transmitter,通用异步收发传输器)等)扩展较少,对底层控制响应很慢,无法完成主处理器对内部其他低速总线、实时功能模块的控制。
发明内容
有鉴于此,本发明的目的在于提供一种安全计算机的处理器系统,以解决上述提及的至少一个问题。
本发明提供了一种安全计算机的处理器系统,该系统包括:载板和主板,载板与主板之间的接口为通用定义接口,其中,载板包括:主处理器最小系统,用于进行安全数据处理;主板包括:协处理器,用于为主处理器最小系统拓展低速总线接口,协处理器通过低速总线接口进行底层输入输出控制。
上述主处理器最小系统与协处理器通过串行总线进行通信。
具体地,通用定义接口包括高速通信接口和低速通信接口。
上述主板还包括:通信模块,与高速通信接口连接,用于与其他设备进行通信。
上述主板还包括:接口拓展模块,与低速通信接口连接,用于拓展主处理器最小系统的并行总线接口。
上述接口拓展模块与协处理器通过串行总线连接。
具体地,上述主板还包括:电源模块,用于为载板提供电源并监测主处理器最小系统的电源信息。
上述主板还包括:存储模块,用于为主板和载板存储数据。
上述主板还包括:监控模块,用于对主处理器最小系统的工作状态进行监控。
上述主处理器最小系统通过安全数据网络进行安全数据处理。
通过协处理器拓展主处理器最小系统不具备的低速总线接口,可以实现底层IO(Input Output,输入输出)控制,从而可以克服现有技术中的高运算性能处理器对各种低速端口扩展较少、对底层控制响应很慢、无法完成主处理器对内部其他低速总线、实时功能模块控制的缺陷。
附图说明
通过以下参照附图对本发明实施例的描述,本发明的上述以及其它目的、特征和优点将更为清楚,在附图中:
图1是根据本发明实施例的安全计算机处理器系统的结构框图;
图2是根据本发明实施例的安全计算机处理器系统的详细结构框图;
图3是根据本发明实施例的安全计算机处理器系统的结构拓扑图。
具体实施方式
以下基于实施例对本发明进行描述,但是本发明并不仅仅限于这些实施例。
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