[发明专利]一种一发多收的雷达系统在审

专利信息
申请号: 201711040736.1 申请日: 2017-10-31
公开(公告)号: CN107621631A 公开(公告)日: 2018-01-23
发明(设计)人: 万永伦;刘进军 申请(专利权)人: 成都瑞达物联科技有限公司
主分类号: G01S13/02 分类号: G01S13/02
代理公司: 暂无信息 代理人: 暂无信息
地址: 610000 四川省*** 国省代码: 四川;51
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摘要:
搜索关键词: 一种 一发 雷达 系统
【权利要求书】:

1.一种一发多收的雷达系统,其特征在于:它包括天线模块、T/R模块组、数据传送与采集模块、主控/数据处理模块、射频综合模块、信号处理模块、时钟信号模块、同步控制器;所述的天线模块与所述T/R模块组相互连接;所述的T/R模块组与所述数据传送与采集模块相互连接;所述的射频综合模块与所述信号处理模块相互连接;所述的信号处理模块与所述数据传送与采集模块相互连接;所述的主控/数据处理模块与所述信号处理模块相互连接;所述的主控/数据处理模块的输出端与所述数据传送与采集模块和所述同步控制器的输入端连接;所述的时钟信号模块的信号输出端与所述信号处理模块、所述射频综合模块和所述数据传送与采集模块的输入端连接;所述的同步控制器的输出端与所述信号处理模块和所述T/R模块组的输入端连接。

2.根据权利要求1所述的一种一发多收的雷达系统,其特征在于:所述的天线模块包括一个发送天线和接收天线阵列;所述的接收天线阵列包括至少两个接收天线;所述的T/R模块组的信号输出端与所述发送天线连接;所述的接收天线将接收到的回波信号发送到T/R模块组的信号输入端。

3.根据权利要求1所述的一种一发多收的雷达系统,其特征在于:所述的信号处理模块包括时钟电路、FPGA单元、DSP单元、ADC、DAC、滤波单元、AGC单元和第一功率放大单元;所述的主控/数据处理模块和数据传输与采集模块的输出端与所述FPGA单元的信号输入端连接;所述的DSP单元的数据输出端与所述主控/数据处理模块的数据输入端连接;所述的时钟电路的输出端与所述FPGA单元的时钟信号输入端连接;所述的FPGA单元的信号输出端与所述DSP单元和所述数据传送与采集模块的信号输入端连接;所述的DSP单元的信号输出端与所述DAC的信号输入端连接;所述的DAC的信号输出端与所述射频综合模块的信号输入端连接;所述的第一功率放大单元的信号输出端与所述AGC单元和滤波单元的信号输入端连接;所述的AGC单元的信号输出端与所述第一功率放大单元的信号输入端连接;所述的滤波单元的信号输出端与所述ADC的信号输入端连接;所述的ADC的信号输出端与所述FPGA单元的信号输入端连接。

4.根据权利要求3所述的一种一发多收的雷达系统,其特征在于:所述的射频综合模块包括VCO单元、第二功率放大单元、低噪声放大单元和差拍处理单元;所述的VCO单元的信号输出端与所述第二功率放大单元的信号输入端连接;所述的第二功率放大单元的信号输出端与所述T/R模块组的输入端连接;所述的T/R模块组的输出端与所述低噪声放大器的输入端连接;所述的第二功率放大单元的信号输出端还与所述差拍处理单元的信号输入端连接;所述的射频综合模块中的差拍处理单元的信号输出端与所述信号处理模块中的第一功率放大单元的信号输入端连接。

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