[发明专利]电路系统有效
申请号: | 201711090659.0 | 申请日: | 2017-11-08 |
公开(公告)号: | CN108288964B | 公开(公告)日: | 2021-08-27 |
发明(设计)人: | 李文明 | 申请(专利权)人: | 南亚科技股份有限公司 |
主分类号: | H03K19/0175 | 分类号: | H03K19/0175 |
代理公司: | 隆天知识产权代理有限公司 72003 | 代理人: | 李昕巍;章侃铱 |
地址: | 中国台*** | 国省代码: | 台湾;71 |
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摘要: | |||
搜索关键词: | 电路 系统 | ||
1.一种能够减少导线数目的电路系统,包含:
一源电路;
一第一电路;
一第二电路;及
一数据分布电路,包括:
一接收电路,用以经由一第一前端线路及一第二前端线路从该源电路接收用于该第一电路的一第一数据、及经由一第三前端线路及一第四前端线路从该源电路接收用于该第二电路的一第二数据;及
一发送电路,用以经由一第一中间线路及一第二中间线路接收该第一数据及该第二数据中的一者、经由一第三中间线路接收与该第一数据及该第二数据中的该者相关的一目标位址、及根据该目标位址提供该第一数据及该第二数据中的该者给该第一电路及该第二电路中的一者。
2.如权利要求1所述的电路系统,其中用以提供该第一数据及该第二数据中的该者给该第一电路及该第二电路中的该者的该发送电路进一步包含:该发送电路是用以经由一第一后端线路及一第二后端线路提供该第一数据给该第一电路、或经由一第三后端线路及一第四后端线路提供该第二数据给该第二电路。
3.如权利要求2所述的电路系统,其中该发送电路包含:
一第一闩锁器,用以在该目标位址与该第一电路的一第一位址完全相同时提供该第一数据给该第一电路;以及
一第二闩锁器,用以在该目标位址与该第二电路的一第二位址完全相同时提供该第二数据给该第二电路。
4.如权利要求3所述的电路系统,其中用以在该目标位址与该第一位址完全相同时提供该第一数据给该第一电路的该第一闩锁器包含:用以经由该第一后端线路及该第二后端线路提供该第一数据给该第一电路的该第一闩锁器;及
其中用以在该目标位址与该第二位址完全相同时提供该第二数据给该第二电路的该第二闩锁器包含:用以经由该第三后端线路及该第四后端线路提供该第二数据给该第二电路的该第二闩锁器。
5.如权利要求3所述的电路系统,其中该第一闩锁器及该第二闩锁器二者都经由该第一中间线路及该第二中间线路接收该第一数据及该第二数据中的该者。
6.如权利要求5所述的电路系统,其中该第一闩锁器及该第二闩锁器二者都经由该第三中间线路接收该目标位址。
7.如权利要求3所述的电路系统,其中该接收电路包含:
一第一判定电路,用以在该第一数据被更新时提供该第一数据及作为该目标位址的该第一位址给该发送电路;及
一第二判定电路,用以在该第二数据被更新时提供该第二数据及作为该目标位址的该第二位址给该发送电路。
8.如权利要求7所述的电路系统,
其中,该第一判定电路进一步用以通过比较该第一数据与一第一早先数据来判定该第一数据是否被更新,其中该第一早先数据是比该第一数据早被接收,及
其中,该第二判定电路进一步用以通过比较该第二数据与一第二早先数据来判定该第二数据是否被更新,其中该第二早先数据是比该第二数据早被接收。
9.如权利要求8所述的电路系统,其中该第一判定电路包含:
一第一异或XOR逻辑门,耦合至该第一前端线路及该第二前端线路以接收该第一数据,且耦合至一第一内线路及一第二内线路以接收该第一早先数据;
一第一多工器MUX,在该第一MUX的受控端耦合至该第一XOR逻辑门的一输出且在该第一MUX的输出耦合至该第三中间线路,且用以接收该第一位址;及
一第二MUX,在该第二MUX的受控端耦合至该第一XOR逻辑门的该输出、分别在该第二MUX的第一输入及第二输入耦合至该第一前端线路及该第二前端线路、且分别在该第二MUX的第一输出及第二输出耦合至该第一中间线路及该第二中间线路。
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