[发明专利]链接的存储系统和主机系统错误校正码有效
申请号: | 201711128948.5 | 申请日: | 2017-11-15 |
公开(公告)号: | CN108073471B | 公开(公告)日: | 2021-06-25 |
发明(设计)人: | 山本智 | 申请(专利权)人: | 西部数据技术公司 |
主分类号: | G06F11/10 | 分类号: | G06F11/10 |
代理公司: | 北京市柳沈律师事务所 11105 | 代理人: | 万里晴 |
地址: | 美国加利*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 链接 存储系统 主机 系统 错误 校正 | ||
这里描述的是用于在向数据存储设备写入数据和从数据存储设备读取数据时提供错误校正的增强。在一个实施方式中,使用编码器矩阵来为数据集生成主机系统上的第一错误校正码(ECC)奇偶校验数据以及耦合到主机系统的数据存储设备上的轨道的第二ECC奇偶校验数据。一旦被生成,数据存储设备可以将数据集以及第一和第二ECC奇偶校验数据存储在设备的存储介质上。当需要读取时,存储设备可以向主机系统提供数据集的第一版本以及第一和第二ECC奇偶校验数据,允许主机系统使用奇偶校验数据来生成数据集的校正版本。
技术领域
本公开涉及存储器领域,且更具体地涉及管理数据集的数据奇偶校验的计算装置和计算系统。
技术背景
诸如硬盘驱动器和固态驱动器的存储设备为主机处理系统提供存储介质以存储和读取各种数据对象。这些数据对象可以包括能够由主机处理系统处理的图像、视频、文档、电子表格和各种其他文件类型。为了使存储介质对主机系统可用,可以使用小型计算机系统接口(SCSI)总线、串行连接SCSI(SAS)总线、串行高级技术附件(Serial AdvancedTechnology Attachment)SATA)总线、高速外围组件互连(PCIe)总线、光纤通道或一些其他类似的接口或总线来通信地耦合存储设备的一个或多个。
在一些示例中,存储设备可以包括能够在存储的数据被写入到存储介质时管理和监视所存储的数据的处理系统。具体地,处理系统可以能够识别要被写入到存储介质的数据,为待写入的数据生成错误校正码(ECC)或奇偶校验数据,以及将具有ECC数据的数据写入到存储介质。然后,当接收到读取请求时,该ECC信息可以被存储系统使用,以帮助确保通过将ECC数据应用于数据以及校正扇区内的任何错误来将正确的数据提供给处理系统。但是,存储设备可能会限制主机处理系统可以校正的扇区的数量。
此外,在一些实施方式中,写入验证(Write Verify)功能可以由主机处理系统相对于存储设备使用,以确保正确的数据被写入存储介质。该功能允许在写入命令之后立即执行读取命令,以确保数据已经适当地写入存储介质。但是,这个额外的读取命令可能会导致硬盘驱动器的性能损失,因为每次读取都占用可能专用于设备上其他读取和写入操作的资源。
发明内容
本文公开的示例提供了在向数据存储设备写入数据和从数据存储设备读取数据时使用错误校正码(ECC)数据的增强。在一个实施方式中,计算装置包括一个或多个计算机可读存储介质以及与一个或多个计算机可读存储介质可操作地耦合的处理系统。计算装置还包括存储在一个或多个计算机可读存储介质上的程序指令,用于操作主机系统以管理数据集的存储,数据集在被处理系统读取和执行时指示处理系统至少:响应于对数据集的读取请求,从数据存储设备接收数据集的第一版本、由主机系统生成的数据集的第一错误校正码(ECC)奇偶校验数据以及由数据存储设备为数据集生成的第二ECC奇偶校验数据,其中第一ECC奇偶校验数据和第二ECC奇偶校验数据是使用编码器矩阵生成的。程序指令还指示处理系统使用第一ECC奇偶校验数据、第二ECC奇偶校验数据和编码器矩阵来至少处理数据集的第一版本以生成具有从数据集的第一版本校正的一个或多个扇区错误的第二版本的数据集。
在至少一个实施方式中,程序指令还可以指示处理系统响应于对数据集的写入请求,使用编码器矩阵生成数据集的第一ECC奇偶校验数据,以及将数据和第一ECC奇偶校验数据传送到数据存储设备以由数据存储设备存储。
附图说明
以下描述和相关附图教导了本发明的最佳模式。为了教导发明原理的目的,可以简化或省略最佳模式的一些常规方面。以下权利要求指定了本发明的范围。注意,最佳模式的一些方面可能不落入如权利要求所规定的本发明的范围内。因此,本领域技术人员将会理解落入本发明范围内的最佳模式的变化。本领域的技术人员将会理解,下面描述的特征可以以各种方式进行组合以形成本发明的多种变型。结果,本发明不限于下面描述的具体示例,而仅限于权利要求及其等同物。
图1示出根据一个实施方式的链接主机系统的错误校正码和数据存储设备的错误校正码的系统。
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